Digitaltechnik: Grundlagen, VHDL, FPGAs, Mikrocontroller
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| Previous Title: | Woitowitz, Roland Digitaltechnik |
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| Format: | Book |
| Language: | German |
| Published: |
Berlin
Springer Vieweg
[2016]
|
| Edition: | 7., überarbeitete und aktualisierte Auflage |
| Series: | Springer-Lehrbuch
OnlinePlus |
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| Online Access: | Inhaltstext Inhaltsverzeichnis Inhaltsverzeichnis |
| Physical Description: | XXIII, 560 Seiten Illustrationen, Diagramme |
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INHALTSVERZEICHNIS
1
EINFUEHRUNG.
1
1.1 ARBEITSWEISE DIGITALER
SCHALTUNGEN. 2
1.1.1 DARSTELLUNG VON
INFORMATIONEN. 2
1.1.2 LOGIK-PEGEL UND
LOGIK-ZUSTAND. 2
1.1.3 VERARBEITUNG VON
INFORMATIONEN. 3
1.1.4 BEISPIEL: EINFACHER
GRAFIKCONTROLLER. 4
1.1.5 BEISPIEL: ZAEHLER IM
GRAFIKCONTROLLER. 6
1.2 TECHNISCHE REALISIERUNG DIGITALER
SCHALTUNGEN. 7
1.2.1
LOGIKBAUSTEINE.
7
1.2.2 KUNDENSPEZIFISCHE INTEGRIERTE SCHALTUNG
.
8
1.2.3
STANDARDBAUELEMENTE.
8
1.2.4 PROGRAMMIERBARE
SCHALTUNG. 9
1.2.5
MIKROCONTROLLER.
10
1.3 DIGITALE UND ANALOGE
INFORMATIONEN.
11
1.3.1 DARSTELLUNG VON
INFORMATIONEN. 11
1.3.2 VOR- UND NACHTEILE DER
DARSTELLUNGEN. 11
1.3.3 WERT-UND
ZEITDISKRET.
12
1.4
UEBUNGSAUFGABEN.
13
2 DIGITALE CODIERUNG VON INFORMATIONEN
.
17
2.1
GRUNDLAGEN.
18
2.2 VORZEICHENLOSE
ZAHLEN.
19
2.2.1
STELLENWERTSYSTEME.
19
2.2.2 DARSTELLUNG VORZEICHENLOSER ZAHLEN IN DER DIGITALTECHNIK
.
20
2.2.3 UMWANDLUNG ZWISCHEN ZAHLENSYSTEMEN
.
22
2.2.4 BEISPIELE ZUR UMWANDLUNG ZWISCHEN ZAHLENSYSTEMEN
.
22
2.2.5 WERTEBEREICHE UND
WORTBREITE. 24
2.2.6 ZAHLENDARSTELLUNG MIT BEGRENZTER WORTBREITE
.
25
2.2.7 BINAERE VORZEICHENLOSE
ADDITION. 26
2.2.8 BINAERE VORZEICHENLOSE
SUBTRAKTION. 27
2.2.9 BINAERE VORZEICHENLOSE MULTIPLIKATION UND DIVISION
.
29
2.3 VORZEICHENBEHAFTETE
ZAHLEN.
30
2.3.1
VORZEICHEN-BETRAG-DARSTELLUNG.
30
2.3.2
ZWEIERKOMPLEMENT-DARSTELLUNG.
32
2.3.3 ADDITION UND SUBTRAKTION IN ZWEIERKOMPLEMENT-DARSTELLUNG. . . 34
2.3.4 MULTIPLIKATION UND DIVISION IN
ZWEIERKOMPLEMENT-DARSTELLUNG.
35
2.3.5
BIAS-DARSTELLUNG.
36
2.3.6 DARSTELLBARE
ZAHLENBEREICHE.
36
2.4 REELLE
ZAHLEN.
37
2.4.1
FESTKOMMA-DARSTELLUNG.
37
2.4.2
GLEITKOMMA-DARSTELLUNG.
38
2.4.3 REELLE ZAHLEN IN DIGITALEN SYSTEMEN
.
39
2.5
CODES.
39
2.5.1
BCD-CODE.
40
2.5.2
GRAY-CODE.
41
2.5.3
1-AUS-N-CODE.
43
2.5.4
ASCII-CODE.
44
2.5.5
7-SEGMENT-CODE.
44
2.6
UEBUNGSAUFGABEN.
47
3 EINFUEHRUNG IN V H D L
.
51
3.1 DESIGNMETHODIK IM
UEBERBLICK.
52
3.2 GRUNDSTRUKTUR EINES
VHDL-MODULS. 54
3.2.1
BIBLIOTHEKEN.
55
3.2.2 ENTITY UND
ARCHITECTURE.
56
3.2.3
BEZEICHNER.
57
3.3 GRUNDLEGENDE
DATENTYPEN.
58
3.3.1
INTEGER.
58
3.3.2 S TD JO G IC
.
59
3.3.3
STD_LOGIC_VECTOR.
60
3.3.4 SIGNED UND
UNSIGNED.
61
3.3.5
KONSTANTEN.
62
3.3.6 UMWANDLUNG ZWISCHEN DATENTYPEN
.
63
3.3.7 DATENTYP B
IT.
64
3.4
OPERATOREN.
65
3.5
SIGNALE.
67
3.5.1 DEFINITION UND VERWENDUNG VON SIGNALEN
.
67
3.5.2
SIGNALZUWEISUNGEN.
68
3.6
PROZESSE.
69
3.6.1 SYNTAKTISCHER AUFBAU VON PROZESSEN
.
70
3.6.2 AUSFUEHRUNG VON
PROZESSEN. 71
3.6.3
VARIABLEN.
72
3.6.4 SIGNALZUWEISUNGEN IN
PROZESSEN. 73
3.6.5 WICHTIGE SPRACHKONSTRUKTE IN VHDL-PROZESSEN.
75
3.7
HIERARCHIE.
79
3.8
UEBUNGSAUFGABEN.
81
4 KOMBINATORISCHE
SCHALTUNGEN.
85
4.1
SCHALTALGEBRA.
86
4.1.1 SCHALTFUNKTION UND
SCHALTZEICHEN. 86
4.1.2
FUNKTIONSTABELLE.
87
4.1.3 FUNKTIONSTABELLE MIT
DON*T-CARE. 87
4.2 FUNKTIONEN DER
SCHALTALGEBRA.
88
4.2.1
UND-VERKNUEPFUNG.
89
4.2.2
ODER-VERKNUEPFUNG.
90
4.2.3 NEGATION,
INVERTER.
90
4.2.4
NAND-VERKNUEPFUNG.
91
4.2.5
NOR-VERKNUEPFUNG.
92
4.2.6 XOR-VERKNUEPFUNG
.
92
4.2.7
XNOR-VERKNUEPFUNG.
92
4.2.8 WEITERE
VERKNUEPFUNGEN.
93
4.2.9
LOGIKSTUFEN.
93
4.2.10 US-AMERIKANISCHE
LOGIKSYMBOLE. 94
4.3 RECHENREGELN DER
SCHALTALGEBRA.
94
4.3.1
VORRANGREGELN.
94
4.3.2
RECHENREGELN.
95
4.4 SCHALTUNGSENTWURF DURCH
MINIMIEREN. 98
4.4.1
MINTERME.
98
4.4.2 SCHALTUNGSENTWURF MIT
MINTERMEN. 98
4.4.3 MINIMIERUNG VON
MINTERMEN. 99
4.4.4
MAXTERME.
100
4.4.5 SCHALTUNGSENTWURF MIT
MAXTERMEN. 100
4.4.6 MINIMIERUNG VON M
AXTERMEN. 100
4.5 SCHALTUNGSMINIMIERUNG MIT KARNAUGH-DIAGRAMM
.
101
4.5.1 GRUNDSAETZLICHE
VORGEHENSWEISE. 101
4.5.2 KARNAUGH-DIAGRAMM FUER ZWEI VARIABLEN
.
102
4.5.3 KARNAUGH-DIAGRAMM FUER DREI VARIABLEN
.
103
4.5.4 KARNAUGH-DIAGRAMM FUER VIER VARIABLEN
.
104
4.5.5 AUSWAHL DER ERFORDERLICHEN
TERME. 106
4.5.6 ERMITTLUNG DER MINIMIERTEN
FUNKTION. 106
4.5.7 KARNAUGH-DIAGRAMM MIT DON*T-C ARE
.
107
4.5.8 KARNAUGH-DIAGRAMM FUER MEHR ALS VIER VARIABLEN
.
109
4.5.9 KARNAUGH-DIAGRAMM DER KONJUNKTIVEN NORMALFORM
.
109
4.6 VHDL FUER KOMBINATORISCHE
SCHALTUNGEN. 110
4.6.1 BESCHREIBUNG LOGISCHER VERKNUEPFUNGEN
.
110
4.6.2 BESCHREIBUNG DER
FUNKTION. 111
4.7
UEBUNGSAUFGABEN.
112
5 SEQUENZIELLE
SCHALTUNGEN.
115
5.1
SPEICHERELEMENTE.
116
5.1.1
RS-FLIP-FLOP.
116
5.1.2 TAKTSTEUERUNG VON
FLIP-FLOPS. 118
5.1.3
D-FLIP-FLOP.
122
5.1.4 ERWEITERUNG DES
D-FLIP-FLOPS. 125
5.1.5 WEITERE
FLIP-FLOPS.
128
5.1.6
KIPPSTUFEN.
129
5.2 ENDLICHE
AUTOMATEN.
129
5.2.1
AUTOMATENTHEORIE.
130
5.2.2 BEISPIEL FUER EINEN
AUTOMATEN. 132
5.2.3 ENTWURF VON
AUTOMATEN.
135
5.2.4 CODIERUNG VON
ZUSTAENDEN. 144
5.2.5 ENTWURF VON
MEALY-AUTOMATEN. 149
5.2.6 VERGLEICH VON MEALY- UND MOORE-AUTOMAT
.
153
5.2.7
REGISTERAUSGABE.
154
5.2.8 ASYNCHRONE
AUTOMATEN.
157
5.3 ENTWURF SEQUENZIELLER SCHALTUNGEN MIT VHDL
.
158
5.3.1 GRUNDFORM DES GETAKTETEN PROZESSES
.
158
5.3.2 ERWEITERTE FUNKTION DES GETAKTETEN PROZESSES
.
159
5.3.3 STEUERLEITUNGEN FUER
FLIP-FLOPS. 160
5.3.4 ENTWURF VON
AUTOMATEN.
163
5.3.5 PROGRAMMIERSTILE FUER
VHDL-CODE. 166
5.4
UEBUNGSAUFGABEN.
167
6
SCHALTUNGSSTRUKTUREN.
173
6.1 GRUNDSTRUKTUREN DIGITALER
SCHALTUNGEN. 173
6.1.1 TOP-DOWN
ENTWURF.
173
6.1.2 DARSTELLUNG VON SCHALTUNGSSTRUKTUREN
.
174
6.2 KOMBINATORISCHE
GRUNDSTRUKTUREN.
175
6.2.1
MULTIPLEXER.
175
6.2.2
DEMULTIPLEXER.
176
6.2.3
ADDIERER.
177
6.3 SEQUENZIELLE
GRUNDSTRUKTUREN.
180
6.3.1
ZAEHLER.
180
6.3.2
SCHIEBEREGISTER.
182
6.3.3 RUECKGEKOPPELTES
SCHIEBEREGISTER. 183
6.4
ZEITVERHALTEN.
184
6.4.1 VERZOEGERUNGSZEIT REALER SCHALTUNGEN
.
184
6.4.2 TRANSIENTE
SIGNALZUSTAENDE.
184
6.4.3 SIGNALUEBERGAENGE IN KOMPLEXEN SCHALTUNGEN
.
185
6.5 TAKTKONZEPT IN REALEN
SCHALTUNGEN. 186
6.5.1 REGISTER-TRANSFER-LEVEL
(RTL). 186
6.5.2 BEISPIEL FUER ENTWURF MIT REGISTER-TRANSFER-LEVEL:
AMPELSTEUERUNG.
187
6.5.3 KRITISCHER
PFAD.
190
6.5.4
PIPELINING.
191
6.5.5
TAKTUEBERGAENGE.
193
6.5.6 METASTABILITAET VON
FLIP-FLOPS. 195
6.5.7 TAKTUEBERGANG MEHRERER
SIGNALE. 196
6.6 SPEZIELLE
EIN-/AUSGANGSSTRUKTUREN.
197
6.6.1
SCHMITT-TRIGGER-EINGANG.
197
6.6.2
TRI-STATE-AUSGANG.
198
6.6.3 OPEN-KOLLEKTOR-
AUSGANG. 199
6.7
UEBUNGSAUFGABEN.
200
7 REALISIERUNG DIGITALER SYSTEME
.
203
7.1 STANDARDISIERTE
LOGIKBAUSTEINE.
204
7.1.1 CHARAKTERISTISCHE EIGENSCHAFTEN DIGITALER SCHALTKREISE
.
206
7.1.2
LASTFAKTOREN.
206
7.1.3
STOERSPANNUNGSABSTAND.
208
7.1.4
SCHALTZEITEN.
208
7.1.5
LOGIKFAMILIEN.
209
7.2 KOMPONENTEN FUER DIGITALE
SYSTEME. 210
7.2.1
ASICS.
210
7.2.2
ASSPS.
211
7.2.3 FPGAS UND CPLD
S.
211
7.2.4
MIKROCONTROLLER.
212
7.2.5 VERGLEICH DER
ALTERNATIVEN.
214
7.2.6 KOMBINATION VON
KOMPONENTEN. 214
7.3 VHDL-BASIERTER
SYSTEMENTWURF.
215
7.3.1
DESIGNFLOW.
215
7.3.2
VHDL-EINGABE.
216
7.3.3
SIMULATION.
217
7.3.4
SYNTHESE.
219
7.3.5 PLATZIERUNG UND
VERDRAHTUNG. 220
7.3.6
TIMINGANALYSE.
220
7.3.7
INBETRIEBNAHME.
221
7.3.8 DER DIGITALE ENTWURF ALS ITERATIVER PROZESS
.
222
7.4
UEBUNGSAUFGABEN.
223
8
VHDL-VERTIEFUNG.
225
8.1 WEITERE
DATENTYPEN.
225
8.1.1 NATURAL UND R E A
L.
225
8.1.2
BOOLEAN.
226
8.1.3
TIME.
226
8.1.4 STD_ULOGIC, STD_ULOGIC_VECTOR
.
227
8.1.5 BENUTZERDEFINIERTE DATENTYPEN
.
227
8.1.6 ZEICHEN UND ZEICHENKETTEN
.
227
8.1.7
SUBTYPES.
228
8.1.8
ARRAYS.
229
8.1.9
RECORDS.
230
8.2 SPRACHELEMENTE ZUR CODE-STRUKTURIERUNG
.
231
8.2.1
FUNCTION.
231
8.2.2
PROCEDURE.
232
8.2.3 ENTITY-DEKLARATION MIT GENERICS
.
234
8.2.4
GENERATE-ANWEISUNG.
236
8.2.5
ATTRIBUTE.
238
8.2.6 INSTALLIERUNG MIT DER COMPONENT-ANWEISUNG
.
240
8.2.7
PAKETE.
241
8.2.8 EINBINDUNG VON SPEZIALKOMPONENTEN
.
243
8.3 SPRACHELEMENTE ZUR
VERIFIKATION.
250
8.3.1 BINAERE
EIN-/AUSGABE.
250
8.3.2 EIN-ZAUSGABE MIT TEXTDATEIEN
.
251
8.3.3 WAIT-ANWEISUNGEN IN TESTBENCHES
.
253
8.3.4 TESTBENCH MIT INTERAKTIVER UEBERPRUEFUNG
.
254
8.3.5 TESTBENCH MIT ASSERT-ANWEISUNGEN
.
255
8.3.6 TESTBENCH MIT DATEIEIN-/-AUSGABE
.
256
8.4
UEBUNGSAUFGABEN.
260
9 PROGRAMMIERBARE
LOGIK.
263
9.1 GRUNDKONZEPTE PROGRAMMIERBARER L O G IK
. 264
9.1.1 ZWEISTUFIGE L O G IK
.
264
9.1.2 TABELLENBASIERTE LOGIKIMPLEMENTIERUNG
.
267
9.2 SIMPLE PROGRAMMABLE LOGIC DEVICE (SPLD)
.
269
9.3 COMPLEX PROGRAMMABLE LOGIC DEVICE (CPLD )
.
271
9.4 FIELD PROGRAMMABLE GATE
ARRAYS. 273
9.4.1 ALLGEMEINER AUFBAU EINES FPGAS
.
273
9.4.2 TAKTVERTEILUNG IM F PG A
. 276
9.4.3 TYPISCHE SPEZIALKOMPONENTEN
.
277
9.5
FPGA-FAMILIEN.
281
9.5.1 VERGLEICH AUSGEWAEHLTER FPGA-FAMILIEN
.
282
9.6 HINWEISE ZUM
SELBSTSTUDIUM.
285
9.7
UEBUNGSAUFGABEN.
286
10
HALBLEITERTECHNIK.
289
10.1
CMOS-TECHNOLOGIE.
290
10.1.1 PRINZIPIELLER
AUFBAU.
290
10.1.2
FELDEFFEKTTRANSISTOREN.
292
10.1.3
LAYOUT.
294
10.2 GRUNDSCHALTUNGEN IN
CMOS-TECHNIK. 296
10.2.1 INVERTER.
.
.
.
296
10.2.2
LOGIKGATTER.
296
10.2.3
TRANSMISSION-GATE.
297
10.2.4
FLIP-FLOP.
298
10.3
VERLUSTLEISTUNG.
300
10.3.1 STATISCHE
VERLUSTLEISTUNG.
301
10.3.2 DYNAMISCHE
VERLUSTLEISTUNG.
301
10.3.3 ENTWURF ENERGIEEFFIZIENTER
SCHALTUNGEN. 303
10.4 INTEGRIERTE
SCHALTUNGEN.
304
10.4.1 LOGIKSYNTHESE UND
LAYOUT. 304
10.4.2 HERSTELLUNG.
.
.
307
10.4.3
PACKAGING.
308
10.4.4
GEHAEUSE.
309
10.5 MINIATURISIERUNG DER
HALBLEITERTECHNIK. 310
10.5.1 MOORE*SCHES
GESETZ.
310
10.5.2
FINFET-TRANSISTOREN.
311
10.5.3 WEITERE
TECHNOLOGIEENTWICKLUNG. 312
10.6
UEBUNGSAUFGABEN.
312
11
SPEICHER.
315
11.1
UEBERSICHT.
316
11.1.1 BEGRIFFE UND ABKUERZUNGEN
.
.-
.
316
11.1.2
GRUNDSTRUKTUR.
317
11.1.3 PHYSIKALISCHES
INTERFACE.
318
11.2
SPEICHERTECHNOLOGIEN.
319
11.2.1 SRAM
.
319
11.2.2
DRAM.
321
11.2.3 R O M
.
323
11.2.4
OTP-SPEICHER.
323
11.2.5
EEPROM.
324
11.2.6 INNOVATIVE
SPEICHERTECHNIKEN. 326
11.3 EINGEBETTETER
SPEICHER.
329
11.3.1 SRAM
.
329
11.3.2
DRAM.
331
11.3.3 R O M
.
331
11.3.4 NV RA M
.
332
11.4 DISKRETE
SPEICHERBAUSTEINE.
332
11.4.1 PRAKTISCHER
EINSATZ.
333
11.4.2
QDR-II-SRAM.
334
11.4.3
DDR3-SDRAM.
337
11.4.4
EEPROM.
340
11.4.5 FRAM MIT SERIELLEM
INTERFACE. 344
11.5
SPEICHERSYSTEME.
345
11.5.1
ADRESSDECODIERUNG.
346
11.5.2 MULTIPLEXING DES
DATENBUSSES. 348
11.5.3 ANSTEUERUNG DISKRETER SPEICHERBAUSTEINE
.
350
11.6
UEBUNGSAUFGABEN.
350
12 ANALOG-DIGITAL- UND DIGITAL-ANALOG-UMSETZER
.
353
12.1 GRUNDPRINZIP VON ANALOG-DIGITAL-UMSETZERN
.
353
12.1.1 SYSTEME ZUR UMSETZUNG ANALOGER IN DIGITALE SIGNALE
.
355
12.1.2
ABTASTTHEOREM.
356
12.1.3 ABTASTHALTEGLIED
(AHG). 357
12.1.4 ERREICHBARE GENAUIGKEIT FUER ADUS ABHAENGIG VON DER
CODEWORTLAENGE.
359
12.1.5 CODIERUNG DER
ADU-WERTE. 361
12.2 VERFAHREN ZUR
ANALOG-DIGITAL-UMSETZUNG.
361
12.2.1 PARALLEL
VERFAHREN.
362
12.2.2
WAEGEVERFAHREN.
363
12.2.3
ZAEHLVERFAHREN.
365
12.2.4 ERWEITERTES PARALLEL
VERFAHREN. 366
12.2.5 ERWEITERTES
ZAEHLVERFAHREN.
369
12.2.6 SINGLE- UND DUAL-SLOPE-VERFAHREN
.
370
12.2.7
SIGMA-DELTA-UMSETZER.
371
12.3 VERFAHREN ZUR
DIGITAL-ANALOG-UMSETZUNG.
374
12.3.1
DIREKTVERFAHREN.
375
12.3.2 SUMMATION GEWICHTETER
STROEME. 375
12.3.3
R-2R-LEITEMETZWERK.
377
12.3.4
PULSWEITENMODULATION.
379
12.4 EIGENSCHAFTEN REALER AD- UND
DA-UMSETZER. 380
12.4.1 STATISCHE
FEHLER.
380
12.4.2 DYNAMISCHE
FEHLER.
384
12.5 ANSTEUERUNG VON DISKRETEN AD- UND DA-UMSETZERN
.
388
12.5.1 SERIELLE
ANSTEUERUNG.
388
12.5.2 PARALLELE ANSTEUERUNG
.
391
12.5.3 SERIELLE HOCHGESCHWINDIGKEITSSCHNITTSTELLE JESD204B
.
393
12.6
UEBUNGSAUFGABEN.
395
13 GRUNDLAGEN DER MIKROPROZESSORTECHNIK
.
397
13.1 GRUNDSTRUKTUR EINES
MIKRORECHNERSYSTEMS. 397
13.2 BEFEHLSABARBEITUNG IN EINEM
MIKROPROZESSOR. 401
13.3 TYPISCHE
BEFEHLSKLASSEN.
402
13.3.1 AUFBAU EINES
BEFEHLSWORTES. 402
13.3.2 ARITHMETISCHE UND LOGISCHE
BEFEHLE. 403
13.3.3
TRANSFERBEFEHLE.
404
13.3.4 BEFEHLE ZUR PROGRAMMABLAUFSTEUERUNG
.
405
13.3.5
SPEZIALBEFEHLE.
405
13.4 ADRESSIERUNG VON DATEN UND
BEFEHLEN. 406
13.4.1 UNMITTELBARE
ADRESSIERUNG. 406
13.4.2 ABSOLUTE
ADRESSIERUNG.
407
13.4.3 INDIREKTE
ADRESSIERUNG.
407
13.4.4 INDIREKTE ADRESSIERUNG MIT DEM STACKPOINTER
.
409
13.4.5
BEFEHLSADRESSIERUNG.
410
13.5 MASSNAHMEN ZUR STEIGERUNG DER RECHENLEISTUNG
.
410
13.5.1 ERHOEHUNG DER
TAKTFREQUENZ. 411
13.5.2 PARALLELITAET
.
411
13.5.3
PIPELINING.
412
13.5.4
BEFEHLSSATZERWEITERUNGEN.
415
13.6 GRUNDLEGENDE
MIKROPROZESSORARCHITEKTUREN.
416
13.6.1 C IS C
.
416
13.6.2 R IS C
.
417
13.6.3 RISC UND
HARVARD-ARCHITEKTUR. 418
13.7
MIKROCONTROLLER.
420
13.8
UEBUNGSAUFGABEN.
423
14 M
IKROCONTROLLER.
425
14.1 DIE MIKROCONTROLLER-FAMILIE
AVR. 425
14.2 PROGRAMMIERUNG VON
MIKROCONTROLLERN. 427
14.2.1 PROGRAMMIERUNG IN
ASSEMBLER. 429
14.2.2 PROGRAMMIERUNG IN C
. 430
14.3 DIE
AVR-CPU.
433
14.4 DER
AVR-BEFEHLSSATZ.
436
14.4.1 ARITHMETISCHE UND LOGISCHE BEFEHLE
.
436
14.4.2
TRANSFERBEFEHLE.
437
14.4.3 BEFEHLE ZUR PROGRAMMABLAUFSTEUERUNG
.
437
14.5 VERWENDUNG DER
AVR-BEFEHLE.
444
14.5.1 ARITHMETISCHE UND LOGISCHE GRUNDFUNKTIONEN
.
444
14.5.2 BEFEHLE FUER DEN ZUGRIFF AUF SPEICHER UND
PERIPHERIEKOMPONENTEN.
451
14.5.3
PROGRAMMVERZWEIGUNGEN.
453
14.6 GRUNDLAGEN DER
INTERRUPTVERARBEITUNG.
458
14.6.1
INTERRUPTFREIGABE.
459
14.6.2
INTERRUPT-SERVICE-ROUTINEN.
460
14.7 EINGEBETTETE
PERIPHERIEKOMPONENTEN.
463
14.7.1
PORTS.
464
14.7.2
TIMER.
470
14.7.3 SCHNITTSTELLEN FUER DIE SERIELLE DATENUEBERTRAGUNG
.
484
14.7.4 S P
I.
492
14.7.5 TWI/I2C
.
497
14.7.6 ANALOGE PERIPHERIEKOMPONENTEN
.
504
14.7.7 INTERRUPT-BASIERTE KOMMUNIKATION MIT
PERIPHERIEKOMPONENTEN.
511
14.8 HINWEISE ZUM PRAKTISCHEN SELBSTSTUDIUM
.
523
14.8.1
HARDWAREAUSWAHL.
523
14.8.2
ENTWICKLUNGSUMGEBUNGEN.
523
14.8.3 PROGRAMMIERUNG UND DEBUGGING VON AVR-MIKROCONTROLLEM. 524
14.9 UEBUNGSAUFGABEN
.
526
15 LOESUNGEN DER
UEBUNGSAUFGABEN.
529
LITERATURHINWEISE.
549
STICHWORTVERZEICHNIS
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