Computerschnittstellen und Bussysteme: für PC, Tablets, Smartphones und Embedded-Systeme ; [mit Hardware-Programmierung für Android-Geräte (WLAN, Bluetooth, USB)]
Gespeichert in:
| 1. Verfasser: | |
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Berlin [u.a.]
VDE-Verl.
2013
|
| Ausgabe: | 3., völlig neu bearb. Aufl. |
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | XV, 404 S. Ill., graph. Darst. |
| ISBN: | 9783800734481 3800734486 |
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TEIL I: GRUNDLAGEN
1 EINFUEHRUNG UND UEBERBLICK 3
1.1 SYSTEMUEBERSICHT 4
1.2 EXTERNE SCHNITTSTELLEN 5
1.2.1 MAUS UND
TASTATUR 5
1.2.2 USB PORTS 5
1.2.3 SERIAL PORT 6
1.2.4 PARALLEL PORT 6
1.2.5 VGA PORT 6
1.2.6 LAN PORT 6
1.2.7 AUDIO 6
1.2.8 IEEE 1394 PORT 7
1.2.9 ESATA 7
1.3 INTERNE BUSSYSTEME 8
1.3.1 VON ISA ZU PCI 9
1.3.2 ACCELERATED GRAPHICS PORT 11
1.3.3 PCI-BUS-WEITERENTWICKLUNGEN 12
1.3.4 PERIPHERIE-SCHNITTSTELLEN UND -BUSSYSTEME 14
1.3.4.1 VON IDE ZU PATA 14
BETRIEBSARTEN 15
ULTRA DMA 16
1.3.4.2 SMALL COMPUTER SYSTEM INTERFACE 17
STANDARDS 18
KONFIGURATION 19
KENNDATEN 20
DIFFERENTIAL SCSI 21
LOW VOLTAGE DIFFERENTIAL 22
HTTP://D-NB.INFO/1035522098
VIII
INHALTSVERZEICHNIS
2 ZAHLEN, ZEICHENDARSTELLUNG UND CODES 25
2.1 ZAHLENDARSTELLUNG 25
2.1.1 BINAERE ZAHLENDARSTELLUNG UND -BERECHNUNG 26
2.1.2 DARSTELLUNG NEGATIVER ZAHLEN 28
2.1.3 GLEITKOMMADARSTELLUNG 29
2.1.4 IEEE-FORMATE 31
2.2 CODES UND ZEICHENSAETZE 33
2.2.1 NUMERISCHE CODES IM UEBERBLICK 33
2.2.2 DER ASCII-CODE 34
2.2.2.1 UEBERTRAGUNGSSTEUERZEICHEN - TRANSMISSION CONTROL 35
2.2.2.2 FORMATSTEUERZEICHEN - FORMAT EFFECTOR 36
2.2.2.3 GERAETESTEUERZEICHEN - DEVICE CONTROL 37
2.2.2.4 INFORMATIONSTRENNZEICHEN - INFORMATION SEPARATOR 37
2.2.2.5 STEUERZEICHEN FUER CODEERWEITERUNGEN 37
2.2.2.6 SONSTIGE STEUERZEICHEN 38
2.2.3 IBM- UND ANSI-ZEICHENSATZ 38
2.2.4 UNICODE 40
3 STANDARDS 43
3.1 ORGANISATIONEN 43
3.2 IEEE-STANDARDS 46
3.3 DAS OSI-SCHICHTENMODELL 47
4 CODIERUNGSVERFAHREN UND FEHLERKONTROLLE 51
4.1 DIE MANCHESTER-CODIERUNG 51
4.2 DIE 4B/5B-CODIERUNG :.. 52
4.3 DIE 8B/10-CODIERUNG 53
4.4 DIE MLT-3-CODIERUNG 56
4.5 PAM5- UND TRELLIS-CODIERUNG 56
4.6 FEHLERKONTROLL- UND KORREKTURMECHANISMEN 58
4.6.1 PARITAETSPRUEFUNG 59
4.6.2 CYCLIC REDUNDANCY CHECK 59
INHALTSVERZEICHNIS IX
5 LOGIKSCHALTUNGEN UND INTERFACE-TECHNIK 61
5.1 LOGISCHE GRUNDSCHALTUNGEN 61
5.2 SEQUENTIELLE LOGIK 63
5.3 LOGIKFAMILIEN IM UEBERBLICK 67
5.4 PC-INTERFACETECHNIK 69
5.4.1 KOMMUNIKATION MIT DEM
INTERFACE 74
5.5 PROGRAMMIERBARE LOGIKSCHALTUNGEN 75
5.5.1 PROGRAMMABLE LOGIC DEVICES 77
5.5.1.1 DECODER MIT
PROGRAMMABLE ARRAY LOGIC 80
5.5.2 COMPLEX PLDS 84
5.5.3 FIELD PROGRAMMABLE GATE ARRAYS 85
5.5.4 HARDWARE DESCRIPTION LANGUAGE UND
IP CORES 87
TEIL II: KLASSISCHE SYSTEME
6 PARALLELE SCHNITTSTELLEN 91
6.1 DER
STANDARD IEEE 1284 92
6.1.1 GRUNDSAETZLICHE KOMMUNIKATION UND
SIGNALBEDEUTUNG 94
6.1.2 COMPATIBLE MODE 96
6.1.3 NIBBLE MODE 97
6.1.4 BYTE MODE 98
6.1.5 EPP MODE 100
6.1.6 ECPMODE 101
6.1.7 PROGRAMMBEISPIELE 103
6.2 GPIB-, IEEE-488-, IEC-625-BUSSYSTEM 106
6.2.1 STANDARDS 106
6.2.2 SYSTEMAUFBAU 109
6.2.3 LEITUNGEN UND SIGNALE 111
6.2.3.1 DATENLEITUNGEN - DATA LINES 112
6.2.3.2 UEBERGABELEITUNGEN - HANDSHAKE LINES 112
6.2.3.3 STEUERLEITUNGEN - MANAGEMENT LINES 113
6.2.4 ADRESSENDARSTELLUNG 114
XII
INHALTSVERZEICHNIS
TEIL III: PERIPHERIE-BUSSYSTEME
9 UNIVERSAL SERIAL BUS 193
9.1 TOPOLOGIE 194
9.2 ANSCHLUESSE UND SIGNALE 196
9.3 KOMMUNIKATION 198
9.4 GERAETEERKENNUNG 199
9.5 PIPES, ENDPOINTS UND DESCRIPTORS 201
9.6 ADRESSEN UND
PAKETE 201
9.7 UEBERTRAGUNGSMODI 203
9.7.1 INTERRUPT TRANSFER 203
9.7.2 BULK TRANSFER 204
9.7.3 ISOCHRONOUS TRANSFER 204
9.7.4 CONTROL TRANSFER 205
9.8 USBON-THE-GO 205
9.9 SUPER SPEED-USB
3.0 206
9.9.1 VERBINDUNGEN 207
9.9.2 PROTOKOLL UND STROMSPARMECHANISMEN 208
9.10 APPLIKATIONEN UND PROGRAMMIERUNG 209
9.10.1 EINFACHE USB-UMSETZUNG MIT FTDI-CHIPS 211
9.10.2 USB-KOMMUNIKATION MIT ANDROID 215
9.10.2.1 ARDUINO-PLATTFORM ALS USB-HOST 217
9.10.2.2 ANDROID-PROGRAMMIERUNG 222
9.10.2.3 DIE MANIFEST-DATEI 226
9.10.3 USB-2.0-APPLIKATIONEN MIT
CYPRESS-CONTROLLERN 227
9.10.3.1 ERSTELLUNG DER SOFTWARE - FIRMWARE 234
9.10.3.2 EEPROM-DATEN 235
9.10.3.3 HAUPTPROGRAMM 236
9.10.3.4 DESKRIPTORTABELLE UND SETTINGS 241
9.10.3.5 INTERRUPT SERVICE-ROUTINEN 244
9.10.3.6 TREIBER UND
APPLIKATIONEN 247
INHALTSVERZEICHNIS
XIIT
10 SERIAL ATA UND SERIAL ATTACHED SCSI 255
10.1 SERIAL ATA 255
10.1.1 ESATA 258
10.2 SERIAL ATTACHED SCSI - SAS 259
11 PERIPHERAL COMPONENT INTERCONNECT 261
11.1 ANSCHLUESSE UND SIGNALE 262
11.2 PCI-BUS-GRUNDLAGEN 267
11.3 REGISTER UND
KOMMUNIKATION 271
11.4 DER KONFIGURATIONSBEREICH
- CONFIGURATION SPACE 273
11.4.1 VENDOR
ID UND DEVICE ID 274
11.4.2 COMMAND REGISTER 274
11.4.3 STATUS REGISTER 275
11.4.4 CLASS CODES 276
11.4.5 WEITERE PCI-BUS-REGISTER 277
11.4.6 DEVICE SPACE 278
11.5 VERSIONS-ERWEITERUNGEN 279
11.5.1 ERWEITERTER CONFIGURATION SPACE 281
11.5.2 POWER MANAGEMENT 282
11.5.3 PCI-X 284
11.6 PCI BUS-PROGRAMMIERUNG 287
11.6.1 PCI-BIOS-DETEKTIERUNG 288
11.6.2 PCI-EINHEIT SUCHEN 290
11.6.3 PCI-EINHEIT NACH KLASSENCODE SUCHEN 291
11.6.4 KONFIGURATIONSDATEN LESEN 293
11.7 PCI EXPRESS 295
11.7.1 KOMMUNIKATION 295
11.7.2 ARCHITEKTUR 297
11.7.2.1 CREDIT BASED FLOW CONTROL 300
11.7.3 SIGNALE UND INTERFACES 300
11.8 IMPLEMENTIERUNGEN FUER NOTEBOOKS 305
11.8.1 PCMCIA UND CARDBUS 306
11.8.2 EXPRESSCARDS 308
11.8.3 THUNDERBOLT 308
XIV
INHALTSVERZEICHNIS
TEIL IV: NETZWERKE UND FUNKSYSTEME
12 LOCAL AREA NETWORKS 313
12.1 FELDBUSSYSTEME 313
12.1.1 STANDARDISIERUNG 315
12.1.2 UNTERSCHEIDUNGSKRITERIEN 315
12.1.3 ETHERNET ALS FELDBUS 318
12.2 TOPOLOGIEN UND ZUGRIFFSVERFAHREN 318
12.2.1 STERNTOPOLOGIE UND ARCNET 319
12.2.1.1 ATTACHED RESSOURCES COMPUTER NETWORK 320
12.2.2 RINGTOPOLOGIE UND TOKEN-PASSING-VERFAHREN 321
12.2.3 BUSTOPOLOGIE UND
CSMA/CD-VERFAHREN 323
12.2.3.1 CARRIER SENSE MULTIPLE ACCESS/COLLISION DETECTION 324
12.2.4 BAUMTOPOLOGIE 325
12.3 DAS ETHERNET 326
12.3.1 FUNKTIONSPRINZIP UND KENNDATEN 326
12.3.2 NETZWERKKABEL UND SIGNALE 329
12.3.2.1 VERBINDUNG FUER GIGABIT-ETHERNET 330
12.3.2.2 KABELAUFBAU UND SPEZIFIKATIONEN 331
DAEMPFUNG UND INHOMOGENITAETEN 332
BANDBREITE 332
UEBERSPRECHEN - CROSSTALK 332
SCHIRMUNG 334
12.3.3 ETHERNET-SCHICHTEN 335
12.3.4 FRAME-FORMATE 337
13 WIRELESS LANS 341
13.1 FUNKTECHNIK 343
13.1.1 DIGITALE MODULATION 344
13.1.2 FREQUENCY HOPPING SPREAD SPECTRUM 346
13.1.3 MULTIPLE INPUT MULTIPLE OUTPUT 347
13.1.4 DIRECT SEQUENCE SPREAD SPECTRUM 347
13.1.5 ORTHOGONAL FREQUENCY-DIVISION MULTIPLEX 349
13.2 WLANS NACH IEEE 802.11 350
13.2.1 WI-FI 352
13.2.2 ZUGRIFFSVERFAHREN - CSMA/CA 352
13.2.3 WLAN-TOPOLOGIEN 354
INHALTSVERZEICHNIS
XV
13.2.3.1 ADHOC-WLAN 354
13.2.3.2 INFRASTRUCTURE-WLANS 354
13.2.4 ANDROID-PROGRAMMIERUNG FUER DEN WLAN-ZUGRIFF 357
14 BLUETOOTH 363
14.1 PICONET UND
SCATTERNET 364
14.2 STANDARDS - IEEE 802.15.1 365
14.3 LEISTUNGSKLASSEN UND PROTOCOL STACK 365
14.4 BETRIEBSMODI 367
14.5 PAKETAUFBAU 368
14.6 PROFILES 369
14.7 VERBINDUNGSAUFBAU UND
SICHERHEITSMECHANISMEN 370
14.8 ANDROID-PROGRAMMIERUNG FUER DIE BLUETOOTH-KOMMUNIKATION 370
14.8.1 SUCHVORGANG UND PAIRING 371
14.8.2 CLIENT-VERBINDUNG 374
14.8.3 SERVER-VERBINDUNG 374
14.8.4 DATENUEBERTRAGUNG 375
14.9 BLUETOOTH LOW ENERGY 376
14.9.1 LINK LAYER 377
14.9.2 HCL LAYER 378
14.9.3 HOST-SCHICHTEN 378
14.9.4 GENERIC ATTRIBUTE PROFILE 379
14.9.5 GENERIC ACCESS PROFILE 380
14.9.6 APPLIKATIONEN 381
14.9.6.1 CC2540-SCHALTUNG 382
DEVELOPMENT KIT 386
SOFTWARE UND PROGRAMMIERUNG 386
STICHWORTVERZEICHNIS 391
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Inhaltsverzeichnis
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| Signatur: |
2000 ST 185 D375(3) |
|---|---|
| Exemplar 1 | ausleihbar Verfügbar Bestellen |