PC-XT-AT-Kompendium: eine detaillierte Systembeschreibung mit vielen informativen Fotos
Gespeichert in:
| Hauptverfasser: | , |
|---|---|
| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Haar bei München
Markt-u.-Technik-Verl.
1989
|
| Ausgabe: | [2. Aufl.] |
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | 506 S. Ill., graph. Darst. 1 Diskette |
| ISBN: | 3890907784 |
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MARC
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Datensatz im Suchindex
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|---|---|
| adam_text | INHALTSVERZEICHNIS 5
INHALTSVERZEICHNIS
VORWORT
KAPITEL 1 EINFUEHRUNG
L.I
DIE SPRACHE C
1.1.1
DATENTYP-UMWANDLUNGEN IN C
1.1.2
ZEIGER IN C
1.1.3
BEDINGUNGEN IN C
1.1.4
SCHLEIFEN IN C
1.1.5
STRUKTUREN IN C
1.1.6 INTERRUPTPROGRAMMIERUNG IN C
1.1.7 DIREKTE ADRESSPROGRAMMIERUNG IN C
1.1.8
PROGRAMMIERUNG DER PORTADRESSEN IN C
1.2
DAS TURBO PASCAL
1.2.1
DATENTYP-UMWANDLUNGEN IN TURBO PASCAL
1.2.2
ZEIGER IN TURBO PASCAL
1.2.3 BEDINGUNGEN IN TURBO PASCAL
1.2.4
SCHLEIFEN IN TURBO PASCAL
1.2.5 UNITS IN TURBO PASCAL 4.0
1.2.6
INTERRUPTPROGRAMMIERUNG IN TURBO PASCAL
1.2.7 DIREKTE ADRESSPROGRAMMIERUNG IN TURBO PASCAL
1.2.8 PROGRAMMIERUNG DER PORTADRESSEN IN TURBO PASCAL
1.3
DER ASSEMBLER
1.3.1
DIE SPRUNGBEFEHLE
1.3.2
DIE INTERRUPTPROGRAMMIERUNG IN ASSEMBLER
1.3.3
DIREKTE ADRESSPROGRAMMIERUNG IN ASSEMBLER
1.3.4 PROGRAMMIERUNG DER PORTADRESSEN IN ASSEMBLER
KAPITEL 2 DIE PC/XT/AT-SERIE
2.1 DER PC/XT
2.1.1 DER AUFBAU DES PC/XT-SYSTEMS
13
17
17
22
22
23
24
25
26
28
30
32
39
42
43 ^
44 - -
45
47
50
53
54
57
59
60
62
65
67
68
HTTP://D-NB.INFO/891485740
6 INHALTSVERZEICHNIS
2.2
DER AT
2.2.1
DER AUFBAU DES AT-SYSTEMS
KAPITEL 3
DAS BIOS
3.1
DEM BIOS-EINSPRUNG AUF DER SPUR
3.2
DIE BIOS-EINSPRUENGE
3.2.1
DER VIDEO-INTERRUPT 10H
3.2.1.1
INTLOH DEMOPROGRAMME
3.2.1.2
CTEXT.C DEMOPROGRAMM
3.2.1.3
ATEXT. ASM DEMOPROGRAMM
3.2.1.4
PTEXT.PAS DEMOPROGRAMM
3.2.1.5
CGRAFIK.C DEMOPROGRAMM
3.2.1.6
AGRAFIK.
ASM DEMOPROGRAMM
3.2.1.7
PGRAFIK.PAS DEMOPROGRAMM
3.2.2
DER SYSTEMKONFIGURATION-INTERRUPT 1 LH
3.2.2.1
INTLLH DEMOPROGRAMME
3.2.2.2
CSYS.C DEMOPROGRAMM
3.2.2.3
PSYS.PAS DEMOPROGRAMM
3.2.3
DER MEMORYCHECK-INTERRUPT 12H
3.2.4
DER DISKETTEN- UND FESTPLATTEN-INTERRUPT 13H
3.2.4.1 INT
13H DEMOPROGRAMME
3.2.4.2
CCHECK.C DEMOPROGRAMM
3.2.4.3
PSECTOR.PAS DEMOPROGRAMM
3.2.5
DER SERIELLE SCHNITTSTELLEN-INTERRUPT 14H
3.2.5.1 INT14H DEMOPROGRAMM
3.2.5.2
PSERI.PAS DEMOPROGRAMM
3.2.6
DER KASSETTENRECORDER-INTERRUPT 15H
3.2.6.1
INT15H DEMOPROGRAMME
3.2.6.2
CWARTE.C DEMOPROGRAMM
3.2.6.3 AWARTE. ASM DEMOPROGRAMM
3.2.6.4
PWARTE.PAS DEMOPROGRAMM
3.2.7
DER TASTATUR-INTERRUPT 16H
3.2.7.1
INT
16H DEMOPROGRAMME
3.2.7.2
PTASTE.PAS DEMOPROGRAMM
3.2.7.3
CTASTE.C DEMOPROGRAMM
3.2.7.4 ATASTE. ASM DEMOPROGRAMM
3.2.8
DER DRUCKER-INTERRUPT 17H
3.2.8.1 INT
17H DEMOPROGRAMME
3.2.8.2
CDRUCK.C DEMOPROGRAMM
3.2.8.3
ADRUCK.
ASM DEMOPROGRAMM
3.2.8.4 PDRUCK.PAS DEMOPROGRAMM
3.2.9
DER KASSETTEN-BASIC-INTERRUPT 18H
70
71
75
79
81
82
88
88
89
91
92
94
95
96
98
98
99
99
100
109
110
111
113
116
117
117
121
121
122
123
123
125
125
127
127
128
130
130
131
132
133
INHALTSVERZEICHNIS 1
3.2.10
DER URLADER-INTERRUPT 19H
133
3.2.11
DER SYSTEMUHR-INTERRUPT 1 AH
133
3.2.11.1
INTLAH DEMOPROGRAMM
137
3.2.11.2
PUHR.PAS
137
3.3
DER BIOS-DATENBEREICH
138
KAPITEL 4
DIE MIKROPROZESSOREN DER SYSTEME
141
4.1
ALLGEMEINE SYSTEMARCHITEKTUR DER INTEL-PROZESSOREN
142
4.1.1 DIE REGISTER IM REAL MODE
142
4.1.2
DIE KENNZEICHEN-BIT IM REAL MODE
145
4.1.3
SPEICHERORGANISATION UND ADRESSIERUNG IM REAL MODE
146
4.2 DER INTEL 8086/8088
148
4.2.1 DIE PINBELEGUNG DES 8086/8088
149
4.3 DER INTEL 80286
152
4.3.1 DIE PINBELEGUNG DES 80286
153
4.4 DER INTEL 80386
155
4.4.1 DIE PINBELEGUNG DES 80386
156
KAPITEL 5
DIE MATHEMATISCHEN CO-PROZESSOREN DER SYSTEME
159
5.1
DIE HARDWARE-STEUERUNG DER CO-PROZESSOREN
159
5.2 DER IEEE-STANDARD 754 DER CO-PROZESSOREN
160
5.3
ALLGEMEINE FLOATING-POINT-ARITHMETIK
161
5.4
DER INTEL-CO-PROZESSOR 8087
165
5.4.1 DIE PINBELEGUNG DES 8087
165
5.5 DER INTEL-CO-PROZESSOR 80287
168
5.5.1 DIE PINBELEGUNG DES 80287
168
5.6 DER INTEL 80387
171
5.6.1 DIE PINBELEGUNG DES 80387
172
KAPITEL 6
DIE TASTATUR DES PC/XT/AT
175
6.1
DER AUFBAU EINER
TASTATUR
176
6.1.1
DIE SCAN-CODES DER TASTATUR
178
6.2
DER TASTATURPROZESSOR 8048
182
6.2.1 AUFBAU UND FUNKTIONSWEISE DES 8048
182
6.3
DIE ANSCHLUSSBELEGUNG DER TASTATURSTECKER
186
6.4 DIE TASTATURSCHNITTSTELLE IM PC/XT/AT
186
6.4.1
DIE TASTATURSCHNITTSTELLE IM PC
187
6.4.2
DIE TASTATURSCHNITTSTELLE IM AT
188
6.4.3
DIE PROGRAMMIERUNG DER AT-TASTATUR
193
6.4.4
PROGRAMMBEISPIELE ZUR AT-TASTATUR
195
6.4.4.1
DAS TASTR.ASM DEMOPROGRAMM
195
6.4.4.2
DAS PTABLINK.PAS DEMOPROGRAMM
195
8 INHALTSVERZEICHNIS
KAPITEL 7
HARDWARE-INTERRUPTS
197
7.1
TABELLE DER HARDWARE-INTERRUPTS IM PC
197
7.2 TABELLE DER HARDWARE-INTERRUPTS IM AT 198
7.3
DER INTERRUPT-KONTROLLER 8259 199
7.4 DIE PROGRAMMIERUNG DES 8259 204
7.4.1
INITIALISIERUNGSWOERTER (ICW S) 204
7.4.2 STEUERWOERTER (OCW S) 206
7.5 HARDWARE-INTERRUPT DEMOPROGRAMME 208
7.5.1 DAS DEMOPROGRAMM INTERRUP.PAS 208
KAPITEL 8 DIE DMA-KONTROLLE
211
8.1 DER DMA-KONTROLLER 8237 213
8.1.1
DMA-KANAELE IM PC 217
8.1.2
DMA-KANAELE IM AT
217
8.1.3 DAS DMA-PAGE-REGISTER 218
8.1.3.1 ANSCHLUSS DES DMA-PAGE-REGISTERS IM PC 221
8.2
MOEGLICHKEITEN DER DATENUEBERTRAGUNG
222
8.2.1 EINZELUEBERTRAGUNGSMODUS (SINGLE TRANSFER MODE) 222
8.2.2 BLOCKUEBERTRAGUNGSMODUS (BLOCK TRANSFER MODE) 223
8.2.3 ANFORDERUNGSMODUS (DEMAND TRANSFER MODE) 223
8.2.4 KASKADENMODUS (CASCADE MODE) 223
8.2.5 ANWENDUNGSGEBIETE DER VERSCHIEDENEN MODI 224
8.3 REGISTER UND PROGRAMMIERUNG DES DMA-KONTROLLERS 8237 224
8.3.1 INTERNE ADRESSZAEHLER (CURRENT ADDRESS REGISTER) 224
8.3.2 AKTUELLES DURCHLAUFREGISTER (CURRENT WORD REGISTER) 226
8.3.3
STARTREGISTER (BASE ADDRESS REGISTER)
226
8.3.4
DURCHLAUFREGISTER (BASE WORD COUNT REGISTER)
226
8.3.5 KOMMANDO-REGISTER (COMMAND REGISTER) 226
8.3.6 MODEREGISTER (MODE REGISTER)
228
8.3.7 ANFORDERUNGSREGISTER (REQUEST REGISTER) 229
8.3.8 MASKENREGISTER I (MASK REGISTER I) 230
8.3.9 MASKENREGISTER II (MASK REGISTER II)
230
8.3.10 STATUSREGISTER (STATUS REGISTER)
231
8.3.11 TEMPORAERES REGISTER (TEMPORARY REGISTER)
231
8.3.12 SOFTWAREKOMMANDOS (SOFTWARE COMMANDS)
231
8.3.12.1
LOESCHE HIGH-LOW-BYTE-FLIP-FLOP
232
(CLEAR FIRST/LAST FLIP-FLOP)
8.3.12.2 DMA-KONTROLLER-RESET (MASTER CLEAR)
232
8.3.12.3 LOESCHE ALLE MASKENBITS (CLEAR MASK REGISTER)
232
8.3.13 DIE ADRESSEN DER REGISTER- UND SOFTWAREKOMMANDOS
232
8.4
DER DMA-KONTROLLER UND DER REFRESH DES SPEICHERS IM PC 238
8.5 DMA-DEMOPROGRAMME
240
INHALTSVERZEICHNIS 9
8.5.1 DIE DMA-UNIT
240
8.5.2 DAS PROGRAMM DMA-TEST.PAS
245
KAPITEL 9 DER TIMERBAUSTEIN UND DAS SYSTEMTIMING
247
9.1 DER TIMER-ZAEHLER 8253 UND 8254
247
9.1.1
PROGRAMMIERUNG DES TIMER
250
9.1.1.1 DER MODUS 0 (INTERRUPT ON TERMINAL COUNT)
251
9.1.1.2
DER MODUS 1 (PROGRAMMABLE ONE-SHOT)
252
9.1.1.3 DER MODUS 2 (RATE GENERATOR)
253
9.1.1.4
DER MODUS 3 (SQUARE WAVE RATE GENERATOR)
253
9.1.1.5 DER MODUS 4 (SOFTWARE TRIGGERED STROHE)
254
9.1.1.6 DER MODUS 5 (HARDWARE TRIGGERED STROHE)
254
9.1.1.7 DER GATE-EINGANG UND SEINE WIRKUNG
255
9.1.1.8 ADRESSEN DES TIMER UND DIE VERSCHATTUNG DER EINZELNEN ZAEHLER
256
9.2 DIE CLOCKGENERATOREN 8284 UND 82284 257
9.2.1 DER CLOCKGENERATOR 8284
258
9.2.2
DER CLOCKGENERATOR 82284 263
9.3 DIE REALTIME-CLOCK 266
9.3.1
DIE REALTIME-CLOCK 146818 267
9.3.1.1 REGISTER UND PROGRAMMIERUNG DES 146818
268
9.3.1.2
ANWENDUNGEN DES 146818
271
9.3.1.3 DEMOPROGRAMM PALARM.PAS 273
9.3.1.4 DAS CUHR.C DEMOPROGRAMM 278
9.3.2 DIE REGISTER DER REALTIME-CLOCK MM 58167 279
KAPITEL
10 DIE BUS-KONTROLLE
281
10.1 DER BUS-KONTROLLER
8288
281
10.2 DER BUS-KONTROLLER 82288
286
10.3
DIE BUS-SYSTEME DES PC/XT/AT
291
10.3.1 16 BIT- ZU 8 BIT-TRANSFER
291
10.3.2 16 BIT- ZU 16 BIT-TRANSFER 293
10.3.3 8 BIT- ZU 8 BIT-TRANSFER 293
10.3.4 DIE KOPPLUNG ZWISCHEN X- UND S-BUS 294
KAPITEL
11 SPEICHERORGANISATION DES PC/XT/AT
295
11.1
STATISCH ODER DYNAMISCH ? 296
11.2
DIE SPEICHER-LOGIK DES PC/XT/AT
299
11.2.1
DAS SYSTEM-RAM INTERFACE 300
11.2.2
DIE RAM-KONTROLL-LOGIK
305
11.2.3
DIE RAM-REFRESH-LOGIK
306
11.2.4
DIE WARTE-ZYKLEN 308
11.2.5 DIE PARITAET DES SYSTEM-RAM 309
10 INHALTSVERZEICHNIS
KAPITEL 12
DIE PORTADRESSEN DES PC/XT/AT
12.1 DIE WICHTIGSTEN PC/XT/AT-PORTADRESSEN
KAPITEL 13 DIE SLOTS DES PC/XT/AT
13.1 DER PC/XT-SLOT
13.1.1 DIE PINBELEGUNG DES PC-SLOT
13.1.2 DIE SIGNALE DES PC-SLOT
13.2 DER AT-SLOT
13.2.1 DIE PIN-BELEGUNG DES AT-SLOT
13.2.2 DIE SIGNALE DES AT-SLOT
KAPITEL 14 DIE PC-FLOPPY
14.1 DER AUFBAU DER PC-FLOPPY
14.2 DER DISKETTEN-ANTRIEB
14.3 DIE POSITIONIERUNG DES SCHREIB/LESEKOPFES
14.4 DER SCHREIB/LESEKOPF DER PC-FLOPPY
14.5 DER SCHREIBVORGANG
14.6 DER LESEVORGANG
14.7
DIE 3,5 UND 5 1/4 ZOLL-DISKETTE
14.8 DIE PHYSIKALISCHE AUFZEICHNUNG
14.9 DIE AUFZEICHNUNGSVERFAHREN
14.9.1 DAS MFM/FM KODIERUNGSVERFAHREN
14.10
DIE VERBINDUNG ZWISCHEN FLOPPY UND PC
14.11 DER FLOPPY-CONTROLLER UPD765
14.11.1 DAS DIGITALE-AUSGABE-REGISTER
14.11.2
DAS MAIN-STATUS-REGISTER
14.11.3 DAS DATEN- UND KOMMANDO-STATUS-REGISTER
14.11.4 DAS DIGITALE-EINGABE-REGISTER
14.11.5 DAS DISKETTEN-KONTROLL-REGISTER
14.11.6 DEMOPROGRAMME ZUR FLOPPY
14.11.6.1
SEEK.ASM DEMOPROGRAMM
14.11.6.2
DISKT.PAS DEMOPROGRAMM
14.12 DER EINBAU VON DISKETTEN-LAUFWERKEN
KAPITEL 15
DIE FESTPLATTE IM PC/XT/AT
15.1 DIE FESTPLATTE
15.2 DER FESTPLATTEN-KONTROLLER
15.2.1 DER KONTROLL-PROZESSOR
15.2.2 DER FESTPLATTEN-KONTROLL-CHIP
15.2.3 DIE FEHLER-LOGIK
15.2.4 DER DATEN-SEPARATOR
15.3 DER EINBAU VON FESTPLATTEN
311
312
319
320
321
323
325
326
327
329
330
333
334
338
341
342
344
346
348
348
350
354
355
356
357
367
367
367
368
370
372
375
376
377
382
383
385
385
386
INHALTSVERZEICHNIS 11
15.3.1 DIE INSTALLATION DER FESTPLATTE
388
15.3.2 MOEGLICHE FEHLER UND DEREN BESEITIGUNG
390
KAPITEL 16
DIE PARALLELE SCHNITTSTELLE
393
16.1 DIE REGISTER UND DIE PROGRAMMIERUNG DER CENTRONICS-SCHNITTSTELLE
393
16.2 DER EINBAU DER PARALLELEN SCHNITTSTELLE
396
16.3
BELEGUNG DER PARALLELEN SCHNITTSTELLE
397
16.4
DATENAUSTAUSCH PER PARALLELER SCHNITTSTELLE
400
KAPITEL 17
DIE SERIELLE SCHNITTSTELLE
403
17.1
DER SERIELLE KONTROLLER 8250
403
17.1.1
DIE REGISTER UND DIE PROGRAMMIERUNG DES 8250
404
17.2
EINBAU DER SERIELLEN SCHNITTSTELLE
412
17.3
BELEGUNG DER SERIELLEN SCHNITTSTELLE
412
17.4
DATENAUSTAUSCH PER SERIELLER SCHNITTSTELLE
414
KAPITEL
18 DIE PC-MAUS
419
18.1 DIE SERIELLE MAUS
420
18.2 DIE BUS-MAUS
421
18.3
DIE SOFTWARE FUER DIE MAUS
421
18.4 DER MAUSINTERRUPT INT33H
422
18.5 PROGRAMME FUER DIE MAUS
427
18.5.1 DAS CMOUSE.C DEMOPROGRAMM
427
18.5.2 DAS AMOUSE.ASM DEMOPROGRAMM
430
18.5.3 DIE MAUS-UNIT
432
18.5.3.1 DAS PMAUS.PAS DEMOPROGRAMM
441
KAPITEL
19
DIE GRAFIK-KARTEN DES PC/XT/AT
443
19.1 DIE HERCULES-KARTE
445
19.2 DIE CGA-KARTE
449
19.3 DIE EGA-KARTE
452
19.4 DIE VGA-KARTE
453
19.5 DIE BIOS-MODI DER GRAFIK-KARTEN
456
19.6 DIE STECKER-BELEGUNGEN DER GRAFIK-KARTEN
457
19.7 DIE GRAFIK-DEMOPROGRAMME
460
19.7.1 DAS CTGR.C DEMOPROGRAMM
460
19.7.2
DAS ATGR.ASM DEMOPROGRAMM
461
19.7.3 DAS PTGR.PAS DEMOPROGRAMM
462
19.7.4 DAS AGGR.ASM DEMOPROGRAMM
463
ANHANG A BLOS-INTERRUPT-UEBERSICHT
465
ANHANG B DIE WICHTIGSTEN MS-DOS-FUNKTIONEN
469
12 INHALTSVERZEICHNIS
ANHANG C DIE BEFEHLE DES 8086/88
473
ANHANG D
DIE BEFEHLE DER CO-PROZESSOREN
477
ANHANG
E
DIE GROESSE DER ERWEITERUNGSKARTEN
479
ANHANG F
DIE ASCII- UND UMWANDLUNGSTABELLEN
481
ANHANG G
LITERATURHINWEIS
485
ANHANG H
DIE BEIGEFUEGTE DISKETTE
487
ANHANG I
AUFLISTUNG DER BILDER UND FOTOS DES BUCHES
491
|
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