Mikrorechner-Technik: 1 Mikroprozessoren und digitale Signalprozessoren : mit 57 Tabellen
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| Format: | Book |
| Language: | German |
| Published: |
Berlin [u.a.]
Springer
2002
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| Edition: | 3., vollst. überarb. Aufl. |
| Series: | Springer-Lehrbuch
|
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| Online Access: | Inhaltsverzeichnis |
| Item Description: | Literaturverzeichnis Seite [453] - 457 |
| Physical Description: | XXVI, 469 S. Ill., graph. Darst. |
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| adam_text | INHALTSVERZEICHNIS 1. GRUNDLAGEN
..............................................................................
..............................1 1.1 AUFBAU EINES
DIGITALRECHNERS.......................................................................1
1.1.1
EINFUEHRUNG...................................................................................1
1.1.2 ERKLAERUNG WICHTIGER
BEGRIFFE.......................................................5 1.1.3
ZUR ABGRENZUNG ZWISCHEN CISC- UND RISC-PROZESSOREN ..........8 1.1.4
EXKURS: ZU DEN BEGRIFFEN BIT UND BYTE
......................................12 1.2 ENTWICKLUNGSGESCHICHTE DER
MIKROPROZESSOREN.........................................13 1.2.1 DIE
VERSCHIEDENEN PROZESSOR-GENERATIONEN ..............................13
1.2.2 TECHNOLOGISCHE
ENTWICKLUNGEN.................................................18 1.3
BASISARCHITEKTUR EINES
MIKROPROZESSORS.....................................................22
1.3.1 GEHAEUSE UND
ANSCHLUESSE...........................................................22
1.3.2 EXKURS: ZUR BESCHREIBUNG VON SIGNALEN UND STEUERBITS ..........28
1.3.3 INTERNER AUFBAU
.........................................................................28
2. KOMPONENTEN EINES MIKROPROZESSORS
................................................................31 2.1
STEUERWERK
.................................................................................................31
2.1.1 FUNKTION UND AUFBAU
................................................................31 2.1.2
EIN-/AUSGANGSSIGNALE................................................................37
2.1.3 DAS STEUERREGISTER
.....................................................................40
2.1.4 FALLSTUDIE: DAS STEUERWERK DES MOTOROLA MC68000 ................41
2.1.5 FALLSTUDIE: DAS STEUERWERK DES INTEL 80486
..............................43 2.2 AUSNAHMEBEHANDLUNG
................................................................................44
2.2.1 AUSNAHMEROUTINEN
....................................................................45
2.2.2 PROZESSOREXTERNE URSACHEN FUER AUSNAHMESITUATIONEN...............47
2.2.3 PROZESSORINTERNE URSACHEN FUER AUSNAHMESITUATIONEN
...............50 2.2.4 ERMITTLUNG DER STARTADRESSE EINER
AUSNAHMEROUTINE .................52 2.2.5 DIE BEHANDLUNG MEHRERER
INTERRUPTQUELLEN...............................53 2.2.6 PRIORITAETEN BEI
MEHRFACHEN UNTERBRECHUNGEN............................59 2.2.7 EXKURS:
INTERRUPTKONTROLLE DER PROZESSOREN MC680X0..............60 2.3
ADRESSWERK..................................................................................................63
2.4 OPERATIONSWERK
..........................................................................................67
2.4.1
INTEGER-RECHENWERKE.................................................................67
2.4.2 BARREL
SHIFTER.............................................................................78
2.4.3 MULTIPLIZIER-AKKUMULIER-RECHENWERKE
....................................80 INHALTSVERZEICHNIS XIV 2.4.4
GLEITPUNKT-RECHENWERKE...........................................................81
2.4.5 MULTIMEDIA-RECHENWERKE
.........................................................84 2.5
REGISTERSATZ
................................................................................................88
2.5.1
REGISTERTYPEN.............................................................................88
2.5.2 STACK UND STACKREGISTER
.............................................................93 2.5.3
REGISTERSAETZE REALER
MIKROPROZESSOREN......................................94 2.5.4
REGISTERSPEICHER
......................................................................102
2.6 SYSTEMBUSSCHNITTSTELLE
.............................................................................110
2.6.1
AUFBAU.....................................................................................110
2.6.2 EXKURS: REALISIERUNG DER BUSANKOPPLUNG
...............................112 2.6.3 ZEITVERHALTEN DER
SYSTEMBUS-SIGNALE ......................................114 2.6.4 BUSSE
MIT
PAKETUEBERTRAGUNG....................................................125
2.6.5
MULTIPLEXBUS............................................................................127
2.6.6 STEUERUNG DER DATENBUSBREITE
.................................................129 2.6.7 ADRESSIERUNG
VON PERIPHERIEBAUSTEINEN ..................................131 2.6.8
WEITERE SIGNALE DER
SYSTEMBUSSCHNITTSTELLE............................132 2.6.9 AUFBAU UND
FUNKTION EINES SYSTEMBUS-CONTROLLERS................137 3.
HARDWARE/SOFTWARE-SCHNITTSTELLE
.....................................................................141
3.1 DATENTYPEN UND DATENFORMATE
.................................................................141
3.1.1 DATENTYPEN UND DATENFORMATE VON 8-BIT-PROZESSOREN.............142
3.1.2 DATENTYPEN UND DATENFORMATE VON 16/32-BIT-PROZESSOREN......144
3.1.3 EXKURS: IEEE-754-STANDARD
....................................................145 3.1.4 BIT- UND
BLOCKORIENTIERTE DATENTYPEN UND IHRE FORMATE..........149 3.1.5 WEITERE
DATENTYPEN UND DATENFORMATE ...................................151 3.2
BEFEHLSSAETZE
.............................................................................................154
3.2.1 BEGRIFFE UND DEFINITIONEN
.......................................................156 3.2.2
REALISIERUNG EINES MASCHINENBEFEHLSSATZES
............................158 3.2.3 DARSTELLUNG DER VERSCHIEDENEN
BEFEHLSGRUPPEN ......................166 3.3
ADRESSIERUNGSARTEN...................................................................................197
3.3.1 VORAUSSETZUNGEN UND BEGRIFFE
................................................197 3.3.2 BESCHREIBUNG
DER WICHTIGSTEN ADRESSIERUNGSARTEN..................200 3.3.3 MINIMALER
SATZ VON ADRESSIERUNGSARTEN..................................215 4.
MODERNE HOCHLEISTUNGSPROZESSOREN
................................................................217 4.1
PRINZIPIELLER
AUFBAU.................................................................................217
4.1.1 FALLSTUDIE: MOTOROLA
MC68040...............................................222 4.1.2
FALLSTUDIE: MOTOROLA
MC88110...............................................223 4.2
CACHE-SPEICHER
........................................................................................224
4.2.1 MOTIVATION
...............................................................................224
4.2.2 FUNKTIONSWEISE EINES CACHES
..................................................226 4.2.3 AUFBAU EINES
CACHE-SPEICHERS................................................229 4.2.4
ANBINDUNG DES CACHES AN DEN SYSTEMBUS ..............................237
4.2.5 STEUER- UND STATUSSIGNALE DES
CACHE-CONTROLLERS....................239 INHALTSVERZEICHNIS XV 4.2.6
SYSTEMBUSUEBERWACHUNG ZUR KOHAERENZ-ERHALTUNG...................240 4.2.7
MESI-KOHAERENZPROTOKOLL........................................................241
4.2.8 REALISIERTE
CACHE-SPEICHER......................................................246
4.3
FLIESSBANDVERARBEITUNG..............................................................................248
4.3.1 GRUNDPRINZIP
...........................................................................248
4.3.2
PIPELINEHEMMNISSE..................................................................251
4.3.3 BEISPIELE FUER REALISIERTE PIPELINES
............................................258 4.4
SUPERSKALARITAET..........................................................................................260
4.4.1
PARALLEL-PIPELINES.....................................................................260
4.4.2 STATISCHE BEFEHLSZUTEILUNG
......................................................261 4.4.3
DYNAMISCHE
BEFEHLSZUTEILUNG.................................................262 4.5
VERZWEIGUNGSVORHERSAGE
.........................................................................264
4.5.1 STATISCHE VORHERSAGEN
.............................................................265 4.5.2
DYNAMISCHE
VORHERSAGE..........................................................265
4.6 SPEKULATIVE UND UNGEORDNETE BEFEHLSAUSFUEHRUNG
....................................271 4.7 ARCHITEKTUR DER
X86-KOMPATIBLEN PROZESSOREN.........................................275
4.7.1
GRUNDLAGEN..............................................................................275
4.7.2 FALLSTUDIE: PENTIUM III VON
INTEL..............................................277 4.7.3 FALLSTUDIE:
TRACE (EXECUTION) CACHE DES INTEL PENTIUM 4 .......280 4.7.4 FALLSTUDIE:
ATHLON VON AMD...................................................282 5.
SPEICHER- UND PROZESSVERWALTUNG
.....................................................................285
(UEBERARBEITUNG UND ERWEITERUNG EINES TEXTBEITRAGS VON DR. J. DUNKEL)
5.1
EINLEITUNG.................................................................................................285
5.1.1 ZIELE VON
BETRIEBSSYSTEMEN.....................................................286
5.1.2 SPEZIELLE AUFGABEN
VONBETRIEBSSYSTEMEN...............................289 5.2 EINFUEHRUNG IN
DIE
SPEICHERVERWALTUNG.....................................................292
5.2.1 VIRTUELLE
SPEICHER....................................................................292
5.2.2 SEGMENTIERUNGS- UND
SEITENWECHSELVERFAHREN........................294 5.2.3 PROBLEME DER
VIRTUELLEN SPEICHERVERWALTUNG ..........................294 5.3
SEGMENTORIENTIERTE
SPEICHERVERWALTUNG..................................................300
5.3.1 ADRESSIERUNG DURCH
SEGMENTREGISTER.......................................300 5.3.2
ADRESSIERUNGSMODI..................................................................305
5.3.3 SEGMENT-DESKRIPTOREN UND SEGMENT-DESKRIPTOR-TABELLEN .....307 5.4
SEITENORIENTIERTE
SPEICHERVERWALTUNG.......................................................314
5.4.1 BERECHNUNG PHYSIKALISCHER AUS LINEAREN
ADRESSEN..................315 5.4.2 SEITENVERWALTUNG MIT
ADRESSRAUM-ERWEITERUNG.......................321 5.4.3 BESCHLEUNIGUNG DER
ADRESSBERECHNUNG DURCH EINEN TLB .......325 5.4.4 BEHANDLUNG VON
SEITENFEHLERN ................................................328 5.5
SCHUTZMECHANISMEN.................................................................................328
5.5.1 SCHUTZEBENEN UND
ZUGRIFFSRECHTE............................................329 5.5.2
SCHUTZMASSNAHMEN BEI SEGMENTVERWALTUNG............................330
5.5.3 UEBERPRUEFUNG DER ZUGRIFFSRECHTE
..............................................333 INHALTSVERZEICHNIS XVI
5.5.4 SCHUTZMASSNAHMEN DER
SEITENVERWALTUNG................................336 5.5.5
KONTROLLTRANSFER
.......................................................................337
5.6
PROZESSVERWALTUNG.....................................................................................342
5.6.1 PROZESS-KONTROLL-BLOCK
............................................................343 5.6.2
DESKRIPTOR DES PROZESS-KONTROLL-BLOCKS
..................................344 5.7 KOMMUNIKATION ZWISCHEN
PROZESSEN.......................................................348
5.7.1 KOMMUNIKATION BEIM SEGMENTIERUNGSVERFAHREN....................349
5.7.2 KOMMUNIKATION BEIM
SEITENWECHSELVERFAHREN.......................351 5.8 AUSNAHMEBEHANDLUNG
..............................................................................352
5.8.1 INTERRUPT-DESKRIPTOR-TABELLE
...................................................352 5.8.2
PROZESSORIENTIERTE AUSNAHMEBEHANDLUNG.................................353
5.8.3 PROZEDURORIENTIERTE
AUSNAHMEBEHANDLUNG..............................354 5.8.4 TRAP
-BEHANDLUNG
....................................................................356
5.9 GESAMTUEBERSICHT UEBER DIE
DESKRIPTOR-TABELLEN........................................358 6.
DIGITALE SIGNALPROZESSOREN
................................................................................361
6.1 GRUNDLAGEN DER DIGITALEN
SIGNALVERARBEITUNG...........................................361 6.1.1
EINLEITUNG
................................................................................361
6.1.2 AUFBAU EINES DIGITALEN SIGNALVERARBEITUNGSSYSTEMS
...............362 6.1.3
DSP-EINSATZBEREICHE...............................................................366
6.1.4 TYPISCHE DSP-ALGORITHMEN
....................................................367 6.2
BASISARCHITEKTUR DIGITALER
SIGNALPROZESSOREN...........................................368 6.2.1
TYPISCHE BUS- UND SPEICHERSTRUKTUR
.......................................368 6.2.2 GEBRAEUCHLICHE
ZAHLENFORMATE .................................................372 6.2.3
RECHENWERKE
...........................................................................373
6.2.4 DATEN-ADRESSWERKE
..................................................................377
6.2.5
STEUERWERK...............................................................................381
6.2.6 DSP-SPEZIFISCHE BEFEHLE
.........................................................386 6.3 EXKURS:
ADSP-218X VON ANALOG DEVICES
...............................................389 6.3.1 ARCHITEKTUR
..............................................................................389
6.3.2 ZAHLENFORMATE
.........................................................................393
6.3.3 RECHENWERKE
...........................................................................395
6.3.4
STEUERWERK...............................................................................409
6.3.5 SPEICHERORGANISATION
...............................................................425 6.3.6
SYSTEMBUSSCHNITTSTELLE UND ANSCHLUSS EXTERNER SPEICHER ........428 6.4
HOCHLEISTUNGS-DSPS.................................................................................431
6.4.1 DSP-FAMILIE ADSP-2106X DER FIRMA ANALOG DEVICES...........433
6.4.2 VLIW-DSPS TMS320C6XXX VON TEXAS INSTRUMENTS...........437 6.4.3
MULTIPROZESSOR-KOPPLUNG VON
DSPS.......................................441 LITERATURVERZEICHNIS
................................................................................................453
INDEX
.........................................................................................................................459
|
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