Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor: [2] Faltungscodierer und Viterby-Decodierer
Gespeichert in:
| 1. Verfasser: | |
|---|---|
| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
1988
|
| Beschreibung: | 39 Bl. |
Internformat
MARC
| LEADER | 00000nam a2200000 cc4500 | ||
|---|---|---|---|
| 001 | BV014571843 | ||
| 003 | DE-604 | ||
| 005 | 00000000000000.0 | ||
| 007 | t | ||
| 008 | 020718s1988 m||| 00||| ger d | ||
| 035 | |a (OCoLC)634661017 | ||
| 035 | |a (DE-599)BVBBV014571843 | ||
| 040 | |a DE-604 |b ger |e rakwb | ||
| 041 | 0 | |a ger | |
| 049 | |a DE-91G | ||
| 100 | 1 | |a Papanagnou, Joanis |e Verfasser |4 aut | |
| 245 | 1 | 0 | |a Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor |n [2] |p Faltungscodierer und Viterby-Decodierer |c Joanis Papanagnou |
| 264 | 1 | |c 1988 | |
| 300 | |a 39 Bl. | ||
| 336 | |b txt |2 rdacontent | ||
| 337 | |b n |2 rdamedia | ||
| 338 | |b nc |2 rdacarrier | ||
| 773 | 0 | 8 | |w (DE-604)BV014571822 |g 2 |
| 999 | |a oai:aleph.bib-bvb.de:BVB01-009907821 | ||
Datensatz im Suchindex
| _version_ | 1804129350655672320 |
|---|---|
| any_adam_object | |
| author | Papanagnou, Joanis |
| author_facet | Papanagnou, Joanis |
| author_role | aut |
| author_sort | Papanagnou, Joanis |
| author_variant | j p jp |
| building | Verbundindex |
| bvnumber | BV014571843 |
| ctrlnum | (OCoLC)634661017 (DE-599)BVBBV014571843 |
| format | Book |
| fullrecord | <?xml version="1.0" encoding="UTF-8"?><collection xmlns="http://www.loc.gov/MARC21/slim"><record><leader>00757nam a2200253 cc4500</leader><controlfield tag="001">BV014571843</controlfield><controlfield tag="003">DE-604</controlfield><controlfield tag="005">00000000000000.0</controlfield><controlfield tag="007">t</controlfield><controlfield tag="008">020718s1988 m||| 00||| ger d</controlfield><datafield tag="035" ind1=" " ind2=" "><subfield code="a">(OCoLC)634661017</subfield></datafield><datafield tag="035" ind1=" " ind2=" "><subfield code="a">(DE-599)BVBBV014571843</subfield></datafield><datafield tag="040" ind1=" " ind2=" "><subfield code="a">DE-604</subfield><subfield code="b">ger</subfield><subfield code="e">rakwb</subfield></datafield><datafield tag="041" ind1="0" ind2=" "><subfield code="a">ger</subfield></datafield><datafield tag="049" ind1=" " ind2=" "><subfield code="a">DE-91G</subfield></datafield><datafield tag="100" ind1="1" ind2=" "><subfield code="a">Papanagnou, Joanis</subfield><subfield code="e">Verfasser</subfield><subfield code="4">aut</subfield></datafield><datafield tag="245" ind1="1" ind2="0"><subfield code="a">Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor</subfield><subfield code="n">[2]</subfield><subfield code="p">Faltungscodierer und Viterby-Decodierer</subfield><subfield code="c">Joanis Papanagnou</subfield></datafield><datafield tag="264" ind1=" " ind2="1"><subfield code="c">1988</subfield></datafield><datafield tag="300" ind1=" " ind2=" "><subfield code="a">39 Bl.</subfield></datafield><datafield tag="336" ind1=" " ind2=" "><subfield code="b">txt</subfield><subfield code="2">rdacontent</subfield></datafield><datafield tag="337" ind1=" " ind2=" "><subfield code="b">n</subfield><subfield code="2">rdamedia</subfield></datafield><datafield tag="338" ind1=" " ind2=" "><subfield code="b">nc</subfield><subfield code="2">rdacarrier</subfield></datafield><datafield tag="773" ind1="0" ind2="8"><subfield code="w">(DE-604)BV014571822</subfield><subfield code="g">2</subfield></datafield><datafield tag="999" ind1=" " ind2=" "><subfield code="a">oai:aleph.bib-bvb.de:BVB01-009907821</subfield></datafield></record></collection> |
| id | DE-604.BV014571843 |
| illustrated | Not Illustrated |
| indexdate | 2024-07-09T19:03:45Z |
| institution | BVB |
| language | German |
| oai_aleph_id | oai:aleph.bib-bvb.de:BVB01-009907821 |
| oclc_num | 634661017 |
| open_access_boolean | |
| owner | DE-91G DE-BY-TUM |
| owner_facet | DE-91G DE-BY-TUM |
| physical | 39 Bl. |
| publishDate | 1988 |
| publishDateSearch | 1988 |
| publishDateSort | 1988 |
| record_format | marc |
| spelling | Papanagnou, Joanis Verfasser aut Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor [2] Faltungscodierer und Viterby-Decodierer Joanis Papanagnou 1988 39 Bl. txt rdacontent n rdamedia nc rdacarrier (DE-604)BV014571822 2 |
| spellingShingle | Papanagnou, Joanis Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor |
| title | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor |
| title_auth | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor |
| title_exact_search | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor |
| title_full | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor [2] Faltungscodierer und Viterby-Decodierer Joanis Papanagnou |
| title_fullStr | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor [2] Faltungscodierer und Viterby-Decodierer Joanis Papanagnou |
| title_full_unstemmed | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor [2] Faltungscodierer und Viterby-Decodierer Joanis Papanagnou |
| title_short | Realisierung von ratenkompatibel gelochten Faltungscodes auf einem Signalprozessor |
| title_sort | realisierung von ratenkompatibel gelochten faltungscodes auf einem signalprozessor faltungscodierer und viterby decodierer |
| volume_link | (DE-604)BV014571822 |
| work_keys_str_mv | AT papanagnoujoanis realisierungvonratenkompatibelgelochtenfaltungscodesaufeinemsignalprozessor2 |