Unterbrechungsfreie Echtzeitverarbeitung von Meßdaten mit eingebetteten Parallelrechnerarchitekturen:
Gespeichert in:
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
1998
|
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| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | Hamburg, Univ. der Bundeswehr, Diss., 1998 |
| Beschreibung: | II, 132 S. graph. Darst. |
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INHALTSVERZEICHNIS
VERWENDETE
FORMEKEICHEN
UND
ABKUERZUNGEN
.
1
1
EINLEITUNG
.
4
2
EINFUEHRUNG
.
6
2.1
KURZZEITANALYSE
IN
NIEDERSPANNUNGSNETZEN
.
6
2.1.1
FFT-ANSATZ
.
7
2.1.2
ERHOEHUNG
DER
SPEKTRALEN
DICHTE
.
9
2.1.3
DFT-ANSATZ
.
11
2.2
HARD
UND
SOFTWAREKONZEPT
FUER
EINGEBETTETE
DSP-ARCHITEKTUREN
.
13
2.3
DEFINITION
YYEINGEBETTETER
ECHTZEITDATENVERARBEITUNG
"
.
18
2.4
PARALLELRECHNER
UND
YYECHTZEIT
"
.
19
2.5
ECHTZEITASPEKT
IN
DER
SCHNELLEN
MESSDATENVERARBEITUNG
.
20
2.6
MESSDATENVERARBEITUNG
FUER DIE
KURZSCHLUSSFRUEHERKENNUNG
.
21
3
ARCHITEKTURKONZEPTE
FUER DIE
PARALLELE
MESSDATENVERARBEITUNG
.
25
3.1
AUSLEGUNG
DER
ALGORITHMEN
.
26
3.2
BEDARF
AN
RECHENLEISTUNG
.
32
3.2.1
RECHENLEISTUNG
FUER
DEN
FFT-ANSATZ
.
32
3.2.2
RECHENLEISTUNG
FUER DEN
DFT-ANSATZ
.
37
3.3
KOMMUNIKATIONSBANDBREITEN
.
40
3.3.1
ANFORDERUNGEN
.
40
3.3.2
VERGLEICH
ZWISCHEN
PARALLELER
UND
SERIELLER
UEBERTRAGUNG
.
43
3.4
EINBETTUNG
VON
DSPS
IN
FPGA-STRUKTUREN
.
44
3.4.1
CHARAKTERISTIKA
EINES
EINGEBETTETEN
DSP'S
.
45
3.4.2
KOMBINIERTER
HARDWARE/SOFTWARE-ENTWURF.
.
46
3.4.3
FPGA-FUNKTIONALITAETEN
.
52
3.4.3.1
FPGA-BASIERTE
DATENPFADE
.
53
3.4.3.2
FPGA-BASIERTE
STEUERUNGSLOGIK
.
55
3.5
DATENFLUSSORIENTIERTE
SOFTWAREARCHITEKTUR
.
55
4
PRAKTISCHE
UMSETZUNG
DER
ARCHITEKTURKONZEPTE
.
58
4.1
DSP-SYSTEME
MIT
REKONFIGURIERBAREN
ARCHITEKTUREN
.
59
4.1.1
ERWEITERUNG
VORHANDENER
DSP-BAUGRUPPEN
.
59
4.1.1.1
DIE
DSP-BAUGRUPPE
ZPB3212
.
60
4.1.1.2
DIE
KOMMUNIKATIONSBAUGRUPPE
.
61
4.1.2
REALISIERUNG
SPEZIELLER
MULTI-DSP-BAUGRUPPEN
.
64
4.1.2.1
VIERFACH
DSP-BOARD
MIT
HOHER
VERSCHALTUNGSFLEXIBILITAET.
.
.65
4.1.2.2
ACHTFACH
DSP-BOARD
MIT
EINGESCHRAENKTER
FLEXIBILITAET
.
67
4.1.3
REALISIERUNG
EINES
MODULAREN
KONZEPTES
.
70
4.1.3.1
DSPM-MODUL
.
71
4.1.3.2
M-MODUL
BASISBAUGRUPPE
.
73
4.1.4
UNIVERSELLE
FPGA-BASIERTE
DATENPFADE
.
76
4.1.4.1
BUSORIENTIERTES
QUELLE/ZIEL-KONZEPT
.
77
4.1.4.2
MULTIPLEXERBASIERTES
QUELLE/ZIEL-KONZEPT
.
81
4.1.5
SKALIERBARKEIT
FPGA-BASIERTER
DATENPFADE
.
83
4.1.5.1
ANZAHL
REALISIERBARER
SERIELLER
ANSCHLUESSE
.
83
4.1.5.2
LIMITIERUNG
DER
SCHALTUNGSKOMPLEXITAET
.
85
4.1.5.3
REDUZIERUNG
DER
EFFEKTIVEN
DATENRATE
.
86
4.2
IMPLEMENTIERUNG
DER
ALGORITHMISCHEN
STRUKTUREN
.
89
4.2.1
ERSTE
IMPLEMENTIERUNG
DES
FFT-ANSATZES
.
89
4.2.2
ZWEITE
IMPLEMENTIERUNG
DES
FFT-ANSATZES
.
91
4.2.3
IMPLEMENTIERUNG
DES
DFT-ANSATZES
.
94
4.3
DIE
MESSWERTERFASSUNGSEINHEIT
.
98
4.3.1
ANALOGE
VORVERARBEITUNG
.
99
4.3.2
ANALOG-DIGITAL
UMSETZUNG
.
101
4.3.3
UEBERTRAGUNG
DER
MESSDATEN
.
101
4.4
DIGITALE
VORVERARBEITUNG
.
103
4.4.1
THEORETISCHE
BETRACHTUNG
VON
DEZIMIERUNGSFIITEM
.
104
4.4.2
REALISIERUNGSMOEGLICHKEITEN
FUER
DEZIMIERUNGSFILTER
.
105
4.4.3
IMPLEMENTIERUNG
VON
ARITHMETIKFUNKTIONALITAET
IN
FPGAS
.
106
4.4.4
DEZIMIERUNGSFILTER
IN
DER
KOMMUNIKATIONSBAUGRUPPE
.
106
4.4.5
DIE
DIGITALE
VORVERARBEITUNGSBAUGRUPPE
.
107
4.5
PROTOTYPENAUFBAU
FUER
DIE
KURZSCHLUSSFRUEHERKENNUNG
.
109
4.5.1
GESAMTANORDNUNG
FUER
DIE
1.
FFT-IMPLEMENTIERUNG
.
111
4.5.2
GESAMTANORDNUNG
FUER DIE
2.
FFT-IMPLEMENTIERUNG
.
113
4.5.3
GESAMTANORDNUNG
FUER DIE
DFT-IMPLEMENTIERUNG
.
114
4.5.4
ABSCHAETZUNG
DER
ABSCHALTGESCHWINDIGKEIT
.
117
5
ZUSAMMENFASSUNG
UND
AUSBLICK
.
118
LITERATURVERZEICHNIS
.
121
ANHANG:
SYSTEMKONZEPT
ZUM
UEBERGANG
AUF
EIN
MIKROSYSTEM
.
128 |
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