Programmierbare Logik mit GAL und CPLD: Einführung in die Schaltungsentwicklung mit Logikbausteinen in ISP-Technologie
Gespeichert in:
| 1. Verfasser: | |
|---|---|
| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
München [u.a.]
Oldenbourg
1999
|
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | X, 236 S. Ill., graph. Darst. CD-ROM (12 cm) |
| ISBN: | 3486246100 |
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PROGRAMMIERBARE
LOGIK MIT GAL UND CPLD EINFUEHRUNG IN DIE SCHALTUNGSENTWICKLUNG MIT
LOGIKBAUSTEINEN IN ISP-TECHNOLOGIE VON CHRISTIAN ELLWEIN
R.OLDENBOURG VERLAG MUENCHEN WIEN 1999
IMAGE 2
INHALTSVERZEICHNIS
VORWORT 1
1.1 1.2 1.2.1 1.2.2
1.2.3 1.3 1.4
2
2.1 2.1.1 2.1.2 2.2 2.2.1 2.2.2 2.2.3 2.3 2.3.1 2.3.2 2.3.3
2.3.4 2.3.5
3
3.1 3.1.1 3.1.2 3.1.3 3.2
3.3 3.4
GAL, CPLD UND ABGRENZUNG ZU ANDEREN PROGRAMMIERBAREN BAUSTEINEN WARUM
PROGRAMMIERBARE BAUSTEINE ? UEBERBLICK UEBER VERSCHIEDENE BAUSTEINE
PLD-BAUSTEINE
SPEICHER SONSTIGE PROGRAMMIERBARE BAUSTEINE DIE ISP-TECHNOLOGIE SYNTHESE
ODER *BASTELN ?
SCHALTNETZE KURZE VORSTELLUNG WICHTIGER VERKNUEPFUNGEN XOR - VERKNUEPFUNG
NOR- UND NAND - VERKNUEPFUNG
VEREINFACHUNG VON SCHALTNETZEN THEOREME MIT EINER VARIABLEN UND EINER
KONSTANTEN THEOREME MIT EINER VARIABLEN DE-MORGANSCHES GESETZ
SYNTHESE VON SCHALTNETZEN DAS PROBLEM IN VERBALER FORM FESTLEGUNG DER
EIN- UND AUSGANGSVARIABLEN ERSTELLEN DER WAHRHEITSTABELLE
BESTIMMEN DER LOGISCHEN VERKNUEPFUNGSSCHALTUNGEN REALISIERUNG MIT EINEM
ENTWICKLUNGSWERKZEUG
SCHALTWERKE FLIPFLOPS RS-FF T-FF
D-FF ALLGEMEINE STRUKTUR EINES SCHALTWERKES AUS SCHALTNETZ UND SPEICHER
(MOORE-STRUKTUR) MEALY-STRUKTUR
BESCHREIBUNG VON SCHALTWERKEN
IX
1
1
2
3
10 10 10 12
15 16 16 17 19
19 20 20 21 21
22 22 23 23
25 26 26 27 28
28 30 30
IMAGE 3
3.4.1 SCHALTFOLGETABELLE 31
3.4.2 ZUSTANDSDIAGRAMM 35
3.4.3 HARDWAREBESCHREIBUNGSSPRACHEN 36
3.5 BETRIEBSARTEN VON SCHALTWERKEN 37
3.5.1 SYNCHRONER BETRIEB 38
3.5.2 ASYNCHRONER BETRIEB 39
3.6 SYNTHESE VON SCHALTWERKEN 39
3.6.1 ERSTELLEN DER SCHALTFOLGETABELLE ODER DES ZUSTANDSDIAGRAMMS 40
3.6.2 REALISIERUNG MIT EINEM ENTWICKLUNGSWERKZEUG 40
4 DIE WECHSEL-BLOCK-METHODE 41
4.1 GRUNDLAGEN 41
4.2 SYNTHESE VON SCHALTNETZEN MIT DER WECHSEL-BLOCK-METHODE 42
4.3 SYNTHESE VON SCHALTWERKEN 43
4.4 BEISPIEL ZUR WECHSEL-BLOCK-METHODE 44
5 TECHNISCHE BESCHREIBUNG DER GAL 48
5.1 EINFUEHRUNG 48
5.2 DAS ISPGAL22V10 48
5.3 REGISTER-MODUS 51
5.4 TRISTATE-MODUS 53
5.5 KOMBINATORISCHER MODUS 54
5.6 EMULATION VON PAL MIT GAL 55
5.7 INTERNER AUFBAU DES ISPGAL22 V10 56
5.7.1 UND-MATRIX 56
5.7.2 EIN-/AUSGAENGE 58
5.7.3 PROGRAMMIERUNG DES GAL 59
5.7.4 NAMENSERWEITERUNGEN FUER VARIABLEN 59
5.7.5 SONSTIGE MOEGLICHKEITEN DES ISPGAL22V 10 61
5.7.6 TIMINGDESISPGAL22V10 68
6 6 TECHNISCHE BESCHREIBUNG DER CPLD 71
6.1 EINFUEHRUNG 71
6.1.1 DIE VERBINDUNGSMATRIX 73
6.1.2 DASMINI-GAL 76
6.1.3 DIE I/O-ZELLEN 78
6.1.4 DAS TIMING VON CPLD 80
6.1.5 DESIGNSTRATEGIEN BEI CPLD 82
6.1.6 AUSGANGSSPANNUNGEN BEI CPLD 88
6.2 BAUSTEINE VERSCHIEDENER HERSTELLER 90
6.3 BAUSTEINE VON ALTERA 91
6.3.1 ALLGEMEINES 91
6.3.2 DIE MAX 9000 - FAMILIE 92
6.3.3 DIE MAX 7000 - FAMILIE
IMAGE 4
VII
6.3.4 6.3.5 6.4 6.4.1
6.4.2 6.5 6.5.1 6.5.2
6.5.3 6.6 6.6.1 6.6.2 6.6.3 6.6.4 6.6.5 6.6.6 6.6.7
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6.8.4 6.8.5 6.9 6.9.1 6.9.2 6.9.3 6.10 6.10.1
6.10.2
DIE PROGRAMMIERUNG DER MAX-BAUSTEINE DIE FLEX-BAUSTEINE VON ALTERA
BAUSTEINE VON ATMEL ALLGEMEINES DIE ATF1500AS-FAMILIE
BAUSTEINE VON CYPRESS FLASH3 70I-GENERATION ERWEITERTE EIGENSCHAFTEN DER
ULTRA37000-FAMILIE DIE PROGRAMMIERUNG
BAUSTEINE VON LATTICE ALLGEMEINES PLSI- UND ISPLSI 1000/E-FAMILIE ISPLSI
2000-FAMILIE
ISPLSI 3000-FAMILIE ISPLSI 6000-FAMILIE DIE DOWNLOAD-SOFTWARE DAS
DOWNLOAD-KABEL BEI LATTICE BAUSTEINE VON PHILIPS ALLGEMEINES DAS
MINI-GAL BEI PHILIPS DIE VERBINDUNGSMATRIX (ZIA)
SONSTIGE EIGENSCHAFTEN DER PHILIPS CPLD BAUSTEINE VON VANTIS ALLGEMEINES
MACH 1 UND MACH 2-BAUSTEINE MACH 4-BAUSTEINE
MACH 5-BAUSTEINE DIE PROGRAMMIERUNG DER MACH CPLD DIE BAUSTEINE VON
XILINX ALLGEMEINES DIE XC9500-FAMILIE DIE PROGRAMMIERUNG DER XC9500
VERGLEICH DER BAUSTEINFAMILIEN DER PREP-BENCHMARK CHECKLISTE FUER DIE
AUSWAHL VON CPLD
104 106 108 108
109 115 116 122 123
124 124 124 134 134
135 135 135 137 138
139 143 144 145
145 146 150 152 153 154
154 154 161 162 162 163
7 DIE ISP-TECHNOLOGIE 165
7.1 EINFUEHRUNG 165
7.1.1 VORTEILE DER ISP-TECHNOLOGIE 166
7.1.2 MOEGLICHKEITEN DER PROGRAMMIERUNG VON ISP-BAUSTEINEN 167
7.1.3 UNTERSCHIEDE ZWISCHEN DEN SCHNITTSTELLEN DER ISP-BAUSTEINE 168
7.2 HARD-UND SOFTWARE BEI DER IN SYSTEM PROGRAMMIERUNG 173
7.2.1 DAS DOWNLOAD-KABEL 173
7.2.2 IN-SYSTEM-PROGRAMMIERUNG BEI LATTICE 174
IMAGE 5
VIII
7.2.3 IN-SYSTEM-PROGRAMMIERUNG UEBER DEN JT AG-PORT 179
7.3 PROBLEME DURCH DIE DATEIGROESSE 187
7.31 JAM - EIN LOESUNGSANSATZ VON ALTERA 187
7.32 ISPSTREAM - EIN LOESUNGSANSATZ VON LATTICE 191
8 ENTWICKLUNGSSOFTWARE 193
8.1 EINFUEHRUNG 193
8.2 SYNARIO 196
8.2.1 INSTALLATION 196
8.2.2 UEBERBLICK 197
8.2.3 DER SCHALTPLAN-EDITOR 198
8.2.4 HIERARCHISCHE STRUKTURIERUNG DES DESIGNS 201
8.2.5 PROPERTIES 202
8.3 LOGIC/2 203
8.4 MAX+PLUS II 204
8.5 XILINX FOUNDATION SERIES SOFTWARE 206
8.6 PDS STARTER SOFTWARE 207
8.7 WARP 208
9 ENTWICKLUNGSBOARDS 210
9.1 ALLGEMEINES 210
9.2 XPLA-PROMMER 211
10 DESIGNBEISPIELE 214
10.1 EINFUEHRUNG 214
10.2 EINGABE IN TABELLEN UND GLEICHUNGEN 214
10.2.1 BESCHREIBUNG DES DESIGNS IN DER LOGIC/2-SYNTAX 214
10.2.2 ERKLAERUNG DER LOGIC/2-SYNTAX 216
10.3 EINGABE ALS SCHALTPLAN 217
10.4 EINGABE ALS VHDL-SKRIPT 220
10.4.1 BESCHREIBUNG DES DESIGNS IN DER VHDL-DATEI 221
10.4.2 ERKLAERUNG DER VHDL-DATEI 222
11 CD-ROM 223
12 ADRESSEN 224
12.1 POSTADRESSEN 224
12.2 INTERESSANTE INTERNET-SEITEN 226
13 GLOSSAR 229
14 LITERATURANGABEN 233
15 STICHWORTVERZEICHNIS 234
|
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