Übersetzungsmethoden für strukturprogrammierbare Rechner:
Gespeichert in:
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Berlin
Logos-Verl.
1997
|
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | Zugl.: Karlsruhe, Univ., Diss., 1997 |
| Beschreibung: | IV, 147 S. Ill., graph. Darst. |
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INHALTSVERZEICHNIS
1
EINLEITUNG
1
2
EIN
EINFUEHRENDES
BEISPIEL
4
2.1
BILDVERARBEITUNG
.
4
2.2
GRUNDSTRUKTUR
KOMBINIERTER
UEBERSETZER
.
10
3
STRUKTURPROGRAMMIERBARE
HARDWARE
11
3.1
PROGRAMMIERBARE
LOGIKBAUSTEINE
.
11
3.1.1
PROGRAMMABLE
LOGIC
ARRAYS
.
11
3.1.2
FIELD-PROGRAMMABLE
GATE
ARRAYS
.
12
3.2
ENTWURFSWERKZEUGE
FUER
FPGAS
.
14
3.2.1
HIGH-LEVEL-SYNTHESE
.
14
3.2.2
LOGIKSYNTHESE
.
16
3.3
STRUKTURPROGRAMMIERBARE
RECHNER
.
17
3.3.1
WIRT
UND
REKONFIGURIERBARE
EINHEIT
.
18
3.4
ANWENDUNGEN
.
19
3.4.1
MIKROPROZESSOREN
.
19
3.4.2
REKONFIGURIERBARE
HARDWARE
.
19
3.4.3
KOOPERATION
IM
STRUKTURPROGRAMMIERBAREN
RECHNER
.
21
4
VERWANDTE
TECHNIKEN
22
4.1
ANSAETZE
ZUR
KOMBINIERTEN
PROGRAMMIERUNG
.
22
4.1.1
SEQUENTIELLE
SPRACHEN
.
23
4.1.2
PARALLELE
SPRACHEN
.
23
4.2
AUTOMATISCHE
HARDWARE/SOFTWARE-PARTITIONIERUNG
.
24
4.3
PIPELINE-SYNTHESE
UND
-OPTIMIERUNG
.
26
4.3.1
GRUNDLAGEN
DER
PIPELINE-VERARBEITUNG
.
26
4.3.2
SYNTHESE
AUS
DATEN-PARALLELEN
PROGRAMMEN
.
27
4.3.3
PIPELINING
IN
DER
HIGH-LEVEL-SYNTHESE
.
29
II
INHALTS
VERZEICHNIS
4.3.4
REGISTER-VERTEILUNG
UND
OPTIMIERUNG
.
29
4.4
PARALLELITAET
DURCH
VEKTORISIERUNG
.
32
4.4.1
VEKTORRECHNER
UND
VEKTORANWEISUNGEN
.
32
4.4.2
AUTOMATISCHE
VEKTORISIERUNG
.
33
5
VEKTORISIERUNG
UND
PIPELINE-SYNTHESE
37
5.1
KOPROZESSOREN
FUER
SCHLEIFENFREIE
PROGRAMMTEILE
.
38
5.1.1
EINGABESPRACHE
.
38
5.1.2
HARDWARE-KANDIDATEN
.
39
5.1.3
ALIAS-ANALYSE
.
40
5.1.4
KOPROZESSOR-SYNTHESE
.
42
5.2
PIPELINES
FUER
SCHLEIFEN
OHNE
ABHAENGIGKEITEN
.
44
5.2.1
SCHLEIFEN-AUSWAHL
UND
-NORMALISIERUNG
.
44
5.2.2
VEKTORISIERUNG
.
49
5.2.3
PIPELINE-SYNTHESE
.
52
5.3
PIPELINES
FUER
SCHLEIFEN
MIT
ABHAENGIGKEITEN
.
56
5.3.1
ERWEITERTE
VEKTORISIERUNG
.
57
5.3.2
PIPELINE-SYNTHESE
MIT
RUECKKOPPLUNGSZYKLEN
.
57
5.3.3
BEHANDLUNG
VON
WHILE-SCHLEIFEN
.
63
5.4
REGISTEROPTIMIERUNG
FUER
FPGA-PIPELINES
.
64
5.4.1
REGISTERZUSAMMENFASSUNG
.
64
5.4.2
LINEARES
PROGRAMM
ZUR
OPTIMALEN
REGISTER-VERTEILUNG
.
65
5.5
GESAMTSTRUKTUR
DER
PIPELINE-SYNTHESE
.
71
5.6
BEWERTUNG
.
73
6
KOMBINIERTE
STRUKTURPROGRAMMIERUNG
76
6.1
RELEVANTE
MASCHINENEIGENSCHAFTEN
.
76
6.2
KOMBINATION
DER
UBERSETZUNGSMETHODEN
.
77
6.3
ANSTEUERUNG
DER
KOPROZESSOREN
.
79
6.3.1
PIPELINE-STEUERUNGSEINHEIT
UND
HARDWARE-INTEGRATION
.
79
6.3.2
SOFTWARE-INTEGRATION
.
83
6.4
HARDWARE/SOFTWARE-PARTITIONIERUNG
.
85
6.4.1
SCHAETZUNG
DER
AUSFUEHRUNGSZEITEN
.
86
6.4.2
BESTIMMUNG
DER
LOHNENDEN
PIPELINES
.
87
6.4.3
LAUFZEIT-AUSWAHL
.
89
6.5
BEWERTUNG
.
91
INHALTSVERZEICHNIS
III
7
DER
M
ODULA
P
IPELINE
C
OMPILER
93
7.1
DIE
HARDWARE-PLATTFORM
.
93
7.1.1
DER
ENGINEER
'
S
VIRTUAL
COMPUTER
EVC1
.
94
7.2
DER
MOCKA-COMPILER
.
94
7.2.1
PHASEN
DER
UEBERSETZUNG
.
95
7.3
IMPLEMENTIERUNG
.
95
7.3.1
PIPELINE-SYNTHESE
.
97
7.3.2
PIPELINE-STEUERUNGSEINHEIT
.
98
7.3.3
GENERIERUNG
DER
FPGA-KONFIGURATION
.
100
7.3.4
ANPASSUNG
DES
ZWISCHENCODES
.
100
7.3.5
INTEGRATION
.
101
7.4
ERFAHRUNGEN
UND
VERBESSERUNGSVORSCHLAEGE
.
101
7.4.1
SCHNITTSTELLEN-OPTIMIERUNGEN
.
103
8
ANWENDUNGEN
UND
ERGEBNISSE
105
8.1
DER
MESSAUFBAU
.
106
8.2
BEISPIELE
.
106
8.2.1
FIR-FILTER
.
106
8.2.2
ZELLULARAUTOMATEN
.
108
8.2.3
BILDVERARBEITUNG
.
110
8.2.4
VERARBEITUNG
VON
ZEICHENKETTEN
.
111
8.3
FOLGERUNGEN
.
112
9
ERWEITERUNGEN
115
9.1
SYNTHESE-ERWEITERUNGEN
.
115
9.1.1
SPEZIELLE
KOMBINATORISCHE
FUNKTIONEN
.
115
9.1.2
SPEICHERZUGRIFF
IN
PIPELINES
.
116
9.2
SCHLEIFEN-TRANSFORMATIONEN
.
117
9.2.1
VEKTORISIERUNG
DER
LAENGSTEN
SCHLEIFE
.
117
9.2.2
BEHEBUNG
VON
HARDWARE-ENGPAESSEN
.
117
9.2.3
BEHEBUNG
VON
LOKALEN
SPEICHER-ENGPAESSEN
.
118
9.2.4
AUFLOESUNG
IRREGULAERER
ABHAENGIGKEITEN
.
118
9.3
ERWEITERUNG
DER
PARTITIONIERUNG
.
119
9.4
VERALLGEMEINERUNG
DES
RECHNER-MODELLS
.
119
9.4.1
MEHRERE
SPEICHERBAENKE
.
119
9.4.2
MULTI-FPGA-ARCHITEKTUREN
.
120
9.5
ERWEITERUNGEN
DER
EINGABESPRACHE
.
120
IV
INHALTSVERZEICHNIS
10
ZUSAMMENFASSUNG
UND
AUSBLICK
121
10.1
ZUSAMMENFASSUNG
.
121
10.2
AUSBLICK
.
122
LITERATURVERZEICHNIS
124
VERZEICHNIS
DER
ABKUERZUNGEN
131
A
GEWICHTSVERTEILUNG
LINEARER
BLOCKCODES
133
A.L
GEWICHTSVERTEILUNG
LINEARER
BLOCKCODES
.
133
A.2
IMPLEMENTIERUNG
.
134
A.3
LAUFZEITMESSUNGEN
.
136
A.4
PROGRAMMIERUNG
IN
HOEHEREN
SPRACHEN
.
137
A.5
ZUSAMMENFASSUNG
.
138
B
LINEARES
PROGRAMM
ZUR
PARTITIONIERUNG
140
B.L
HARDWARE/SOFTWARE-CODESIGN
.
140
B.2
VORVERARBEITUNG
.
142
B.2.1
KANDIDATEN-AUSWAHL
.
142
B.2.2
DATENFLUSS-ANALYSE
.
143
B.3
LINEARES
PROGRAMM
ZUR
PARTITIONIERUNG
.
144
B.3.1
NOTATION
.
144
B.3.2
KOSTENFUNKTION
.
145
B.3.3
BEDINGUNGEN
.
146
B.4
ERGEBNISSE
.
147
B.5
ZUSAMMENFASSUNG
.
147 |
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