Testentwurf zur Erkennung von Verzögerungsfehlern in hochintegrierten Schaltungen:
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| Language: | German |
| Published: |
Aachen
Shaker
1996
|
| Edition: | Als Ms. gedr. |
| Series: | Berichte aus der Informatik
|
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| Online Access: | Inhaltsverzeichnis |
| Item Description: | Zugl.: München, Techn. Univ., Diss., 1996 |
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INHALTSVERZEICHNIS
1
EINLEITUNG
1
1.1
TESTEN
DIGITALER
SCHALTUNGEN
.
3
1.1.1
TESTABLAUF
.
YY
.
4
1.1.2
FEHLERMODCLLE
.
5
1.1.3
PRUEFPFADTECHNIKEN
.
6
1.2
AUFGABENSTELLUNG
DES
TESTENTWURFS
.
7
1.3
STAND
DER
TECHNIK
.
10
1.4
ZIELE
DER
ARBEIT
.
16
1.5
PRUEFPFADTECHNIKEN
FUER
DEN
DYNAMISCHEN
TEST
.
18
2
GRUNDLAGEN
19
2.1
SCHALTUNGSBESCHREIBUNG
.
20
2.1.1
BESCHREIBUNG
DER
KOMBINATORIK
.
20
2.1.2
BESCHREIBUNG
DES
SEQUENTIELLEN
VERHALTENS
.
23
2.2
DAS
PFADVERZOEGERUNGSFEHLERMODELL
.
25
2.2.1
DAS
TESTMODELL
.
25
2.2.2
MODELLIERUNG
VON
VERZOEGERUNGSFEHLERN
.
26
2.2.3
FEHLERERKENNUNG
.
28
2.2.4
AUFGABENSTELLUNG
.
32
II
I
NHALTSVERZEICHNIS
3
UNTERSUCHUNG
DES
VERZOEGERUNGSFEHLERMODELLS
33
3.1
REDUNDANTE
VERZOEGERUNGSFEHLER
.
34
3.2
KLASSIFIZIERUNG
DER
VERZOEGERUNGSFEHLER
.
35
3.3
VERZOEGERUNGSDEFEKTWAHRSCHEINLICHKEIT
N
'
J
.
39
3.4
DISKUSSION
DER
UNTERSUCHUNGEN
.
41
4
VERWALTUNG
FUNKTIONALER
PFADE
43
4.1
SPEICHERUNG
FUNKTIONALER
PFADE
.
44
4.2
DIE
PFADKENNUNG
.
46
4.2.1
GRUNDGATTER
.
46
4.2.2
XOR/XNOR
GATTER
.
47
4.2.3
BEISPIEL
.
48
4.3
SPEICHERUNG
DER
PFADINFORMATION
.
49
5
FEHLERSIMULATION
51
5.1
FEHLERSIMULATION
FUER
VERZOEGERUNGSFEHLER
.
52
5.1.1
INITIALISIERUNG
DER
PRIMAEREINGAENGE
UND
GUTSIMULATION
.
52
5.1.2
IDENTIFIKATION
DER
ERKENNBAREN
VERZOEGERUNGSFEHLER
.
53
5.1.3
BEISPIEL
.
55
5.2
BESCHLEUNIGUNGSMETHODEN
.
56
5.2.1
CODIERUNG
DER
LOGISCHEN
WERTE
.
56
5.2.2
SEGMENT-SPEICHERUNG
.
59
5.2.3
KOMBINIERT
ROBUST/NICHT
ROBUSTE
FEHLERSIMULATION
.
64
5.3
SEQUENTIELLE
SCHALTUNGEN
MIT
SCAN
PATH
.
68
6
AUTOMATISCHE
TESTMUSTERGENERIERUNG
71
6.1
ATG
FUER
VERZOEGERUNGSFEHLER
.
72
6.1.1
DIE
TESTMUSTERGENERIERUNG
ALS
SUCHVERFAHREN
.
72
I
NHALTSVERZEICHNIS
III
6.1.2
GRUNDSAETZLICHE
VORGEHENSWEISE
.
73
6.2
DIE
PFADSENSIBILISIERUNG
.
76
6.3
LOGIKEN
FUER
DIE
TESTMUSTERGENERIERUNG
.
77
6.4
DIE
IMPLIKATIONSPROZEDUR
.
81
6.4.1
AUSWERTUNG
DER
GATTERFUNKTION
.
82
6.4.2
IMPLIKATION
.
84
6.5
BEISPIEL
.
87
7
EXPERIMENTELLE
ERGEBNISSE
89
7.1
DEFEKTWAHRSCHEINLICHKEIT
.
90
7.2
VERWALTUNG
FUNKTIONALER
PFADE
.
95
7.3
FEHLERSIMULATION
.
97
7.4
AUTOMATISCHE
TESTMUSTERGENERIERUNG
.
100
ZUSAMMENFASSUNG
105
LITERATURVERZEICHNIS
109
A
VEREINBARUNGEN,
FORMELZEICHEN
UND
ABKUERZUNGEN
121
A.L
VEREINBARUNGEN
UND
FORMELZEICHEN
.
121
A.2
ABKUERZUNGEN
.
124
B
STANDARDABWEICHUNG
DER
PFADLAUFZEIT
125
C
TABELLEN
FUER
FS
UND
ATG
127
C.L
TABELLEN
ZUR
FEHLERSIMULATION
.
127
C.2
TABELLEN
ZUR
AUTOMATISCHEN
TESTMUSTERGENERIERUNG
.
128
D
SCHALTUNGSCHARAKTERISTIKA
133
IV
I
NHALTSVERZEICHNIS
KURZFASSUNG
135 |
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| spelling | Wittmann, Hannes Verfasser aut Testentwurf zur Erkennung von Verzögerungsfehlern in hochintegrierten Schaltungen Hannes Wittmann Als Ms. gedr. Aachen Shaker 1996 X, 134 S. graph. Darst. txt rdacontent n rdamedia nc rdacarrier Berichte aus der Informatik Zugl.: München, Techn. Univ., Diss., 1996 Testmustergenerierung (DE-588)4234817-1 gnd rswk-swf Fehlersimulation (DE-588)4234819-5 gnd rswk-swf Verknüpfungsglied (DE-588)4135908-2 gnd rswk-swf Verzögerungszeit (DE-588)4400439-4 gnd rswk-swf Digitalschaltung (DE-588)4012295-5 gnd rswk-swf Fehlererkennung (DE-588)4133764-5 gnd rswk-swf VLSI (DE-588)4117388-0 gnd rswk-swf (DE-588)4113937-9 Hochschulschrift gnd-content Digitalschaltung (DE-588)4012295-5 s VLSI (DE-588)4117388-0 s Verknüpfungsglied (DE-588)4135908-2 s Verzögerungszeit (DE-588)4400439-4 s Fehlererkennung (DE-588)4133764-5 s Fehlersimulation (DE-588)4234819-5 s DE-604 Testmustergenerierung (DE-588)4234817-1 s DNB Datenaustausch application/pdf http://bvbr.bib-bvb.de:8991/F?func=service&doc_library=BVB01&local_base=BVB01&doc_number=007272528&sequence=000001&line_number=0001&func_code=DB_RECORDS&service_type=MEDIA Inhaltsverzeichnis |
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