VLSI-Entwurf: Vorgehen, Methoden, Automatisierung
Gespeichert in:
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Bonn u.a.
Internat. Thomson Publ.
1995
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| Ausgabe: | 1. Aufl. |
| Schriftenreihe: | Thomson's aktuelle Tutorien
17 |
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | Literaturverz. S. 109 - 112 |
| Beschreibung: | VIII, 115 S. Ill., graph. Darst. |
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INHALTSVERZEICHNIS
1
EINLEITUNG
1
2
ENTWURFSABLAUF
3
2.1
ENTWURFSSCHRITTE
UND
ENTWURFSEBENEN
.
3
2.2
ENTWURF
MIT
VHDL
.
9
2.2.1
VHDL
ALS
PROGRAMMIERSPRACHE
.
10
2.2.2
SCHALTUNGSSTRUKTUREN
.
19
2.2.3
SCHALTUNGSVERWALTUNG
.
25
2.3
ZUSAMMENFASSUNG
.
27
3
SPEZIFIKATION
UND
SIMULATION
29
3.1
SPEZIFIKATIONSERSTELLUNG
.
29
3.2
VERHALTENSBESCHREIBUNG
MIT
VHDL
.
30
3.2.1
SIGNALZUWEISUNGEN
.
31
3.2.2
PROZESSE.
35
3.2.3
SIMULATIONSALGORITHMUS
.
37
3.3
SPEZIFIKATION
DES
SYSTEMS
.
39
3.3.1
VORGEHENSWEISE
.
40
3.3.2
SPEZIFIKATION
DES
BEISPIELS
.
40
3.4
VALIDIERUNG
DES
SYSTEMS.
42
3.4.1
STIMULIERZEUGUNG
.
43
3.4.2
VALIDIERUNG
DES
BEISPIELS
.
44
3.5
ZUSAMMENFASSUNG
.
47
4
ARCHITEKTURSYNTHESE
49
4.1
AUFGABEN
DER
SYNTHESE
.
50
4.2
AUFGABEN
DER
ARCHITEKTURSYNTHESE
.
51
4.2.1
SYNTHETISIERBARES
VHDL
.
54
4.2.2
ALGORITHMEN
DER
ARCHITEKTURSYNTHESE
55
4.3
ZUSAMMENFASSUNG
.
65
5
LOGIKSYNTHESE
67
5.1
SYNTHESE
ARITHMETISCHER
EINHEITEN
.
67
5.2
STEUERWERKSSYNTHESE
.
69
5.3
LOGIKMINIMIERUNG
.
74
5.3.1
ZWEISTUFIGE
LOGIKMINIMIERUNG
.
75
5.3.2
MEHRSTUFIGE
LOGIKMINIMIERUNG
.
77
5.4
ZUSAMMENFASSUNG
.
80
6
TECHNOLOGISCHE
REALISIERUNG
83
6.1
GRUNDLAGEN
.
83
6.2
TECHNOLOGIEABBILDUNG
.
86
6.2.1
REGULAERE
MODULN
.
88
6.2.2
STANDARDZELLEN
.
89
6.2.3
PROGRAMMIERBARE
BAUSTEINE
.
94
6.3
VALIDIERUNG
DER
ENTWURFSERGEBNISSE
.
99
6.4
ZUSAMMENFASSUNG
.
100
7
AUSBLICK
103
ABKUERZUNGSVERZEICHNIS
105
GLOSSAR
107
LITERATURVERZEICHNIS
109
INDEX
113
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