Handbuch des 80C517 und 80C517A:
Gespeichert in:
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Traunreut
Feger
1995
|
| Ausgabe: | 2. Aufl. |
| Schriftenreihe: | MC tools
5 |
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | 379 S. graph. Darst. |
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INHALTSVERZEICHNIS
VORWORT
.
5
1
EINLEITUNG
.
13
1.1
AN
WEN
WENDET
SICH
DIESES
BUCH?
.
14
1.2
TERMINOLOGIE
UND
FACHAUSDRUECKE
.
15
1.3
UEBERBLICK
UEBER
DEN
80C517/80C517A
.
16
2
GRUNDZUEGE
DER
ARCHITEKTUR
.
19
2.1
8051
-MIKROCONTROLLER-FAMILIE
.
20
2.2
CPU
.
23
2.3
SPEICHER-ORGANISATION
.
23
2.4
EXTERNE
BUSERWEITERUNG
.
25
2.5
INTEGRIERTE
PERIPHERIEKOMPONENTEN
.
25
2.6
INTERRUPT-SYSTEM
.
25
3
CPU
(CENTRAL
PROCESSING
UNIT)
.
27
3.1
FUNKTION
DER
CPU
.
28
3.2
CPU-TIMING
.
30
4
SPEICHERORGANISATION
.
35
4.1
PROGRAMMSPEICHER
.
36
4.2
DATENSPEICHER
.
38
4.3
ALLGEMEIN
NUTZBARE
REGISTER
.
42
4.4
SPECIAL-FUNCTION-REGISTER
.
43
5
EXTERNER
BUS
.
53
5.1
ZUGRIFFE
AUF
DEN
EXTERNEN
PROGRAMM
UND
DATENSPEICHER
.
54
5.2
SIGNALE
DES
EXTERNEN
BUSSES
.
56
5.2.1
PORT
0
UND
PORT
2
.
56
5.2.2
SIGNAL
ALE
(ADDRESS
LATCH
ENABLE)
.
57
5.2.3
SIGNAL
PSEN#
(PROGRAM
STORE
ENABLE)
.
57
5.2.4
TIMING
DER
BUSSIGNALE
.
57
5.2.5
UEBERLAPPUNG
VON
EXTERNEM
PROGRAMM
UND
DATENSPEICHER
.
60
5.3
EFFEKTIVERER
ZUGRIFF
DURCH
ACHT
DATA
POINTER
.
60
5.4
ZUSAETZLICHER
INTERNER
DATENSPEICHER
XRAM
IM
80C517A
.
62
8
INHALTSVERZEICHNIS
5.4.1
ORGANISATION
DES
XRAM
.
62
5.4.2
ZUGRIFFSMOEGLICHKEITEN
AUF
XRAM
.
62
5.4.3
KONFIGURATION
DES
XRAM
.
66
6
RESET
.
71
6.1
HARDWARE-RESET
.
72
6.1.1
FUNKTION
UND
BESCHALTUNG
.
72
6.1.2
TIMING
DES
HARDWARE-RESET
.
77
6.1.3
SCHNELLES
RESET
NACH
POWER-ON
BEIM
80C517A
.
78
6.2
RESET-AUSGANG
RO#
.
80
7
PARALLELE
EINGABE-AUSGABE-PORTS
.
8I
7.1
PORT-STRUKTUREN
.
82
7.1.1
DIGITALE
EINGABE-AUSGABE-PORTS
.
82
7.1.2
ANALOG/DIGITALE
EINGABEPORTS
.
88
7.2
PORT
0
UND
PORT
2
ALS
DATEN/ADRESSBUS
.
89
7.3
ALTERNATIVE
PORT-FUNKTIONEN
.
91
7.4
VERWENDUNG
DER
PORTS
.
93
7.4.1
ZEITVERHALTEN
.
93
7.4.2
ELEKTRISCHE
EIGENSCHAFTEN
.
94
7.4.3
READ-MODIFY-WRITE-FUNKTION
.
95
8
SERIELLE
SCHNITTSTELLEN
.
97
8.1
SERIELLE
SCHNITTSTELLE
0
.
98
8.1.1
BETRIEBSARTEN
.
98
8.1.2
MULTIPROZESSOR-KOMMUNIKATION
.
100
8.1.3
BAUDRATEN
.
102
8.2
SERIELLE
SCHNITTSTELLE
1
.
109
8.2.1
BETRIEBSARTEN
.
109
8.2.2
MULTIPROZESSOR-KOMMUNIKATION
.
112
8.2.3
BAUDRATEN
.
112
8.3
SERIELLE
BETRIEBSARTEN
IM
DETAIL
.
115
8.3.1
MODUS
0,
SYNCHRONER
BETRIEB
.
115
8.3.2
MODUS
1/B,
8-BIT-UART
.
118
8.3.3
MODUS
2,
9-BIT-UART
.
122
8.3.4
MODUS
3/A,
9-BIT-UART
.
122
INHALTSVERZEICHNIS
9
9
TIMER
0
UND
1.
127
9.1
MODUS
0
.
129
9.2
MODUS
1
.
131
9.3
MODUS
2
.
133
9.4
MODUS
3
.
134
10
ANALOG/DIGITAL-WANDLER
.
137
10.1
A/D-WANDLER
IM
80C517
.
138
10.1.1
GRUNDFUNKTION
.
140
10.1.2
REFERENZSPANNUNGEN
.
144
10.1.3
TIMING
.
148
10.2
A/D-WANDLER
IM
80C517A
.
149
10.2.1
GRUNDFUNKTION
.
152
10.2.2
REFERENZSPANNUNGEN
.
155
10.2.3
TIMING
.
156
11
COMPARE/CAPTURE-EINHEIT
.
159
11.1
EINFUEHRUNG
.
160
11.1.1
BEGRIFFSDEFINITIONEN
.
161
11.1.2
KONFIGURATIONEN
.
161
11.2
TIMER
2
UND
COMPARE-TIMER
.
165
11.2.1
TIMER
2
(T2)
.
165
11.2.2
COMPARE-TIMER
(CT)
.
170
11.3
COMPARE-FUNKTIONEN
IN
DER
CCU
.
173
11.3.1
PRINZIP
DER
COMPARE-FUNKTION
.
173
11.3.2
COMPARE-MODUS
0
(PWM-MODUS)
.
175
11.3.3
COMPARE-MODUS
1
.
189
11.3.4
CONCURRENT-COMPARE-MODUS
MIT
CC4
.
194
11.3.5
SET/RESET-MODUS
(NUR
80C517A)
.
197
11.4
CAPTURE-FUNKTIONEN
IN
DER
CCU
.
200
10
INHALTSVERZEICHNIS
12
ARITHMETIK-EINHEIT
.
203
12.1
ALLGEMEINES
.
204
12.2
PROGRAMMIERUNG
DER
ARITHMETIK-EINHEIT
.
205
12.2.1
ARBEITSWEISE
DER
MDU
.
205
12.2.2
AUSWAEHLEN
EINER
OPERATION
.
206
12.3
MULTIPLIKATION
UND
DIVISION
.
207
12.4
NORMALISIEREN
UND
SCHIEBEN
.
208
12.4.1
NORMALISIEREN
.
210
12.4.2
SCHIEBEN
.
211
12.5
UEBERLAUF-FLAG
(OVERFLOW
FLAG)
.
211
12.6
FEHLER-FLAG
(ERROR
FLAG)
.
212
13
REDUZIERUNG
DER
STROMAUFNAHME
.
213
13.1
SLOW-DOWN-MODUS
.
217
13.2
IDLE-MODUS
.
218
13.3
SOFTWARE-POWER-DOWN-MODUS
(SWPD)
.
220
13.4
HARDWARE-POWER-DOWN-MODUS
(HWPD)
.
221
14
SICHERHEITSMECHANISMEN
.
227
14.1
WATCHDOG-TIMER
(WDT)
.
228
14.1.1
STARTEN
DES
WATCHDOG-TIMERS
.
230
14.1.2
RUECKSETZEN
DES
WATCHDOG-TIMERS
.
232
14.1.3
WATCHDOG-TIMER-RESET
UND
-STATUSBIT
.
233
14.2
OSZILLATOR-WATCHDOG
(OWD)
.
234
15
OSZILLATOR
UND
TAKTVERSORGUNG
.
239
16
SYSTEMTAKT-AUSGANG
.
243
17
INTERRUPT-SYSTEM
.
247
17.1
STRUKTUR
UND
PRINZIP
DES
INTERRUPT-SYSTEMS
.
249
17.2
PRIORITAETSSTEUERUNG
.
265
17.3
BEDIENUNG
DER
INTERRUPTS
.
268
17.3.1
TIMING
DER
INTERRUPTS
.
268
17.3.2
INTERRUPT-VEKTOREN
.
269
17.4
EXTERNE
INTERRUPTS
.
270
INHALTSVERZEICHNIS
11
18
BEFEHLSSATZ
.
276
18.1
ADRESSIERUNGSARTEN
.
276
18.2
FLAGS
.
278
18.3
BITVERARBEITUNG
.
279
18.4
BEFEHLSBESCHREIBUNG
.
279
18.5
BEFEHLSCODE
.
358
STICHWORTVERZEICHNIS
.
36I |
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