PC-Hardwarebuch: Aufbau, Funktionsweise, Programmierung ; ein Handbuch nicht nur für Profis
Gespeichert in:
| 1. Verfasser: | |
|---|---|
| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Bonn [u.a.]
Addison-Wesley
1995
|
| Ausgabe: | 3., erw. Aufl. |
| Schlagworte: | |
| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | 1435 S. Ill., graph. Darst. |
| ISBN: | 3893197109 |
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HANS-PETER MESSME
R
PC-HARDWAREBUCH
AUFBAU, FUNKTIONSWEISE
, PROGRAMMIERUN
G
EIN HANDBUC
H NICH
T NU
R FUER PROFIS
3. ERWEITERT
E AUFLAGE
T
T ADDISON-WESLEY PUBLISHING COMPANY
BONN YY PARIS YY READING, MASSACHUSETTS YY MENLO PARK, CALIFORNIA YY NE
W YORK
DON MILLS, ONTARIO YY WOKINGHAM, ENGLAND YY AMSTERDAM YY MILAN YY SYDNEY
TOKYO YY SINGAPORE YY MADRID YY SAN JUAN YY SEOUL YY MEXICO CITY YY
TAIPEI, TAIWAN
INHALTSVERZEICHNIS
VORWORT 23
TEIL 1
: GRUNDLEGENDES UND ALLGEMEINES 25
1 DIE WICHTIGSTEN KOMPONENTEN EINES PC 25
1.1 DER COMPUTER UN
D SEINE PERIPHERIE 25
1.2 DAS INNENLEBEN DES PERSONAL COMPUTERS 27
1.2.1 OEFFNEN DES GEHAEUSES 27
1.2.2 DER DATENFLUSS IN EINEM PC 31
1.2.3 MOTHERBOARD 32
1.2.4 GRAPHIKADAPTER UN
D MONITOR 36
1.2.5 LAUF WERKCONTROLLER, DISKETTEN UN
D FESTPLATTEN 39
1.2.6 STREAMER UN
D ANDERE LAUFWERKE 42
1.2.7 PARALLELE SCHNITTSTELLEN UN
D DRUCKER 44
1.2.8 SERIELLE SCHNITTSTELLEN UN
D MODEMS 46
1.2.9 NETZWERKKARTEN UN
D LANS 48
1.2.10 CMOS-RAM UN
D ECHTZEITUHR 50
1.2.11 TASTATUR 52
1.2.12 MAEUSE UN
D ANDERE ZEIGEEINRICHTUNGEN 53
1.2.13 NETZTEIL 56
1.3 ANMERKUNGEN ZUR DOKUMENTATION 57
1.4 VORSICHTSMASSNAHMEN FUER DATEN UN
D BENUTZER 58
1.5 BETRIEBSSYSTEM, BIOS UN
D SPEICHERAUFTEILUNG 59
TEIL 2: PROZESSOR UND SPEICHER 67
2 INTELS MIKROPROZESSOR FUER EINSTEIGER - DER I386 67
2.1 HARDWARE FUER HARTGESOTTENE: DER FELDEFFEKTTRANSISTOR 68
2.2 GRUNDLAGEN MASCHINENNAHER INFORMATIONSDARSTELLUNG 70
2.2.1 DEZIMAL- UN
D BINAERSYSTEM 71
2.2.2 ASCII-CODE 72
2.2.3 NEGATIVE GANZZAHLEN UN
D ZWEIERKOMPLEMENT 73
2.2.4 HEXADEZIMALZAHLEN 74
2.2.5 BCD-ZAHLEN 75
2.2.6 LITTLE-ENDIAN-FORMAT UN
D INTEL-NOTATION 76
2.3 DIE CPU ALS ZENTRALER BESTANDTEIL ALLER COMPUTER 76
2.4 VORABZUSAMMENFASSUNG: PROZESSOREN, BUSBREITEN UN
D ANDERE
KENNZEICHEN VON PCS UEBER EISA BIS ZU LOCAL-BUS-SYSTEMEN 78
2.5 DER I386-MIKROPROZESSOR - EIN KURZER ABRISS 79
2.5.1 DER ALLGEMEINE AUFBAU DES I386 79
2.5.2 CPU, HAUPTSPEICHER UN
D SEGMENTIERUNG IM REAL MODE 81
6 INHALTSVERZEICHNIS
2.6 DI
E I386-VIELZWECK
- UN
D SEGMENTREGISTE
R 84
2.7 DI
E HAG
S 89
2.8 STEUER
- UN
D SPEICHERVERWALTUNGSREGISTE
R 93
2.8.1 STEUERREGISTE
R 9
3
2.8.2 DEBUG-REGISTE
R 95
2.8.3 SPEICHERVERWALTUNGSREGISTE
R 97
2.9 DE
R CPU-BU
S AL
S VERBINDUN
G ZU
R AUSSENWEL
T 97
3 LOGISCH
E SPEICHERADRESSIERUN
G UN
D LOGISCHE
R SPEICHERZUGRIF
F DE
S I386 99
3.1 CODESEGMEN
T UN
D BEFEHLSZAEHLE
R 99
3.2 STACKSEGMEN
T UN
D STACK-ZEIGE
R 101
3.3 DATENSEGMEN
T DS UN
D ADRESSIERUN
G 103
3.4 ADRESSIERUNGSARTE
N UN
D BEFEHLSCODIERUN
G 103
3.4.1 PROGRAMMIERUN
G AU
F PROZESSOREBENE
: MNEMONIC
S UN
D DE
R ASSEMBLE
R .
. 103
3.4.2 ADRESSIERUNGSARTE
N 104
3.4.3 BEFEHLSCODIERUN
G 106
3.4.4 EINLESE
N VO
N BEFEHLEN UN
D PREFETCHIN
G 108
3.5 DE
R REA
L MOD
E DE
S I386, HIGH-MEMORY-ARE
A UN
D HIMEM.SYS 109
3.6 INTERRUPT
S UN
D EXCEPTION
S 112
3.6.1 SOFTWARE-INTERRUPT
S 112
3.6.2 HARDWARE-INTERRUPT
S 115
3.6.3 EXCEPTION
S 116
3.7 DE
R PROTECTE
D MOD
E DE
S I386 118
3.7.1 SEGMENTSELEKTOREN
, SEGMENTDESKRIPTORE
N UN
D PRIVILEGIERUNGSSTUFE
N .
. 118
3.7.2 GLOBAL
E UN
D LOKAL
E DESKRIPTORTABELL
E 124
3.7.3 SEGMENTDESKRIPTOR-CACHE-REGISTE
R 128
3.7.4 UMSCHALTE
N I
N DE
N PROTECTE
D MOD
E 129
3.7.5 SPEICHERADRESSIERUN
G I
M PROTECTE
D MOD
E 129
3.7.6 SEGMENT
- UN
D ZUGRIFFSTYPE
N 131
3.7.7 STEUERUNGSUEBERGAB
E UN
D CAL
L GATE
S 135
3.7.8 DI
E INTERRUPT-DESKRIPTORTABELL
E 139
3.7.9 MULTITASKING
, TSS UN
D DA
S TAS
K GAT
E 140
3.7.10 SCHUT
Z DE
S I/O-ADRESSBEREICH
S UEBE
R DA
S IOPL-FLA
G 144
3.7.11 SCHUT
Z DE
S I/O-ADRESSBEREICH
S UEBE
R DI
E I/O-PERMISSION-BIT-MA
P 145
3.7.12 EXCEPTION
S I
M PROTECTE
D MOD
E 147
3.7.13 ZUSAMMENFASSUN
G DE
R SCHUTZMECHANISME
N I
M PROTECTE
D MOD
E 148
3.7.14 DE
R BIOS-ZUGRIFF AUF EXTENDE
D MEMOR
Y 149
3.7.15 SCHNITTSTELL
E ZU
R HARDWAR
E I
M PROTECTED-MOD
E - DA
S ABIOS 149
3.8 PAGIN
G 152
3.8.1 LOGISCHE
, LINEARE
, PHYSIKALISCH
E ADRESSE
N UN
D PAGIN
G 152
3.8.2 PAG
E DIRECTORY
, PAG
E TABLES
, PAG
E FRAME
S UN
D CR3-REGISTE
R 154
3.8.3 PAGING-EXCEPTION
S 159
3.8.4 DI
E TESTREGISTE
R TR6 UN
D TR7 ZU
M PRUEFE
N DE
S TLB 159
INHALTSVERZEICHNIS ". 7
3.9 MYTHO
S UN
D REALITAE
T - DE
R VIRTUAL-8086-MODU
S DE
S I386 162
3.9.1 VIRTUELL
E MASCHINE
N UN
D VIRTUAL-8086-MONITO
R 162
3.9.2 ADRESSE
N I
M VIRTUA
L 8086 MOD
E 163
3.9.3 EINSTIE
G I
N DE
N UN
D AUSSTIE
G AU
S DE
M VIRTUA
L 8086 MOD
E 163
3.9.4 TASK
S I
M VIRTUA
L 8086 MOD
E 164
3.9.5 PAGIN
G UN
D VIRTUA
L 8086 MOD
E 168
4 PHYSIKALISCH
E SPEICHERADRESSIERUN
G UN
D PHYSIKALISCHE
R SPEICHERZUGRIF
F DE
S I386 .
. 171
4.1 ANSCHLUESS
E UN
D SIGNAL
E DE
S I386 171
4.2 DE
R PHYSIKALISCH
E ZUGRIF
F AUF DE
N SPEICHE
R 176
4.2.1 DE
R SIGNALPFA
D ZWISCHE
N CP
U UN
D SPEICHE
R 176
4.2.2 DE
R BUSZYKLU
S FUER EINE
N LESEZUGRIF
F 178
4.2.3 DE
R BUSZYKLU
S FUER EINE
N SCHREIBZUGRIF
F 180
4.2.4 WAITSTATE
S ODE
R WARTEZYKLE
N 181
4.2.5 ADRESS-PIPELININ
G ODE
R PIPELINED-ADRESSIERUN
G 182
4.2.6 DOPPELWORTGRENZ
E 184
4.2.7 SONDERZYKLE
N 186
4.2.8 DE
R FLEXIBLE BU
S DE
S I386 - 16-BIT-DATENBU
S UN
D DUPLIZIERUN
G VO
N
SCHREIBDATE
N 187
4.3 I/O-ADRESSRAU
M UN
D PERIPHERI
E 188
4.3.1 I/O-ADRESSIERUN
G 189
4.3.2 I/O-ZYKLE
N 190
5 PROZESSOR-RESE
T UN
D I386-INTERNER SELBSTTES
T 193
6 GRUNDSAETZLICHES
: LOGIKGATTE
R UN
D MIKROPROGRAMMIERUN
G - ZWE
I GRUNDLEGEND
E
ELEMENT
E EINE
S PROZESSOR
S 195
6.1 UND
- UN
D ODER-GATTE
R AL
S GRUNDLEGEND
E LOGIKELEMENT
E 195
6.2 CMOS-INVERTE
R AL
S LOW-POWER-ELEMENT
E 196
6.3 EIN BEISPIEL
: 1-BIT-ADDIERE
R 199
6.4 DI
E MIKROKODIERUN
G VO
N MASCHINENBEFEHLE
N 200
7 EIN HALBLEITERRECHENGENI
E - DER MATHEMATISCH
E COPROZESSO
R I387 207
7.1 ZAHLENEXKUR
S - DI
E DARSTELLUN
G VO
N GLEITKOMMAZAHLE
N 207
7.1.1 WISSENSCHAFTLICH
E NOTATIO
N UN
D N-UBERSCHUSSDARSTELLUN
G 207
7.1.2 DE
R STANDAR
D - IEEE-FORMAT
E 209
7.1.3 BASIC-PROGRAMMIERE
R AUFGEPASS
T - DA
S MSBIN-FORMA
T 212
7.2 FUNKTIONSERWEITERUN
G UN
D LEISTUNGSZUWACH
S 214
7.3 I387-ZAHLENFORMAT
E UN
D GLEITKOMMABEFEHL
E 215
7.4 ANSCHLUESS
E UN
D SIGNAL
E DE
S I387 217
7.5 AUFBA
U UN
D FUNKTIONSWEIS
E DE
S I387 221
7.6 DI
E EXCEPTION
S DE
S I387 226
7.7 PROTECTE
D MOD
E UN
D DI
E SPEICHERABBILDE
R DE
R BEFEHLS- UN
D DATENZEIGE
R 228
8
INHALTSVERZEICHNIS
7.8 I387-SPEICHERZYKLEN UN
D DIE KOMMUNIKATION ZWISCHEN I386 UN
D I387 229
7.9 SYSTEMKONFIGURATION I386/I387 231
7.10 I387-RESET 232
8 I386-PROZESSORDERIVATE UND CLONES 233
8.1 ABMAGERUNGSKUR - DIE SX-VARIANTEN DER PROZESSOREN 233
8.2 DER 386SL-CHIPSATZ - EIN ZWEI-CHIP-AT 235
8.2.1 INTERNER AUFBAU VON 386SL UN
D 82360SL 236
8.2.2 ANSCHLUESSE UN
D SIGNALE 237
8.3 PROZESSOR-WIRRWAR DURCH 386-CLONES 245
8.3.1 AMD-PROZESSOREN 246
8.3.2 PROZESSOREN VON CHIPS & TECHNOLOGIES 248
8.3.3 CYRIX-CPUS 251
8.3.4 IBM - NU
R ZUM HAUSGEBRAUCH 252
9 CACHEING - ZUSAMMENARBEIT MIT HOCHGESCHWINDIGKEITSSPEICHERN 253
9.1 CACHE-PRINZIP UN
D CACHE-STRATEGIEN 253
9.2 CACHE-ORGANISATION UN
D ASSOZIATIVSPEICHER 256
9.3 CACHE-TREFFER-BESTIMMUNG 259
9.4 ERSETZUNGSSTRATEGIEN 261
9.5 ON-CHIP- UN
D SECOND-LEVEL-CACHES 263
9.6 CACHE-KOHAERENZ UN
D DA
S MESI-PROTOKOLL - EIN ERSTER SCHRITT IN
RICHTUNG MULTIPROCESSING 264
9.6.1 DIE VIER MESI-ZUSTAENDE 264
9.6.2 MESI-ZUSTANDSUEBERGAENGE 266
9.6.3 L2-CACHE-SUBSYSTEME UN
D MESI-CACHE-KOHAERENZPROTOKOLL 268
10 LEISTUNGSERWEITERUNG NACH OBEN - DER I486 271
10.1 ANSCHLUESSE UN
D SIGNALE DES I486 271
10.2 DER INTERNE AUFBAU DES I486 278
10.3 A STAR IS BORN - RISC-PRINZIPIEN AUF HARDWARE
- UN
D SOFTWARE-EBENE 280
10.3.1 UEBERRASCHENDE ERGEBNISSE - WENIGER IST MEHR 280
10.3.2 RISC-KENNZEICHEN AUF HARDWARE-EBENE 281
10.3.3 RISC-KENNZEICHEN AUF SOFTWARE-EBENE 288
10.4 DIEI486-PIPELINE 290
10.5 DER I486-ON-CHIP-CACHE 292
10.6 UNTERSCHIEDE UN
D GEMEINSAMKEITEN VON I486 UN
D I386/I387 295
10.6.1 UNTERSCHIEDE IN DE
N REGISTERSTRUKTUREN 295
10.6.2 UNTERSCHIEDE IN DER SPEICHERVERWALTUNG 297
10.6.3 I486-RESET 297
10.6.4 DER I486-REAL-MODE 298
10.6.5 DER I486-PROTECTED-MODE 299
10.6.6 DER I486-VIRTUAL-8086-MODE 299
INHALTSVERZEICHNIS 9
10.6.7 INTEGER-COR
E UN
D GLEITKOMMAEINHEI
T 299
10.6.8 FPU-EXCEPTION
S 300
10.6.9 DE
R TRANSLATIO
N LOOKASID
E BUFFER (TLB) 300
10.7 DE
R I486-BUS 300
10.7.1 BURST-ZYKLE
N 300
10.7.2 SONDERZYKLE
N 302
10.7.3 INVALIDIERUNGSZYKLE
N 303
10.8 TESTFUNKTIONE
N 304
10.8.1 DE
R INTERN
E SELBSTTES
T BIST 304
10.8.2 PRUEFUN
G DE
S TLB 304
10.8.3 PRUEFUN
G DE
S ON-CHIP-CACH
E 306
10.8.4 TRISTATE-TESTMODU
S 308
10.8.5 DE
R JTAG-BOUNDARY-SCAN-TES
T 308
10.9 DE
R I/O-ADRESSRAU
M DE
S I486 312
11 I486-ABMAGERUNGEN
, OVERDRIVES
, UPGRADE
S UN
D CLONE
S 313
11.1 I486SX UN
D I487SX - ERS
T ABSPECKEN
, DAN
N UPGRADE
N 313
11.1.1 DE
R I486SX - TROTZDE
M MEH
R AL
S EI
N I386 313
11.1.2 EI
N WOR
T Z
U DE
N TAKTFREQUENZE
N 316
11.1.3 I486SX-UPGRAD
E - DE
R I487SX 317
11.2 DI
E I486DX2-PROZESSORE
N MI
T INTERNE
R TAKTVERDOPPLUN
G 320
11.3 DA
S KREU
Z MI
T DE
N TAKTFREQUENZE
N 320
11.4 DI
E LOESUN
G - INTERN
E TAKTVERDOPPLUN
G 320
11.4.1 GRETCHENFRAGE
: WA
S BRING
T DI
E INTERN
E TAKTVERDOPPLUNG
? 321
11.4.2 EIN
E BEMERKUN
G Z
U TAKTANGABE
N 323
11.4.3 UPGRADIN
G UN
D OVERDRIVE
S 323
11.5 DI
E LOW-POWER-VERSIONE
N DE
S I486DX UN
D I486SX 326
11.6 DE
R I486DX4 328
11.6.1 ANSCHLUSSSCHEM
A 328
11.6.2 NEU
E FLAGS
, STEUERREGISTE
R UN
D ERWEITERUNGE
N DE
S VIRTUAL-8086-MODU
S .
. 330
11.6.3 I486DX4-IDENTIFIZIERUN
G MI
T CPUI
D 332
11.6.4 STROMSPARMOEGLICHKEITE
N 333
11.6.5 DE
R JTAG-BOUNDARY-SCAN-TES
T DE
S I486DX4 334
11.7 DE
R SL ENHANCE
D I486 335
11.7.1 SL ENHANCE
D I486DX MI
T LX-TAK
T 335
11.7.2 SL ENHANCE
D I486DX2 MI
T L/2X-TAK
T 336
11.7.3 SL ENHANCE
D I486SX MI
T LX-TAK
T 336
11.7.4 SL ENHANCE
D I486DX MI
T 2X-TAK
T 336
11.7.5 SL ENHANCE
D I486SX MI
T 2X-TAK
T 337
11.7.6 I486SL-IDENRIFIZIERUN
G MI
T CPUI
D 337
11.8 I486-CLONE
S 338
11.8.1 AMD-CLONE
S 338
11.8.2 CYRIX-CLONE
S 341
11.8.3 IBMS GEISTESBLIT
Z 342
10 INHALTSVERZEICHNIS
12 GEGENWAERTIG ENDE DER FAHNENSTANGE - DER 110-MIPS-RISC-SUPERSKALAR
PENTIUM .
. 343
12.1 ANSCHLUESSE UN
D SIGNALE 344
12.2 INTERNER AUFBAU DE
S PENTIUM 357
12.2.1 DIE INTEGER PIPELINES U UN
D V 358
12.2.2 BEFEHLSPAARUNG IN DEN INTEGER-PIPELINES 362
12.2.3 DIE GLEITKOMMA-PIPELINE 365
12.2.4 BEFEHLSSERIALISIERUNG 367
12.2.5 DYNAMISCHE VERZWEIGUNGSVORHERSAGE 368
12.2.6 DIE PENTIUM-ON-CHIP-CACHES 370
12.3 PENTIUM-KOMPATIBILITAET UN
D NEUE PENTIUM-FUNKTIONEN 374
12.3.1 ERWEITERUNGEN DER PENTIUM-REGISTER 375
12.3.2 MODELLSPEZIFISCHE REGISTER 376
12.3.3 DER PENTIUM-REAL MODE 377
12.3.4 DER PENTIUM-PROTECTED MODE 378
12.3.5 DER PENTIUM-VIRTUAL 8086 MODE 378
12.3.6 PENTIUM UN
D PAGING 380
12.3.7 DEBUG-ERWEITERUNGEN 381
12.3.8 PENTIUM-RESET, PENTIUM-INIT UN
D SELBSTTEST 382
12.3.9 CPU-IDENTIFIZIERUNG MIT CPUID 384
12.4 DER PENTIUM-BUS 385
12.4.1 EINZELTRANSFERZYKLEN 386
12.4.2 BURST-ZYKLEN 386
12.4.3 PENTIUM-ADRESS-PIPELINING 389
12.4.4 SONDERZYKLEN 390
12.4.5 ABFRAGEZYKLEN UN
D INTERNES SNOOPING 391
12.4.6 INTERNE PENTIUM-BUSPUFFER 392
12.5 DER SYSTEM-MANAGEMENT-MODUS DES PENTIUM 392
12.5.1 DER SYSTEM MANAGEMENT MODE INTERRUPT SMI 393
12.5.2 DIE SMM-RAM-STRUKTUR 393
12.5.3 PROGRAMMAUSFUEHRUNG IM SYSTEM MANAGEMENT MODE 395
12.5.4 RUECKKEHR AUS DEM SYSTEM MANAGEMENT MODE 396
12.6 CODEOPTIMIERUNG MIT DEM PERFORMANCE MONITORING 396
12.6.1 HARDWARE-ELEMENTE FUER DAS PERFORMANCE MONITORING 396
12.6.2 ZUGRIFFE UEBER DE
N TEST ACCESS PORT 397
12.7 PENTIUM-TESTFUNKTIONEN 397
12.7.1 DER PENTIUM JTAG BOUNDARY SCAN TEST 397
12.7.2 ERFASSUNG INTERNER FEHLER 398
12.7.3 ERFASSUNG VON BUSFEHLERN 399
12.7.4 PROGRAMMAUSFUEHRUNGSVERFOLGUNG ODER EXECUTION TRACING 400
12.7.5 HARDWARE-DEBUG-UNTERSTUETZUNG UN
D PROBE MODE 401
12.7.6 DIE MACHINE CHECK-EXCEPTION 401
12.8 DER PENTIUM-I/O-ADRESSRAUM 401
12.9 DAS L2-CACHE-SUBSYSTEME 82496/82491 FUER DEN PENTIUM 402
INHALTSVERZEICHNIS 11
13 KOMPATIBILITAE
T NAC
H UNTE
N - DER 80286 405
13.1 ANSCHLUESS
E UN
D SIGNAL
E DE
S 80286 405
13.2 DI
E 80286-REGISTER 408
13.3 DE
R 80286-PROTECTE
D MOD
E 409
13.3.1 DI
E 80286-SPEICHERVERWALTUNGSREGISTE
R 409
13.3.2 80286-SEGMENTDESKRIPTORE
N 410
13.3.3 80286-SEGMENT
- UN
D ZUGRIFFSTYPE
N 411
13.3.4 MULTITASKING
, 80286 TSS UN
D DA
S 80286-TASK-GAT
E 412
13.3.5 80286-SCHUTZ FUER DE
N I/O-ADRESSRAU
M 413
13.4 80286-BUSZYKLE
N UN
D -PIPELININ
G 413
13.5 WORTGRENZE
N 415
13.6 80286-RESET 415
14 DE
R 80287 - MATHEMATISCHE
R HELFE
R I
M PROTECTED MOD
E 417
14.1 ANSCHLUESS
E UN
D SIGNAL
E DE
S 80287 418
14.2 AUFBA
U UN
D FUNKTIONSWEIS
E DE
S 80287 421
14.3 80287-RESET 422
14.4 DI
E EXCEPTION
S DE
S 80287 422
14.5 KOMMUNIKATIO
N ZWISCHE
N CP
U UN
D 80287 423
14.6 SYSTEMKONFIGURATIO
N 80286/8028
7 423
15 ALLE
S BEGAN
N MI
T DE
M URVATER 8086 425
15.1 ANSCHLUESS
E UN
D SIGNAL
E DE
S 8086 425
15.2 8086-BETRIEBSMOD
I UN
D DE
R BUSCONTROLLE
R 8288 430
15.3 DE
R 8086-REAL MOD
E 431
15.4 ZUGRIF
F AU
F DE
N SPEICHE
R 431
15.5 WORTGRENZE
N 434
15.6 ZUGRIF
F AUF DE
N I/O-ADRESSRAU
M 434
15.7 8086-RESET 435
15.8 DE
R 8088 436
15.9 DE
R 80186/8
8 437
16 MATHEMATISCHE
R OP
A - DER MATHC
O 8087 439
16.1 8087-ZAHLENFORMAT
E UN
D NUMERISCHE
R BEFEHLSSAT
Z 439
16.2 ANSCHLUESS
E UN
D SIGNAL
E DE
S 8087 439
16.3 AUFBA
U UN
D FUNKTIONSWEIS
E DE
S 8087 442
16.4 SPEICHERZYKLE
N DE
S 8087 443
16.5 SYSTEMKONFIGURATIO
N 8086/808
7 445
17 SPEICHERCHIP
S - DA
S GEDAECHTNI
S DER COMPUTE
R 447
17.1 KLEI
N UN
D BILLI
G - DRA
M 447
17.1.1 AUFBA
U UN
D FUNKTIONSWEIS
E 449
17.1.2 LESE
N UN
D SCHREIBE
N VO
N DATE
N 451
12
INHALTSVERZEICHNIS
17.1.3 SCHICHTENSTRUKTUREN 456
17.1.4 AUFFRISCHUNG DES DRAM 458
17.1.5 VERSCHIEDENE ORGANISATIONSFORMEN DER DRAM-CHIPS 460
17.1.6 SCHNELLE BETRIEBSMODI DER DRAM-CHIPS 461
17.1.7 SIMM UN
D SIP 467
17.2 EIN DIDAKTISCHES BEISPIEL FUER INTELLIGENTE SPEICHERSTEUERUNGEN
- DER PAGE/INTERLEAVE-MEMORY-CONTROLLER 82C212 469
17.2.1 ANSCHLUESSE UN
D SIGNALE 470
17.2.2 DER INTERNE AUFBAU DES 82C212 476
17.2.3 SHADOW-RAM UN
D BIOS 480
17.2.4 EXPANDED MEMORY UN
D MEMORY-MAPPING 483
17.2.5 DIE KONFIGURATIONSREGISTER DES 82C212 486
17.3 SCHNELL UN
D TEUER-SRA
M 492
17.3.1 DAS FLIP-FLOP 493
17.3.2 DER ZUGRIFF AUF SRAM-SPEICHERZELLEN 496
17.3.3 EIN TYPISCHER SRAM - DER 51258 VON INTEL 496
17.4 ROM, EPROM UN
D ANDERE PROMS 498
17.4.1 ROM 498
17.4.2 EPROM 499
17.4.3 EEPROM 501
17.5 SIHZIUMFESTPLATTEN - DIE FLASH-SPEICHER 503
TEIL 3: PERSONAL-COMPUTER-ARCHITEKTUREN UND -BUSSYSTEME 50
9
18 DIE 8-BIT-ARCHITEKTUR DES PC/XT 509
18.1 DIE KOMPONENTEN UN
D IHR ZUSAMMENWIRKEN 510
18.2 DMA-ARCHITEKTUR 515
18.2.1 8-BIT-KANAELE 516
18.2.2 SPEICHERAUFFRISCHUNG 517
18.2.3 SPEICHER-SPEICHER-TRANSFER 518
18.3 I/O-KANAL UN
D BUSSLOTS 518
19 DIE 16-BIT-ARCHITEKTUR DES AT 523
19.1 DIE KOMPONENTEN UN
D IHR ZUSAMMENWIRKEN 523
19.2 DMA-ARCHITEKTUR 530
19.2.1 8- UN
D 16-BIT-KANAELE 530
19.2.2 SPEICHERAUFFRISCHUNG 532
19.2.3 SPEICHER-SPEICHER-TANSFERS 532
19.3 I/O-KANAL UN
D BUSSLOTS 533
19.4 AT-BUSFREQUENZEN UN
D ISA-BUS 537
20 32-BIT-EISA-ARCHITEKTUR - DI
E EVOLUTION 539
INHALTSVERZEICHNIS
13
21 EISA-BUSSTRUKTUR 541
21.1 BUSARBITRIERUNG 544
21.2 DMA-ARCHITEKTUR 545
21.3 INTERRUPT-SUBSYSTEM 547
21.4 EISA-TIMER UN
D FAIL-SAFE-TIMER 548
21.5 I/O-ADRESSRAU
M 548
21.6 CMOS-RAM 549
21.7 EISA-ADAPTER UN
D AUTOMATISCHE KONFIGURIERUNG 553
21.8 EISA-SLOTS 554
21.9 EISA-SIGNALE 556
21.9.1 32-BIT-MIKROKANAL - DIE REVOLUTION 559
21.10 MCA-BUSSRRUKRUR 560
21.11 BUSARBITRIERUNG 562
21.12 SPEICHERSYSTEM 564
21.13 DMA 565
21.14 INTERRUPTS 565
21.15 MCA-TIMER UN
D FAIL-SAFE-TIMER 565
21.16 I/O-PORT
S UN
D I/O-ADRESSRAU
M 566
21.17 MCA-ADAPTER UN
D AUTOMATISCHE KONFIGURIERUNG 567
21.18 ON-BOARD-VGA UN
D EXTERNE GRAPHIKADAPTER 570
21.19 PS/2-MODELL 30 571
21.20 MCA-SLOTS 571
21.21 MCA-SIGNALE 573
22 HOCHGESCHWINDIGKEITSSTRECKE IM PC - DER LOCAL-BUS 579
22.1 PERIPHERAL COMPONENT INTERCONNECT (PCI) 580
22.1.1 PCI-BUSSTRUKTUR 580
22.1.2 BUSZYKLEN 583
22.1.3 BUSARBITRIERUNG 587
22.1.4 DMA 589
22.1.5 INTERRUPTS 589
22.1.6 I/O-ADRESSRAU
M 590
22.1.7 KONFIGURATIONSADRESSRAUM 592
22.1.8 PCI-SPEZIFISCHE BIOS-ROUTINEN 597
22.1.9 PCI-SLOTS 599
22.1.10PCI-ADAPTER 602
22.1.11 PCI-SIGNALE 602
22.2 VESA LOCAL BUS (VLB) 607
22.2.1 VLB-BUSSTRUKTUR 608
22.2.2 BUSZYKLEN 610
22.2.3 BUSARBITRIERUNG 614
22.2.4 DMA 614
22.2.5 INTERRUPTS 615
14 INHALTSVERZEICHNIS
22.2.6 I/O-ADRESSRAU
M 615
22.2.7 VLB-SLOTS 616
22.2.8 VLB-ADAPTER 616
22.2.9 VLB-SIGNALE 616
22.3 TYPISCHE LOCAL-BUS-EINHEITEN 622
22.4 BREMSKLOETZE IM LOCAL-BUS-SYSTEM 622
TEIL 4: SUPPORT-CHIPS: OHNE UNS GEHT NICHTS 625
23 HARDWARE-INTERRUPTS UND DER PROGRAMMIERBARE INTERRUPT-CONTROLLER
(PIC) 8259A .
. 625
23.1 INTERRUPT-GETRIEBENER DATENAUSTAUSCH UN
D POLLING 625
23.2 ANSCHLUESSE UN
D SIGNALE DES 8259A 627
23.3 INNERER AUFBAU UN
D INTERRUPT-ACKNOWLEDGE-SEQUENZ 629
23.4 KASKADIERUNG 632
23.5 INITIALISIERUNG UN
D PROGRAMMIERUNG 634
23.6 MASKIERUNG DES NMI 643
23.7 EIN WORT ZU LEISTUNGSFAEHIGEN MULTIPROZESSOR INTERRUPT-SUBSYSTEMEN
645
23.7.1 AUFBAU UN
D FUNKTIONSWEISE DES APIC 82489DX 645
23.7.2 MULTI-APIC-SYSTEME UN
D DER ICC-BUS 647
24 DER PROGRAMMIERBARE INTERVALL-TIMER (PIT) 8253/8254 649
24.1 AUFBAU UN
D FUNKTIONSWEISE DER PITS 8253/8254 649
24.2 ANSCHLUESSE UN
D SIGNALE DES 8253/8254 651
24.3 PROGRAMMIERUNG DES 8253/8254 653
24.4 SCHREIBEN VON ZAEHLERWERTEN 653
24.5 LESEN VON ZAEHLERWERTEN 655
24.6 ZAEHLMODI DES 8253/8254 659
24.7 SYSTEMUHR 663
24.8 SPEICHER-REFRESH 665
24.9 LAUTSPRECHER 667
24.10 FAIL-SAFE-TIMER 667
25 UMGEHUNGSSTRASSE IM PC - DER DMA-CHIP 8237A 669
25.1 DIREKTER SPEICHERZUGRIFF MIT PERIPHERIE UN
D SPEICHER 669
25.2 DER STANDARD-DMA-CHIP 8237A 670
25.2.1 ANSCHLUESSE UN
D SIGNALE DES 8237A 670
25.2.2 INTERNER AUFBAU UN
D DIE BETRIEBSMODI DES 8237A 674
25.2.3 PROGRAMMIERUNG DES 8237A 684
25.2.4 BEISPIEL: INITIALISIERUNG VON DMA 1, KANAL 2 ZUR
DISKETTENUEBERTRAGUNG .
. 691
25.2.5 DMA-ZYKLEN IM PROTECTED UN
D VIRTUAL-8086-MODE 693
INHALTSVERZEICHNIS
15
26 ANDERE PERIPHERIECHIPS UND -KOMPONENTEN 695
26.1 VON TOENEN UN
D GERAEUSCHEN - DER LAUTSPRECHER 695
26.1.1 DIREKTE ANSTEUERUNG UEBER DEN PIT 8253/8254 697
26.1.2 PERIODISCHE AKTIVIERUNG MIT DER CPU 699
26.2 DAS PROGRAMMIERBARE PERIPHERIE-INTERFACE (PPI) 8255 701
26.2.1 ANSCHLUESSE UN
D SIGNALE DES PPI 8255 701
26.2.2 AUFBAU UN
D BETRIEBSMODI DES PPI 8255 703
26.2.3 PROGRAMMIERUNG DES PPI 8255 706
26.2.4 DIE PORT-BELEGUNGEN IM PC/XT 707
26.3 CMOS-RAM UN
D ECHTZEITUHR 710
26.3.1 AUFBAU UN
D PROGRAMMIERUNG DES MC146818 711
26.3.2 DER ZUGRIFF UEBER DAS BIOS 721
26.3.3 DER ZUGRIFF UEBER ADRESS- UN
D DATENREGISTER 722
26.3.4 DER ERWEITERTE CMOS-RAM 723
TEIL 5: MASSENSPEICHER 725
27 DISKETTEN UND DISKETTENLAUFWERKE 725
27.1 GRUNDLAGE MAGNETISCHER DATENAUFZEICHNUNG - FERROMAGNETISMUS
UN
D INDUKTION 725
27.1.1 DIAMAGNETISMUS UN
D PARAMAGNETISMUS 725
27.1.2 FERROMAGNETISMUS 726
27.1.3 INDUKTION 729
27.2 AUFBAU UN
D FUNKTIONSWEISE VON DISKETTEN UN
D DISKETTENLAUFWERKEN 729
27.3 DIE PHYSIKALISCHE ORGANISATION VON DISKETTEN 735
27.4 DIE LOGISCHE ORGANISATION VON DISKETTEN UN
D FESTPLATTEN UNTER DOS 738
27.4.1 LOGISCHE SEKTOREN 739
27.4.2 DIE PARTITION 739
27.4.3 DER BOOTSEKTOR 743
27.4.4 DAS STAMMVERZEICHNIS 745
27.4.5 DIE UNTERVERZEICHNISSE 750
27.4.6 DIE DATEIZUORDNUNGSTABELLE ODER FAT 751
27.4.7 DIE DATEIEN 756
27.4.8 UNTERSCHIEDE ZWISCHEN DE
N DOS-VERSIONEN 757
27.4.9 ANDERE DATEISYSTEME 759
27.5 SYSTEMKONFIGURATION PC-CONTROLLER-DISKETTENLAUFWERK 760
27.5.1 CONTROLLER UN
D LAUFWERKE 760
27.5.2 LAUFWERKKONFIGURIERUNG 763
27.6 AUFZEICHNUNGSFORMATE UN
D CRC 766
27.6.1 SEKTORLAYOUT 766
27.6.2 FM UN
D MFM 769
27.6.3 CRC - MIR ENTGEHT NICHTS 772
27.6.4 FUER INTERESSIERTE - SCHEINBAR VERBLUEFFENDE EIGENSCHAFTEN DER
CRC-CODES
UN
D WAS DAHINTERSTECKT 778
INHALTSVERZEICHNIS
27.7 PROGRAMMIERUNG VO
N DISKETTENLAUFWERKEN - DIE VERSCHIEDENEN ZUGRIFFSEBENEN
UN
D FRAGEN DER KOMPATIBILITAET 781
27.7.1 ANWENDUNGSPROGRAMME 781
27.7.2 HOCHSPRACHEN UN
D BETRIEBSSYSTEM 781
27.7.3 BIOS UN
D REGISTER 784
27.8 PROGRAMMIERUNG VON DISKETTENLAUFWERKEN - ZUGRIFF UEBER DOS 785
27.9 PROGRAMMIERUNG VON DISKETTENLAUFWERKEN - ZUGRIFF UEBER DE
N
BIOS-INTERRUPT INT 13H 788
27.10 PROGRAMMIERUNG VON DISKETTENLAUFWERKEN - DIREKTER ZUGRIFF UEBER
REGISTER .
. 793
27.10.1 AUFBAU UN
D FUNKTIONSWEISE EINES DISKETTENCONTROLLERS 793
27.10.2 KONFIGURATION EINES DISKETTENCONTROLLERS IM PC 795
27.10.3 DIE REGISTER DES DISKETTENCONTROLLERS 796
27.10.4 BEFEHLE UN
D BEFEHLSPHASEN DES DISKETTENCONTROLLERS 799
27.10.5 LAUFWERKDATEN FESTLEGEN 808
27.10.6 FEHLERBEHEBUNGSSTRATEGIE 810
FESTPLATTEN 811
28.1 AUFBAU UN
D FUNKTIONSWEISE VO
N FESTPLATTEN 812
28.1.1 HEAD-DISC-ASSEMBLY (HDA) 812
28.1.2 INTERLEAVING ODER SEKTORVERSATZ 824
28.1.3 CONTROLLER UN
D SCHNITTSTELLEN 826
28.1.4 EIN PAAR ANMERKUNGEN ZU KAPAZITAET, ZUGRIFFSZEIT,
DATENUEBERTRAGUNGSRATE UN
D ZUVERLAESSIGKEIT 829
28.1.5 BIOS-KONFIGURIERUNG 836
28.2 AUFZEICHNUNGSFORMATE, LOW-LEVEL-FORMATIERUNG UN
D BAD-SECTOR-MAPPING .
. 837
28.2.1 MFM UN
D RLL 837
28.2.2 HIGH-LEVEL-FORMATIERUNG VON FESTPLATTEN MIT FORMAT 839
28.2.3 LOW-LEVEL-FORMATIERUNG UN
D BAD-SECTOR-MAPPING 840
28.2.4 FEHLERBEHEBUNGSSTRATEGIEN 845
28.2.5 AUTOKONFIGURIERUNG 848
28.3 EINBINDUNG VON EXOTISCHEN LAUFWERKEN UN
D TRANSLATING 849
28.3.1 BIOS-INTERRUPT 13H, FUNKTION 09H - FREMDLAUFWERK ANPASSEN 849
28.3.2 BIOS-ERWEITERUNGEN UN
D BOOTEN 851
28.3.3 TRANSLATION UN
D ZONENAUFZEICHNUNG 855
28.4 DER ZUGRIFF UEBER DOS UN
D BIOS 857
28.4.1 DIE DOS-INTERRUPTS 25H UN
D 26H 857
28.4.2 DIE FESTPLATTENFUNKTIONEN DES BIOS-INTERRUPTS 13H 859
28.5 ST412/506 UN
D ESDI 864
28.5.1 ST412/506-SCHNITTSTELLEN UN
D DIE VERBINDUNG
ZWISCHEN LAUFWERK UN
D CONTROLLER 864
28.5.2 ANSCHLUSS UN
D KONFIGURATION VON ST412/506-FESTPLATTEN 866
28.5.3 DIE ESDI-SCHNITTSTELLE 867
28.5.4 ESDI-BEFEHLE UN
D KONFIGURATIONSDATEN 871
28.5.5 ANSCHLUSS UN
D KONFIGURATION VON ESDI-FESTPLATTEN 873
INHALTSVERZEICHNIS
17
28.6 LAUFWERKE MIT IDE, AT-BUS ODER ATA-SCHNITTSTELLE 874
28.6.1 DIE PHYSIKALISCHE SCHNITTSTELLE CPU-LAUFWERK 875
28.6.2 BESONDERHEITEN DER IDE-FESTPLATTEN 878
28.6.3 DAS AT-TASK-FILE 879
28.6.4 PROGRAMMIERUNG UN
D BEFEHLSPHASEN DER IDE-SCHNITTSTELLE 885
28.6.5 ENHANCED-IDE 888
28.7 SCSI 890
28.7.1 SCSI-BUS UN
D DIE ANBINDUN
G A
N DE
N PC 890
28.7.2 MEMORY-MAPPED-I/O UN
D SCSI-TASK-FILE DER
HOST-ADAPTER ST01 UN
D ST02 901
28.7.3 PROGRAMMIERUNG UN
D BEFEHLSPHAESEN 906
28.7.4 ASPI , 911
28.7.5 ANDERE STANDARDISIERTE SCSI-PROGRAMMIERSCHNITTSTELLEN 914
28.7.6 VERSCHIEDENE SCSI-STANDARDS 916
28.8 OPTISCHE MASSENSPEICHER 918
28.8.1 CD-ROM 919
28.8.2 WORM 921
28.8.3 MAGNETOOPTISCHE LAUFWERKE 922
TEIL 6: EXTERNES UND PERIPHERES 925
29 SCHNITTSTELLEN - VERBINDUNG ZUR AUSSENWELT 925
29.1 DIE PARALLELE SCHNITTSTELLE 925
29.1.1 HAUPTAUFGABE: DRUCKEN 925
29.1.2 DRUCKEN UEBER DOS 927
29.1.3 DRUCKEN UEBE
R DE
N BIOS-INTERRUPT INT 17H 928
29.1.4 AUFBAU, FUNKTIONSWEISE UN
D DIE VERBINDUNG MIT DRUCKERN 930
29.1.5 DIREKTE PROGRAMMIERUNG DER REGISTER 933
29.1.6 WAS LPTX SONST NOCH ALLES KANN - ALLGEMEINE BELEGUNG 937
29.2 DIE SERIELLE SCHNITTSTELLE 940
29.2.1 SERIELLE UN
D ASYNCHRONE DATENUEBERTRAGUNG 940
29.2.2 DIE RS-232C-SCHNITTSTELLE 944
29.2.3 VERBINDUNG MIT DRUCKERN UN
D NULLMODEM 951
29.2.4 ZUGRIFF UEBER DOS 954
29.2.5 ZUGRIFF UEBE
R DA
S BIOS 955
29.2.6 DER UART 8250/16450/16550 959
29.3 ANDERE SCHNITTSTELLEN 978
29.3.1 DER IBM-ADAPTER FUER COMPUTERSPIELE 978
29.3.2 NETZWERKADAPTER 982
29.3.3 DATEX, DATEX P UN
D PAD-KARTEN 982
29.3.4 FAXKARTEN 984
29.4 KLEIN UN
D UNIVERSELL - PCMCIA 985
29.4.1 AUFBAU UN
D FUNKTIONSWEISE 985
18
INHALTSVERZEICHNIS
29.4.2 ANSCHLUSSBELEGUNG 987
29.4.3 ZUGRIFF UEBE
R DIE SOCKET-SERVICES DES INT IAH
, FUNKTIONEN 80H-FFH 991
29.4.4 ZUGRIFFE UEBER PCMCIA-CONTROLLER-REGISTER - EIN BEISPIEL 993
30 LOKALE NETZWERKE UND NETZWERKADAPTER 999
30.1 NETZTOPOLOGIEN 999
30.1.1 BUSTOPOLOGIE 999
30.1.2 RINGTOPOLOGIE 1001
30.1.3 STERNTOPOLOGIE 1001
30.2 ZUGRIFFSVERFAHREN 1002
30.2.1 CSMA/CD 1002
30.2.2 TOKEN-PASSING 1003
30.2.3 TOKEN-BUS 1003
30.3 ETHERNET 1004
30.3.1 THICK ETHERNET 1004
30.3.2 CHEAPERNET ODER THIN ETHERNET 1005
30.4 TOKEN RING 1005
30.5 FDDI 1007
31 TASTATUREN UND MAEUSE 1009
31.1 OHNE MICH IST DER PC BLIND UN
D TAUB - DIE TASTATUR 1009
31.1.1 AUFBAU UN
D FUNKTIONSWEISE INTELLIGENTER UN
D WENIGER
INTELLIGENTER TASTATUREN 1010
31.1.2 SCANCODES - DIE LANDKARTE IHRER TASTATUR 1012
31.1.3 TASTATURZUGRIFF UEBER DOS 1015
31.1.4 TASTATURZUGRIFF UEBER DAS BIOS 1016
31.1.5 DIREKTE TASTATURPROGRARNMIERUNG UEBER PORTS 1022
31.2 VON MAEUSEN UN
D RATTEN 1034
31.2.1 AUFBAU UN
D FUNKTION 1035
31.2.2 MAUSTREIBER UN
D MAUSSCHNITTSTELLE 1035
31.2.3 PROGRAMMIERUNG 1037
31.2.4 DIE PS/2-MAUS 1041
31.3 TRACKBALL 1045
31.4 DIGITALISIERTABLETT 1045
32 GRAPHIKADAPTER 1047
32.1 DARSTELLUNG VON BILDERN AUF EINEM MONITOR UN
D ALLGEMEINER
AUFBAU VON GRAPHIKADAPTERN 1047
32.2 BILDSCHIRMDARSTELLUNGEN UN
D DE
R GRAPHIKSTEUERCHIP 6845 1051
32.2.1 DER VIDEOCONTROLLER 6845 1051
32.2.2 ZEICHENERZEUGUNG IM TEXTMODUS 1054
32.2.3 ZEICHENERZEUGUNG UN
D FREIE GRAPHIKEN IM GRAPHIKMODUS 1056
32.2.4 ALLGEMEINES ZU ORGANISATION UN
D AUFBAU DES VIDEO-RAM 1057
32.2.5 HERCULESKARTE UN
D PROGRAMMIERUNG DES 6845 1061
INHALTSVERZEICHNIS
19
32.3 DI
E WICHTIGSTE
N ADAPTERTYPE
N UN
D IHR
E BESONDERHEITE
N 1070
32.3.1 MD
A - ALLE
S GRA
U I
N GRA
U 1071
32.3.2 CG
A - E
S WERD
E BUN
T 1072
32.3.3 HERCULE
S - DE
R UNPASSEND
E STANDAR
D 1073
32.3.4 EGA - FEINE
R UN
D FARBIGE
R 1074
32.3.5 VG
A - KUNTERBUN
T 1079
32.3.6 VESA SVGA - HOCHAUFLOESENDE
R STANDAR
D 1082
32.3.7 8514/AUN
D WINDOW
S ACCELERATOR-.
. UN
D NOC
H EI
N FENSTE
R 1083
32.3.8 TIGA - SCHNELLER
, HOEHER
, WEITE
R 1085
32.4 BILDSCHIRMZUGRIF
F UEBE
R DO
S 1086
32.5 BILDSCHIRMZUGRIF
F UEBE
R DA
S BIOS 1088
32.5.1 DI
E GRAPHIKROUTINE
N DE
S STANDARD-BIO
S 1088
32.5.2 HILF
E I
N DE
R NOT-DA
S EGA-UN
D VGA-BIOS 1090
32.5.3 STANDARDERWEITERUN
G - VESA-SVGA-BIOS 1095
32.6 HILF
E ZU
R SELBSTHILF
E - DE
R DIREKT
E ZUGRIF
F AU
F DE
N BILDSCHIRMSPEICHE
R 1096
32.6.1 MD
A 1096
32.6.2 CG
A 1097
32.6.3 HERCULESKARTEGEGEBENENFALL
S 1099
32.6.4 EG
A 1099
32.6.5 VG
A 1103
32.6.6 SVGA 1104
32.6.7 ACCELERATOR
S 1106
32.6.8 ZUSAMMENFASSUN
G 1106
32.7 ACCELERATO
R UN
D GRAPHIKPROZESSO
R GEGE
N LOCAL-BU
S 1107
33 MULTIMEDI
A 1109
33.1 TECHNOLOGISCHE
R HINTERGRUN
D 1109
33.2 PROGRAMMIERUN
G 1114
33.3 EI
N BEISPIEL: DI
E FM-KANAEL
E DE
S SOUNDBLASTER
S 1114
33.3.1 TONERZEUGUN
G MI
T NEU
N KANAELE
N 1115
33.3.2 TONERZEUGUN
G MI
T SECH
S KANAELE
N UN
D FUENF PERCUSSION-INSTRUMENTE
N .
. 1121
TEIL 7: ANHANG 1123
A ASCH
- UN
D TASTENCODE
S 1123
A.
L ASCII-TABELL
E 1123
A.2 TASTENCODE
S (DEUTSCH
E TASTATURBELEGUNG
) 1126
B MASCHINENBEFEHL
E DER 80X86-PROZESSORE
N 1129
B.L 8086/8
8 1129
B.2 80186/8
8 1134
B.3 80286 1135
B.4 I386 1136
B.5 I486 1138
20 INHALTSVERZEICHNIS
B.6 PENTIU
M 1138
B.7 PENTIUM-PAARUNGSREGEL
N 1139
C MASCHINENBEFEHL
E DER 80X87-PROZESSOREN 1141
C.
L 8087 1141
C.2 80287 1145
C.3 80287XL UN
D 80387/387SX 1145
C.4 I486 1145
C.5 PENTIU
M 1145
D INTERRUPTS 1147
D.
L HARDWARE-INTERRUPT
S I
M P
C 1147
D.2 SOFTWARE-INTERRUPT
S I
M P
C 1147
D.3 EXCEPTION
S DE
S 80X86 1148
E DE
R BLOS-UHR-INTERRUPT IA
H UN
D DI
E FUNKTIONE
N 83H/86H DE
S IN
T 15
H 1151
E.
L DE
R BIOS-INTERRUP
T IN
T IA
H 1151
E.2 DI
E WARTEFUNKTIONE
N 83H UN
D 86
H DE
S BIOS-INTERRUP
T IN
T 15H 1153
F DE
R BIOS-INTERRUPT IN
T 13
H 1155
F.
L DI
E FUNKTIONE
N 1155
F.2 FEHLERCODE
S 1166
F.3 FESTPLATTEN-PARAMETERTABELL
E 1166
F.4 FORMATPUFFE
R 1167
F.5 DISKETTENPARAMETERTABELL
E 1167
G DISKETTENCONTROLLE
R 1169
G.
L BEFEHLE 1169
G.L.
L LIST
E DE
R GUELTIGE
N BEFEHLE 1169
G.1.2 DATENUEBERTRAGUNGSBEFEHL
E 1170
G.1.3 STEUERBEFEHL
E 1176
G.1.4 ERWEITERT
E BEFEHLE 1180
G.2 STATUSREGISTE
R ST0 BI
S ST3 1183
H FESTPLATTENCONTROLLE
R 1187
H.
L DI
E BEFEHLE DE
R IDE-SCHNITTSTELL
E 1187
H.1.1 LIST
E DE
R AUFGEFUEHRTE
N BEFEHLE 1188
H.1.2 GEFORDERT
E BEFEHLE 1188
H.1.3 OPTIONAL
E BEFEHLE 1198
H.1.4 OPTIONAL
E IDE-BEFEHLE 1202
H.2 DI
E SCSI-BEFEHLE 1202
H.2.1 LIST
E DE
R AUFGEFUEHRTE
N BEFEHLE 1203
H.2.2 6-BYTE-BEFEHLE 1206
INHALTSVERZEICHNIS 21
H.2.
3 10-BYTE-BEFEHLE 1221
H.2.4 STATUSSCHLUESSE
L 1232
H.2.5 ZUSAETZLICH
E STATUSCODE
S 1232
H.
3 DI
E ASPI-SCHNITTSTELL
E 1234
H.3.1 DI
E ASPI-FUNKTIONE
N 1234
H.3.2 DE
R SCSI-REQUEST-BLOC
K 1234
H.3.
3 ASPI-STATUSCODE
S 1238
I DE
R ZUGRIFF AUF SCHNITTSTELLE
N 1239
1.1 DI
E PARALLEL
E SCHNITTSTELL
E 1239
1.1.1 DI
E DOS-FUNKTIONE
N 1239
1.1.2 DI
E BIOS-FUNKTIONE
N 1239
1.1.3 DRUCKERSTATUSBYT
E 1240
1.2 DI
E SERIELL
E SCHNITTSTELL
E 1241
1.2.1 DI
E DOS-FUNKTIONE
N 1241
1.2.2 DI
E BIOS-FUNKTIONE
N 1242
1.2.3 UEBERTRAGUNGSSTATU
S 1244
1.2.4 MODEMSTATU
S 1245
1.2.5 PARAMETERBYT
E 1245
1.2.6 MODEMSTEUERREGISTE
R 1245
J DE
R ZUGRIFF AUF TASTATUR UN
D MAU
S 1247
J.
L DI
E TASTATU
R 1247
J.L.
L DOS-FUNKTIONE
N 1247
J.1.2 BIOS-INTERRUP
T IN
T 16H 1249
J.1.3 BIOS-INTERRUP
T IN
T 15H 1251
J.L.
4 ERSTE
S UMSCHALTSTATUSBYT
E 1252
J.L.
5 ZWEITE
S UMSCHALTSTATUSBYT
E 1252
J.2 DE
R MAUS-INTERRUP
T 33
H 1252
J.2.1 DI
E FUNKTIONE
N DE
S IN
T 33
H 1252
J.2.2 TASTENBYT
E 1257
J.3 PS/2-MAUSUNTERSTUETZUN
G UEBE
R BIOS-INTERRUP
T IN
T 15H, FUNKTIO
N C2H 1258
J.3.1 DI
E UNTERFUNKTIONE
N DE
S IN
T 15H, FUNKTIO
N C2
H 1258
J.3.2 STATUSBYT
E 1260
J.3.3 MAUSPAKE
T AUF DE
M STAC
K 1261
K DE
R ZUGRIFF AUF GRAPHIKADAPTE
R 1263
K.
L DOS-FUNKTIONE
N 1263
K.2 BIOS-INTERRUP
T IN
T 10H-STANDARDFUNKTIONENDE
S SYSTEM-BIO
S 1264
K.3 BIOS-INTERRUP
T IN
T 10H-ZUSAETZLICH
E FUNKTIONE
N DE
S EGA/VGA-BIO
S 1270
K.4 BIOS-INTERRUP
T ESFT 10H - ZUSAETZLICH
E FUNKTIONE
N DE
S SVGA-BIOS 1287
L DI
E FUNKTIONE
N 87H UN
D 89
H DE
S INTERRUPTS 15
H 1293
22 INHALTSVERZEICHNIS
M PCMCIA-SOCKET-SERVICES 1295
M
L FUNKTIONSGRUPPEN 1295
M.2 DIE FUNKTIONEN 1296
M.3 FEHLERCODES 1311
M.4 ZUSAMMENFASSUNG DER PCMCIA-CARD-SERVICES 1312
M.4.1 CARD-SERVICES-FUNKTIONEN 1312
M.4.2 EVENTS 1314
M.4.3 FEHLERCODES 1315
N GLOSSAR 1317
STICHWORTVERZEICHNIS 1377 |
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