Entwurf digitaler Systeme: eine praktische Einführung
Gespeichert in:
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
Stuttgart
Verl. Berliner Union [u.a.]
1979
|
| Schriftenreihe: | Lehrbuchreihe Elektronik
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| Online-Zugang: | Inhaltsverzeichnis |
| Beschreibung: | 153 S. graph. Darst. |
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|---|---|
| adam_text | INHALTSVERZEICHNIS
1. LOGISCHE SCHALTVERKNUEPFUNGEN UND IHRE REALISATION 11
1.1. DIGITALE SIGNALE, LOGISCHE WERTE, PEGEL 11
1.2. DARSTELLUNGSFORMEN VON SCHALTVERKNUEPFUNGEN 11
1.3. LOGISCHE SCHALTVERKNUEPFUNGEN 14
1.3.1. SCHALTGLIEDER MIT EINER EINGANGSGROESSE 14
INVERTER, BUFFER 15
UEBUNGSAUFGABEN 16
1.3.2. SCHALTGLIEDER MIT ZWEI EINGANGSGROESSEN 18
UND-GATTER, ODER, NOR, NAND, EXKLUSIV-ODER 19
UEBUNGSAUFGABEN 23
1.4. BINAERE ZAHLEN-CODES UND UMRECHNUNGEN 26
1.4.1. DUALCODE 26
1.4.2. BCD-CODE 28
1.4.3. HEXADEZIMALCODE 28
1.4.4. CODIERUNG FUER POSITIVE UND NEGATIVE ZAHLEN 30
1.4.5. GRAY-CODE UND CODEWANDLUNG GRAY/DUAL 31
1.5. SCHALTVERKNUEPFUNGEN MIT DIODEN 32
1.5.1. GATTER 32
1.5.2. SCHALTMATRIX UND CODIEREN, DECODIEREN 33
UEBUNGSAUFGABEN 36
1.5.3. UMCODIEREN 36
1.5.4. INTEGRIERTE DIODEN-SCHALTKREISE, DIODEN-ROM, -PROM
UND -PLA. SPEICHERSTRUKTUR 38
1.6. SCHALTVERKNUEPFUNGEN MIT TRANSISTOREN 40
1.6.1. EINFACHE SCHALTGLIEDER 41
1.6.2. VERDRAHTET-UND, OFFENER COLLECTORAUSGANG 42
UEBUNGSAUFGABEN 44
1.6.3. SCHALTZEITEN, LAUFZEITPROBLEM 46
1.6.4. BELASTBARKEIT, FANOUT 48
1.6.5. DIGITALE INTEGRIERTE SCHALTUNGEN 48
GRUNDGATTER DER HTL-, TTL- UND CMOS-TECHNIK,
NEUE LOGIK-TECHNIKEN 50
2. ENTWURF KOMBINATORISCHER LOGIK 53
2.1. SCHALTALGEBRA 53
UEBUNGSAUFGABEN 54
7
HTTP://D-NB.INFO/790812770
2.2. MINIMIERUNG 55
2.2.1. NORMALFORMEN DER SCHALTFUNKTIONEN 55
2.2.2. MINIMIERUNG MIT KV-TAFELN 57
2.2.3. FAKTORISIERUNG 61
2.3. ENTWURFSBEISPIEL 61
UEBUNGSAUFGABEN 64
3. AUFBAU UND ENTWURF SEQUENTIELLER SCHALTKREISE 66
LABORAUFGABE BEI ALLEN GRUNDSCHALTUNGEN
3.1. FLIPFLOPS 66
3.1.1. LATCH- UND RS-FLIPFLOP-SCHALTUNG 66
3.1.1.1. RS-FLIPFLOP 67
3.1.1.2. LATCH-3-BETRIEB 67
3.1.1.3. ZUSTANDSDARSTELLUNG 68
3.1.1.4. FUNKTIONSTABELLEN 68
3.1.2. GETAKTETES RS-FLIPFLOP 69
3.1.3. AUFFANG-D-FLIPFLOP 69
3.1.4. JK-MASTER-SLAVE-FLIPFLOP 70
3.1.5. D-FLIPFLOP 72
3.2. ZAEHLER 76
3.2.1. ASYNCHRONER DUALZAEHLER 76
3.2.2. ASYNCHRONER VORWAERTS/RUECKWAERTS-DUALZAEHLER 77
3.2.3. SYNCHRONER DUALZAEHLER 78
3.2.4. SYNCHRONER VORWAERTS/RUECKWAERTS-DUALZAEHLER 79
3.2.4.1. GRUNDSCHALTUNG 79
3.2.4.2. INTEGRIERTER 4BIT-BAUSTEIN 80
3.2.5. MODULO-N-ZAEHLER 81
ENTWURFSVERFAHREN AM BEISPIEL SYNCHRONER BCD-ZAEHLER:
3.2.5.1. E-VERFAHREN 81
3.2.5.2. JK-VERFAHREN 83
3.2.5.3. NETZEINSCHALTLOESCHEN 85
3.2.5.4. PSEUDOFOLGEN 85
3.3. REGISTER 86
3.3.1. SCHIEBEREGISTER AUS JK-FLIPFLOPS 86
3.3.2. SCHIEBEREGISTER AUS D-FLIPFLOPS 88
3.3.3. RECHTS/LINKS-SCHIEBEREGISTER 89
3.3.4. SERIELL/PARALLEL-, PARALLEL/SERIELL-UMSETZUNG 90
3.3.5. REGISTERVERARBEITUNG 91
AN DEN BEISPIELEN:
3.3.5.1. KOMPLEMENT 91
3.3.5.2. ADDITION UND SUBTRAKTION 92
4. AUSGEWAEHLTE HARDWARE-MODULE 96
MIT LABORAUFGABEN
4.1. PROGRAMMIERTE ANZAHL VON IMPULSEN 96
4.2. SYNCHRONISATION 98
4.3. PROGRAMMIERBARE ZAEHLER 99
4.4. MONOFLOP 100
4.4.1. BETRIEBSARTEN INTEGRIERTER MONOFLOPS 100
4.4.2. PROGRAMMIERTE IMPULSDAUER 103
4.5. FREQUENZMESSSCHALTUNG MIT DIGITALER ANZEIGE 104
4.6. UEBERTRAGUNG, INTERFACE 105
4.6.1. DATENSELEKTOR, PARALLELER DATENBUS 105
4.6.2. SERIELLE UEBERTRAGUNG 108
4.7. EIN- UND AUSGABE 111
4.7.1. TASTENEINGABE UND PRIORITAETSCODIERUNG 111
4.7.2. EINSTELLAUSWAHL 1 AUS N 112
4.7.3. DISPLAY-AUSGABE 114
4.7.3.1. STROBE UND 7-SEGMENT-MULTIPLEX 114
4.7.3.2. 5X7-ZEICHENGENERATOR UND ZEILENAUSGABE 115
4.7.4. LEISTUNGSAUSGAENGE FUER BETAETIGUNGSELEMENTE 118
4.8. D/A- UND A/D-WANDLUNG 119
5. PROGRAMMIERTE STEUERUNG 121
PROGRAMMIERT MIT FIRMWARE BIS SOFTWARE, MIT LABORAUFGABEN
5.1. STEUERWERKE 121
5.1.1. LINEARE STEUERWERKE 121
5.1.2. VERZWEIGENDE STEUERWERKE 122
5.1.3. STEUERSCHRITTZAEHLER, STEUERSPEICHER 124
5.2. MIKROPROGRAMMSTEUERUNG 126
5.2.1. BEISPIEL 127
5.2.2. FOLGESTEUERUNGEN 127
5.3. PROGRAMMSTEUERUNG 128
5.3.1. PROGRAMMGESTEUERTER RECHNER 128
5.3.2. PROGRAMMGESTEUERTE STEUERUNG MIT MIKROCOMPUTER 130
5.3.3. LOGIK-ANALYSATOR MIT 8080 131
LOESUNGEN UND VORSCHLAEGE ZU DEN AUFGABEN 133
A. ANHANG 141
AI. GRUNDUMFANG VON DIGITALEN ICS IN TTL- UND CMOS-TECHNIK 141
9
A2. PROMS 143
A3. PLA-BAUSTEIN 144
A4. SYMBOLE UND NONNEN 144
LITERATUR 146
SACHVERZEICHNIS 148
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