Mikrocontroller und Mikroprozessoren:
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2010
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UWE BRINKSCHULTE * THEO UNGERER
MIKROCONTROLLER UND
MIKROPROZESSOREN
3. AUFLAGE
4Y SPRINGER
IMAGE 2
INHALTSVERZEICHNIS
VORWORT VII
VORWORT ZUR 2. AUFLAGE IX
VORWORT ZUR 3. AUFLAGE XI
INHALTSVERZEICHNIS XIII
1 GRUNDLAGEN 1
1.1 MIKROPROZESSOREN, MIKROCONTROLLER, SIGNALPROZESSOREN UND SOC 1 1.2
PC-SYSTEME 3
1.3 EINGEBETTETE UND UBIQUITAERE SYSTEME 8
1.4 LEISTUNGSMESSUNG UND LEISTUNGSVERGLEICH 12
2 GRUNDLEGENDE PROZESSORTECHNIKEN 17
2.1 BEFEHLSSATZARCHITEKTUREN 17
. 1 PROZESSORARCHITEKTUR, MIKROARCHITEKTUR UND PROGRAMMIERMODELL 17 .2
DATENFORMATE 18
.3 ADRESSRAUMORGANISATION 22
.4 BEFEHLSSATZ 23
.5 BEFEHLSFORMATE 26
.6 ADRESSIERUNESARTEN R. 28
1.7 CISC-UND RISC-PRINZIPIEN 34
2.2 BEFEHLSSATZBEISPIELE 36
2.2.1 FRUEHE RISC-RECHNER 36
2.2.2 DAS BERKELEY RISC-PROJEKT 37
2.2.3 DIE DLX-ARCHITEKTUR 38
2.3 EINFACHE PROZESSOREN UND PROZESSORKERNE 41
2.3.1 VON-NEUMANN-PRINZIP 41
2.3.2 GRUNDLEGENDER AUFBAU EINES MIKROPROZESSORS 44
2.3.3 EINFACHE IMPLEMENTIERUNGEN 45
2.3.4 PIPELINE-PRINZIP 46
2.4 BEFEHLS-PIPELINING 48
2.4.1 GRUNDLEGENDE STUFEN EINER BEFEHLS-PIPELINE 48
2.4.2 DIE DLX-PIPELINE 49
2.4.3 PIPELINE-KONFLIKTE 55
IMAGE 3
XIV INHALTSVERZEICHNIS
2.4.4 DATENKONFLIKTE UND DEREN LOESUNGSMOEGLICHKEITEN 55
2.4.5 STEUERFLUSSKONFLIKTE UND DEREN LOESUNGSMOEGLICHKEITEN 62 2.4.6
SPRUNGZIELADRESS-CACHE 65
2.4.7 STATISCHE SPRUNGVORHERSAGETECHNIKEN 67
2.4.8 STRUKTURKONFLIKTE UND DEREN LOESUNGSMOEGLICHKEITEN 68 2.4.9
AUSFUEHRUNG IN MEHREREN TAKTEN 69
2.5 WEITERE ASPEKTE DES BEFEHLS-PIPELINING 71
3 MIKROCONTROLLER 73
3.1 ABGRENZUNG ZU MIKROPROZESSOREN 74
3.2 ANWENDUNGSFELDER 82
3.2.1 PROZESSSTEUERUNG 82
3.2.2 STEUERUNG VON BEDIENELEMENTEN 90
3.3 LEISTUNGSKLASSEN UND INDUSTRIELLE MIKROCONTROLLERFAMILIEN 91 3.4
AUSWAHLKRITERIEN FUER DEN EINSATZ VON MIKROCONTROLLERN 100 3.5
SOFTWARE-ENTWICKLUNG 104
3.6 FORSCHUNGSTRENDS 108
3.6.1 SYSTEMS-ON-CHIP (SOC) 109
3.6.2 ENERGIESPAR-TECHNIKEN 114
3.6.3 JAVA UND JAVA-PROZESSOREN FUER EINGEBETTETE SYSTEME 120 3.6.4
SELBSTORGANISATION UND ORGANIC COMPUTING 124
4 MIKROCONTROLLER-KOMPONENTEN 139
4.1 PROZESSORKERNE 139
4.2 EIN-/AUSGABEEINHEITEN 142
4.2.1 ANBINDUNG AN DEN PROZESSORKERN 143
4.2.2 DIGITALE PARALLELE EIN-/AUSGABEEINHEITEN 147
4.2.3 DIGITALE SERIELLE EIN-/AUSGABEEINHEITEN 151
4.2.4 WANDLUNG ZWISCHEN ANALOGEN UND DIGITALEN SIGNALEN 159 4.3
ZEITGEBERBASIERTE EINHEITEN 168
4.3.1 ZAEHLER UND ZEITGEBER 169
4.3.2 CAPTURE-UND-COMPARE-EINHEIT ~ 174
4.3.3 PULSWEITENMODULATOR 175
4.3.4 WATCHDOG-EINHEIT 179
4.3.5 ECHTZEIT-EIN-/AUSGABEEINHEITEN 180
4.4 SPEICHER 182
4.4.1 FESTWERTSPEICHER 184
4.4.2 SCHREIB-/LESESPEICHER 186
4.5 UNTERBRECHUNGSSTEUERUNG 188
4.6 DMA 197
4.7 ERWEITERUNGSBUS 201
5 BEISPIELE VERSCHIEDENER MIKROCONTROLLER 207
5.1 ATMEGAL28A-EIN KOMPAKTER MIKROCONTROLLER 207
5.1.1 PROZESSORKERN 209
5.1.2 UNTERBRECHUNGSBEHANDLUNG 215
IMAGE 4
INHALTSVERZEICHNIS XV
5.1.3 SPEICHER UND ADRESSRAUM 217
5.1.4 EIN-/AUSGABEEINHEITEN UND ZAEHLER/ZEITGEBER 218
5.1.5 ERWEITERUNGSBUS 224
5.2 MC68332 - EIN MIKROCONTROLLER MITTLERER LEISTUNG 225
5.2.1 PROZESSORKERN 227
5.2.2 UNTERBRECHUNGSBEHANDLUNG 230
5.2.3 SPEICHER UND ADRESSRAUM 232
5.2.4 EIN-/AUSGABEEINHEITEN UND ZAEHLER/ZEITGEBER 234
5.2.5 ERWEITERUNGSBUS 239
5.3 PXA270 - EIN HOCHLEISTUNGS-MIKROCONTROLLER 243
5.3.1 PROZESSORKERN 245
5.3.2 UNTERBRECHUNGSBEHANDLUNG 248
5.3.3 SPEICHER UND ADRESSRAUM 250
5.3.4 EIN-/AUSGABEEINHEITEN UND ZAEHLER/ZEITGEBER 252
5.3.5 ERWEITERUNGSBUS 260
5.4 MCORE- OPTIMIERT FUER NIEDRIGEN ENERGIEVERBRAUCH 261
5.4.1 REDUKTION DER BUSAKTIVITAETEN UND ERHOEHUNG DER CODE-DICHTE 263
5.4.2 STATISCHES POWER-MANAGEMENT 265
5.4.3 DYNAMISCHES POWER-MANAGEMENT 266
5.5 KOMODO - EIN FORSCHUNGS-MIKROCONTROLLER 267
5.5.1 PROZESSORKERN 269
5.5.2 ECHTZEIT-SCHEDULING 272
5.5.3 UNTERBRECHUNGSBEHANDLUNG 275
5.5.4 ANBINDUNG DER PERIPHEREN KOMPONENTEN 277
5.5.5 EVALUIERUNGS-ERGEBNISSE 278
5.5.6 WEITERFUEHRENDE KONZEPTE 282
6 HOCHPERFORMANTE MIKROPROZESSOREN 291
6.1 VON SKALAREN RISC- ZU SUPERSKALARPROZESSOREN 291
6.2 KOMPONENTEN EINES SUPERSKALAREN PROZESSORS 294
6.3 SUPERSKALARE PROZESSOR-PIPELINE 296
6.4 PRAEZISIERUNG DES BEGRIFFS *SUPERSKALAR 299
6.5 DIE VLIW-TECHNIK 300
6.6 DIE EPTC-TECHNIK 302
6.7 VERGLEICH DER SUPERSKALAR- MIT DER VLIW- UND DER EPIC-TECHNIK 303
7 DIE SUPERSKALARTECHNIK 307
7.1 BEFEHLSBEREITSTELLUNG 307
7.1.1 CODE-CACHE-SPEICHER 307
7.1.2 BEFEHLSHOLESTUFE 308
7.1.3 TRACE CACHE 309
7.2 SPRUNGVORHERSAGE UND SPEKULATIVE AUSFUEHRUNG 312
7.2.1 GRUNDLAGEN 312
7.2.2 DYNAMISCHE SPRUNGVORHERSAGETECHNIKEN 313
7.2.3 EIN- UND ZWEI-BIT-PRAEDIKTOREN 315
7.2.4 KORRELATIONSPRAEDIKTOREN 318
IMAGE 5
XVI INHALTSVERZEICHNIS
7.2.5 ZWEISTUFIG ADAPTIVE PRAEDIKTOREN 319
7.2.6 GSELECT- UND GSHARE-PRAEDIKTOREN 326
7.2.7 HYBRIDPRAEDIKTOREN 327
7.2.8 ZUVERLAESSIGKEITSABSCHAETZUNG 329
7.2.9 WEITERE PRAEDIKTOREN ZUR INTERFERENZVERRINGERUNG 331 7.2.10
PRAEDIKATION 333
7.2.11 MEHRPFADAUSFUEHAING 335
7.2.12 VORHERSAGE BEDINGTER SPRUNGBEFEHLE MIT INDIREKTER ADRESSIERUNG338
7.2.13 SPRUNGVORHERSAGE IN KOMMERZIELLEN MIKROPROZESSOREN 339 7.2.14
SPRUNGVORHERSAGE MIT HOHER BANDBREITE 340
7.2.15 DATENABHAENGIGKEITS-, ADRESS- UND WERTESPEKULATIONEN 341 7.3
DECODIERUNG UND REGISTERUMBENENNUNG 342
7.3.1 DECODIERUNG 342
7.3.2 REGISTEAIMBENENNUNG 343
7.4 BEFEHLSZUORDNUNG 346
7.5 AUSFUEHRUNGSSTUFEN 353
7.6 GEWAEHRLEISTUNG DER SEQUENZIELLEN PROGRAMMSEMANTIK 358 7.6.1
RUECKORDNUNGSSTUFE 358
7.6.2 PRAEZISE UNTERBRECHUNGEN 359
7.6.3 RUECKORDNUNGSPUFFER 360
7.7 VERZICHT AUF DIE SEQUENZIALISIERUNG BEI DER RUECKORDNUNG 361
8 SPEICHERVERWALTUNG 363
8.1 SPEICHERHIERARCHIE 363
8.2 REGISTER UND REGISTERFENSTER 365
8.3 VIRTUELLE SPEICHERVERWALTUNG 369
8.4 CACHE-SPEICHER 374
8.4.1 GRUNDLEGENDE DEFINITIONEN 374
8.4.2 GRUNDLEGENDE TECHNIKEN 375
8.4.3 VERRINGERN DER FEHLZUGRIFFSRATE 381
8.4.4 VERRINGERN DES FEHLZUGRIFFSAUFWANDES 384
8.4.5 VERRINGERN DER CACHE-ZUGRIFFSZEIT BEI EINEM TREFFER ? 385 8.4.6
CACHE-KOHAERENZ UND SPEICHERKONSISTENZ 388
8.4.7 BUSSCHNUEFFELN UND MESI-PROTOKOLL 389
8.4.8 SPEICHERKONSISTENZ 392
9 MEHRFAEDIGE UND MEHRKERNPROZESSOREN 395
9.1 STAND DER TECHNIK UND TECHNOLOGIEPROGNOSEN 395
9.2 GRENZEN HEUTIGER PROZESSORTECHNIKEN 397
9.3 MEHRFAEDIGE PROZESSOREN 399
9.3.1 MEHRFAEDIGKEIT 399
9.3.2 GRUNDTECHNIKEN DER MEHRFAEDIGKEIT 400
9.3.3 DIE SIMULTAN MEHRFAEDIGE PROZESSORTECHNIK 405
9.3.4 WEITERE ANWENDUNGSMOEGLICHKEITEN DER MEHRFAEDIGKEIT 408 9.4
MEHRKERNPROZESSOREN 409
IMAGE 6
INHALTSVERZEICHNIS XVII
10 BEISPIELE FUER MIKROPROZESSOREN 417
10.1 DIE INTEL PENTIUM-PROZESSOREN 417
10.2 MEHRKERNPROZESSOREN VON INTEL 423
10.3 INTEL LARRABEE 424
10.4 IBMCELL 426
11 ZUSAMMENFASSUNG 429
LITERATUR 431
SACHVERZEICHNIS 447
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