Digitaltechnik: 1 Grundlagen, Entwurf, Schaltungen
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| Format: | Book |
| Language: | German |
| Published: |
Heidelberg
Hüthig
2001
|
| Edition: | 4., neu bearb. und erw. Aufl. |
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| Physical Description: | IX, 256 S. graph. Darst. |
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| adam_text | PETER PERNARDS DIGITALTECHNIK I GRUNDLAGEN, ENTWURF, SCHALTUNGEN 4., NEU
BEARBEITETE UND ERWEITERTE AUFLAGE HUETHIG VERLAG HEIDELBERG
INHALTSVERZEICHNIS 1 EINFUEHRUNG 1 1.1 ANALOG UND DIGITAL 1 1.2 DIGITALE
UND BINAERE SIGNALE 3 2 ZAHLENSYSTEME 5 2.1 POLYADISCHE ZAHLENSYSTEME 6
2.2 ZAHLENUMWANDLUNG BEI UNTERSCHIEDLICHEN BASEN 7 2.3 ARITHMETIK IM
DUALSYSTEM 10 2.4 DARSTELLUNG NEGATIVER ZAHLEN 12 2.5 UEBUNG,
ZAHLENSYSTEME 15 3 CODES 17 3.1 NUMERISCHE CODES 18 3.2 ALPHANUMERISCHE
CODES 23 3.3 CODESICHERUNG 24 3.4 UEBUNG, CODES 25 4 SCHALTALGEBRA 27 4.1
SCHALTVARIABLE UND SCHALTFUNKTION 27 4.2 RECHEN- UND KUERZUNGSREGELN 27
4.3 VERKNUEPFUNGEN UND SCHALTSYMBOLE 32 4.4 VORRANGREGELN 37 4.5
NORMALFORMEN, MINTERME, MAXTERME 38 4.6 UEBUNG, SCHALTALGEBRA 42 5
LOGISCH-PHYSIKALISCHE ZUSAMMENHAENGE 45 5.1 POSITIVE UND NEGATIVE LOGIK
46 5.2 AUSGANGSSCHALTUNGEN 51 5.3 WIRED-TECHNIK 52 5.4 UEBUNG,
LOGISCH-PHYSIKALISCHE ZUSAMMENHAENGE 53 6 ANALYSE VON SCHALTNETZEN 55 6.1
UEBUNG, ANALYSE VON SCHALTNETZEN 58 7 SYNTHESE VON SCHALTNETZEN 61 7.1
MINIMIERUNG MIT KV-TAFELN 61 7.2 REDUNDANZEN T 67 7.3 KONJUNKTIVE
MINIMALFORM 68 7.4 MULTI-OUTPUT-SCHALTNETZE 69 7.5 VORGEHENSWEISE BEI
DER MINIMIERUNG 71 7.6 SYNTHESE BEI VORGEGEBENEN VERKNUEPFUNGEN 72 7.7
UEBUNG, SYNTHESE VON SCHALTNETZEN 77 INHALTSVERZEICHNIS 8 EINFUEHRUNG IN
DIE SCHALTNETZBESCHREIBUNG MIT VHDL 79 8.1 DATENTYPEN IN VHDL 83 8.2
BOOLESCHE GLEICHUNGEN 85 8.3 WAHRHEITSTABELLEN 86 8.4 UEBUNG,
SCHALTNETZBESCHREIBUNG MIT VHDL 90 9 HAEUFIG BENOETIGTE SCHALTNETZE 91 9.1
VERGLEICHER (KOMPARATOREN) 91 9.2 CODE-UMSETZER 95 9.3 MULTIPLEXER 99
9.4 RECHENSCHALTUNGEN 102 9.5 UEBUNG, HAEUFIG BENOETIGTE SCHALTNETZE 108 10
SCHALTNETZREALISIERUNG MIT PROGRAMMIERBAREN BAUSTEINEN 111 10.1
SCHALTUNGSAUFBAU MIT NICHTFLUECHTIGEN SPEICHERN 111 10.2 EINFUEHRUNG IN
PLA UND PAL/GAL 113 10.3 PLA 115 10.4 PAL/GAL 118 10.5 UEBUNG,
SCHALTNETZREALISIERUNG MIT PROGRAMMIERBAREN BAUSTEINEN 120 11 FLIPFLOPS
123 11.1 BASIS-FLIPFLOPS 123 11.2 FLIPFLOPS MIT TAKTSTEUERUNG 128 11.2.1
TAKTZUSTANDSGESTEUERTE EINSPEICHER-FLIPFLOPS 129 11.2.2
TAKTZUSTANDSGESTEUERTE ZWEISPEICHER-FLIPFLOPS 133 11.2.3
TAKTFLANKENGESTEUERTE FLIPFLOPS 136 11.3 KONVERTIERUNG VON
FLIPFLOP-TYPEN 139 11.4 UEBERSICHTSBILDER 140 11.5 UEBUNG, FLIPFLOPS 142
12 EINFUEHRUNG IN DIE SCHALTWERKE 145 12.1 SCHALTNETZE UND SCHALTWERKE
145 12.2 ZUSTANDSDIAGRAMM 146 12.3 STRUKTUR VON SCHALTWERKEN 149 12.4
SYNCHRONER UND ASYNCHRONER BETRIEB 152 12.5 EINFUEHRUNG IN DIE
SCHALTWERKBESCHREIBUNG MIT VHDL 153 12.6 SCHALTWERKREALISIERUNG MIT
EINEM GAL 16V8 158 12.6.1 BESCHREIBUNG DES GAL 16V8 158 12.6.2 SYNTHESE
MIT DEM GAL 16V8 ;65 12.7 UEBUNG, EINFUEHRUNG IN DIE SCHALTWERKE 170 13
SYNTHESE VON ZAEHLSCHALTUNGEN 171 13.1 SYNCHRONE ZAEHLER 171 13.2
ASYNCHRONE ZAEHLER 188 13.3 UEBUNG, ZAEHLER 189 INHALTSVERZEICHNIS IX 14
REGISTER UND SCHIEBEREGISTER 191 14.1 AUFFANGREGISTER 191 14.2
SCHIEBEREGISTER 192 14.3 REGISTERSCHALTUNGEN ALS SPEICHER IN
SCHALTWERKEN 196 14.4 UEBUNG, REGISTER UND SCHIEBEREGISTER... 201 15
HALBLEITERSPEICHER 203 15.1 DEFINITIONEN UND BEGRIFFE 203 15.2
ORTSADRESSIERBARE HALBLEITERSPEICHER 205 15.2.1 NICHTFLUECHTIGE SPEICHER
206 15.2.1.1 ROM 208 15.2.1.2 PROM 209 15.2.1.3 EPROM 210 15.2.1.4
EEPROM UND FLASH EEPROM 212 15.2.2 FLUECHTIGE SPEICHER 213 15.2.2.1 SRAM
216 15.2.2.2 DRAM 218 15.3 INHALTSADRESSIERBARE HALBLEITERSPEICHER 221
16 LOESUNGEN ZU DEN UEBUNGEN 223 17 ANHANG ZUR ABHAENGIGKEITSNOTATION 243
18 LITERATURVERZEICHNIS 249 SACHWOERTERVERZEICHNIS , 251
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