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Digitaltechnik: ein Lehr- und Übungsbuch ; mit 81 Tabellen

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Bibliographic Details
Main Authors:	Urbanski, Klaus 1942- (Author), Woitowitz, Roland 1941- (Author)
Format:	Book
Language:	German
Published:	Berlin [u.a.] Springer 2000
Edition:	3., neubearb. und erw. Aufl.
Series:	Springer-Lehrbuch
Subjects:	Digitaltechnik - Lehrbuch Digitaltechnik Lehrbuch
Online Access:	Inhaltsverzeichnis
Physical Description:	XIII, 454 S. Ill., graph. Darst.
ISBN:	3540668802

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adam_text	INHALTSVERZEICHNIS 1 ZAHLENSYSTEME . 1 1.1 ALLGEMEINES ZAHLENSYSTEM . 1 1.2 DUAL-, OKTAL UND HEXADEZIMALSYSTEM . 2 1.3 KONVERTIERUNG ZWISCHEN DEN ZAHLENSYSTEMEN . 3 1.4 ARITHMETISCHE OPERATIONEN IM DUALSYSTEM . 5 1.4.1 DIE DUALE ADDITION . 5 1.4.2 DIE DUALE SUBTRAKTION . 5 1.4.3 DIE MULTIPLIKATION VON DUALZAHLEN (BOOTH-ALGORITHMUS) . 10 1.4.4 DIE DIVISION VON DUALZAHLEN (RESTORING-METHODE) . 11 1.5 DIE DARSTELLUNG GEBROCHENER ZAHLEN IM DUALSYSTEM . 13 2 LOGISCHE FUNKTIONEN . 15 2.1 GRUNDBEGRIFFE . 15 2.1.1 LOGIK-PEGEL UND LOGIK-ZUSTAND EINER BINAEREN VARIABLEN . 15 2.1.2 ZUORDNUNGSSYSTEME . 16 2.1.3 SIGNALNAMEN IN DER DIGITALTECHNIK . 20 2.2 VERGLEICH ZWISCHEN ANALOGER UND DIGITALER PHYSIKALISCHER GROESSE . 20 2.3 SCHALTALGEBRA . 22 2.3.1 VERKNUEPFIMGSZEICHEN . 22 2.3.2 DEFINITION DER LOGISCHEN FUNKTIONEN . 24 2.3.3 SCHALTSYMBOLE . 25 2.3.4 RECHENREGELN DER SCHALTALGEBRA . 28 2.3.5 LOGIKSTUFEN . 30 2.3.6 REALISIERUNG DER GRUNDVERKNUEPFUNGEN IN NAND UND NOR-TECHNIK . 31 2.3.7 NORMALFORM EINER LOGISCHEN FUNKTION . 33 2.4 MINIMIEREN LOGISCHER FUNKTIONEN . 35 2.4.1 ALLGEMEINES . 35 2.4.2 MINIMIERUNGSVERFAHREN . 37 2.4.3 KAMAUGH-VEITCH-DIAGRAMM (KV-DIAGRAMM) . 38 2.4.3.1 KV-DIAGRAMM FUER ZWEI EINGANGSVARIABLEN . 39 2.4.3.2 KV-DIAGRAMM FUER DREI EINGANGSVARIABLEN . 41 2.4.3.3 KV-DIAGRAMM FUER VIER EINGANGSVARIABLEN . 44 2.4.3.4 KV-DIAGRAMM FUER FUENF EINGANGSVARIABLEN . 46 3 TECHNISCHE REALISIERUNG DIGITALER SCHALTUNGEN . 49 3.1 UEBERBLICK UEBER DIE TECHNOLOGISCHE ENTWICKLUNG . 49 3.2 REALISIERUNGSKONZEPTE NACH EINFUEHRUNG INTEGRIERTER SCHALTKREISE . 49 3.3 CHARAKTERISTISCHE EIGENSCHAFTEN DIGITALER INTEGRIERTER SCHALTKREISE . 52 3.3.1 LASTFAKTOREN . 53 3.3.2 STOERSPANNUNGSABSTAND . 53 VIII INHALTSVERZEICHNIS 3.3.3 SCHALTZEITEN . : . 54 3.4 BAUSTEINFAMILIEN . 56 3.4.1 TRANSISTOR-TRANSISTOR-LOGIK (TTL) . 56 3.4.1.1 DIGITALE SCHALTUNGEN IN STANDARD-TTL . 56 3.4.1.2 DIGITALE SCHALTUNGEN IN SCHOTTKY-TTL . 57 3.4.1.3 TTL-SCHALTUNGEN MIT SPEZIELLER AUSGANGSSTUFE . 59 3.4.1.4 REALISIERUNG DER PEGEL-ZUSTAENDE AN TTL-EINGAENGEN . 61 3.4.2 INTEGRIERTE SCHALTUNGEN IN MOS-TECHNIK . 64 3.4.3 EMITTER COUPLED LOGIC (ECL) . 69 3.4.4 TRENDS BEI DER TECHNOLOGISCHEN WEITERENTWICKLUNG . 71 3.5 ANWENDERSPEZIFISCHE BAUSTEINE (APPLICATION SPECIFIC ICS) . 71 3.5.1 FULLCUSTOM ICS . 72 3.5.2 GATE ARRAY . 72 3.5.3 STANDARDZELLEN IC . 72 3.6 PROGRAMMIERBARE LOGIK . 73 3.6.1 PROGRAMMABLE LOGIC DEVICE PLD . 73 3.6.2 COMPLEX PROGRAMMABLE LOGIC DEVICE (CPLD) . 79 3.6.3 FIELD PROGRAMMABLE GATE ARRAY FPGA . 81 3.6.3.1 ALLGEMEINER AUFBAU EINES FPGAS . 81 3.6.3.2 FPGA MIT ANTIFUSE-LINK . 81 3.6.3.3 FPGA MIT SRAM-VERBINDUNGSELEMENT . 84 4 VHDL ALS ENTWURFS UND SIMULATIONSSPRACHE . 91 4.1 EINFUEHRUNG IN VHDL . 91 4.2 MOTIVATION ZUM ERLERNEN VON VHDL IN EINEM GRUNDKURS . 91 4.3 GRUNDLAGEN . 92 4.4 ENTITY-DEKLARATION . 93 4.4.1 EINFACHE ENTITY-DEKLARATION OHNE PARAMETERUEBERGABE . 95 4.4.2 ERWEITERTE ENTITY-DEKLARATION MIT PARAMETERUEBERGABE . 95 4.4.3 ENTITY-DEKLARATION MIT ENTITY-ANWEISUNGEN . 96 4.5 ARCHITECTURE . 96 4.5.1 VERHALTENSBESCHREIBUNG (BEHAVIORAL DESCRIPTION) . 97 4.5.2 NEBENLAEUFIGE ANWEISUNGEN IN DER VERHALTENSBESCHREIBUNG . 97 4.5.2.1 NEBENLAEUFIGE SIGNALZUWEISUNG . 98 4.5.2.2 WHEN-ELSE-ANWEISUNG . 98 4.5.2.3 WITH-SELECT-WHEN-ANWEISUNG . 99 4.5.2.4 ANWENDUNGSBEISPIELE MIT NEBENLAEUFIGEN ANWEISUNGEN . 99 4.5.3 PROZESS-ANWEISUNG . 101 4.5.4 SEQUENTIELLE ANWEISUNGEN IN DER VERHALTENSBESCHREIBUNG . 102 4.5.4.1 SEQUENTIELLE SIGNALZUWEISUNG . 103 4.5.4.2 SEQUENTIELLE VARIABIENZUWEISUNG . 103 4.5.4.3 IF-THEN-ELSE-ANWEISUNG . 104 4.5.4.4 CASE-WHEN-ANWEISUNG . 104 4.5.4.5 FOR-LOOP-ANWEISUNG . 104 4.5.4.6 WHILE-LOOP-ANWEISUNG . 105 4.5.4.7 NEXT UND EXIT-ANWEISUNG . 105 4.5.4.8 ANWENDUNGSBEISPIELE MIT PROZESS UND SEQUENTIELLEN ANWEISUNGEN . 105 4.5.5 STRUKTURBESCHREIBUNG ( STRUCTURAL DESCRIPTION) . 106 4.6 UNTERPROGRAMME . 109 4.6.1 PROZEDUREN . 109 4.6.2 FUNKTIONEN . 110 INHALTSVERZEICHNIS IX 4.7 WEITERFUEHRENDE KAPITEL . 112 4.7.1 ASSERTION UND REPORT-ANWEISUNG . 112 4.7.2 ALIAS-DEKLARATION . 113 4.7.3 UEBERLADEN (OVERLOADING) . 113 4.7.4 AUFLOESUNGSFUNKTIONEN (RESOLUTION FUNCTIONS) . 114 4.7.5 PACKAGE UND USE-ANWEISUNG . 114 4.7.6 BIBLIOTHEKEN . 117 4.7.7 GENERATE-ANWEISUNG . 117 4.7.8 BLOCK-ANWEISUNG . 118 4.7.9 KONFIGURATION . 118 4.7.9.1 KONFIGURATION FUER VHDL-MODELLE MIT VERHALTENSBESCHREIBUNG . 119 4.7.9.2 KOMPONENTEN-KONFIGURATION . 119 4.7.9.3 BLOCK-KONFIGURATION . 121 4.8 ANHANG: VHDL-GRUNDBEGRIFFE ZUM NACHSCHLAGEN . 123 4.8.1 BEZEICHNER (IDENTIFIER) . 123 4.8.2 DATENOBJEKTE UND OBJEKTKLASSEN . 124 4.8.2.1 KONSTANTEN . 125 4.8.2.2 VARIABLEN . 125 4.8.2.3 SIGNALE . 125 4.8.3 DATENTYPEN . 126 4.8.3.1 SKALARE DATENTYPEN (SCALAR TYPES) . 127 4.8.3.2 ZUSAMMENGESETZTE DATENTYPEN (COMPOSITE TYPES) . 129 4.8.3.2.1 ARRAYS . 129 4.8.3.2.2 RECORDS . 129 4.8.3.2.3 ZUGRIFF AUF DIE ELEMENTE ZUSAMMENGESETZTER DATENTYPEN . 130 4.8.3.3 SUBTYPES . 132 4.8.3.4 ATTRIBUTE . 133 4.8.4 OPERATORENUNDOPERANDEN . 134 5 KOMBINATORISCHE SCHALTUNGEN . 137 5.1 CODIERSCHALTUNGEN . 137 5.1.1 ALPHANUMERISCHER CODE . 137 5.1.2 NUMERISCHER CODE . 138 5.2 MULTIPLEXER UND DEMULTIPLEXER . 143 5.2.1 MULTIPLEXER . 143 5.2.2 DEMULTIPLEXER . 145 5.3 ADDIERER . 146 6 SEQUENTIELLE SCHALTUNGEN . 151 6.1 ELEMENTARE SCHALTWERKE . 151 6.1.1 DIGITALE OSZILLATOREN . 151 6.1.2 MONOSTABILE KIPPSTUFEN (MONOFLOPS) . 154 6.1.3 BISTABILE KIPPSTUFEN (FLIPFLOPS) . 155 6.1.3.1 UNGETAKTETES RS-FLIPFLOP (RS-LATCH) . 156 6.1.3.2 EINZUSTANDSGESTEUERTE FLIPFLOPS . 159 6.1.3.3 EINFLANKENGESTEUERTE FLIPFLOPS . 161 6.2 ZAEHLER . 170 6.2.1 ASYNCHRONE ZAEHLER . 170 6.2.1.1 ASYNCHRONER DUALZAEHLER . 170 6.2.1.2 ASYNCHRONER MODULO-M-ZAEHLER . 172 6.2.2 SYNCHRONE ZAEHLER . 174 X INHALTSVERZEICHNIS 6.2.2.1 SYNCHRONER DUALZAEHLER . 174 6.2.2.2 SYNCHRONER MODULO-M-ZAEHLER . 179 6.3 SCHIEBEREGISTER . 181 6.3.1 REALISIERUNG MIT FLANKENGESTEUERTEN D-FLIPFLOPS . 182 6.3.2 ANWENDUNGSGEBIETE . 184 6.3.2.1 SERIELLE DATENUEBERTRAGUNG . 184 6.3.2.2 RECHENOPERATIONEN . 184 6.3.2.3 RUECKGEKOPPELTE SCHIEBEREGISTER . 185 6.4 SYSTEMATISCHE BESCHREIBUNG DER SCHALTWERKE . 187 6.4.1 GRUNDLAGEN DER AUTOMATENTHEORIE . 187 6.4.2 DAS ZUSTANDSDIAGRAMM UND DIE ZUSTANDSFOLGETABELLE . 189 6.4.2.1 ZUSTANDSDIAGRAMM . 189 6.4.2.2 ZUSTANDSFOLGETABELLE . 191 6.4.2.3 ZUSTANDSREDUZIERUNG . 193 6.5 ASYNCHRONE SCHALTWERKE . 194 6.6 GRUNDLAGEN SYNCHRONER SCHALTWERKE . 196 6.6.1 RESET-LOGIK ZUR VORGABE DES ANFANGSZUSTANDS . 196 6.6.2 ASYNCHRONE UND SYNCHRONE EINGABE . 197 6.6.3 KOMBINATORISCHE AUSGABE UND REGISTERAQSGABE . 197 6.7 BEISPIEL FUER DIE ANALYSE SYNCHRONER SCHALTWERKE . 199 6.8 BEISPIELE FUER DEN ENTWURF SYNCHRONER SCHALTWERKE . 200 6.9 EINSATZ VON FESTWERTSPEICHERN BEIM ENTWURF SYNCHRONER SCHALTWERKE . 208 6.9.1 MEALY-AUTOMAT . 208 6.9.2 MOORE-AUTOMAT . 210 6.9.3 SCHALTWERKSENTWURF MIT MASKIERTEN EINGANGSVARIABLEN . 210 7 DIGITALE HALBLEITERSPEICHER .215 7.1 SCHREIB-ZLESESPEICHER (RAM) . 216 7.1.1 STATISCHES RAM (SRAM) . 217 7.1.2 DYNAMISCHES RAM (DRAM) .220 7.1.3 DAS FAST-PAGE-MODE-DRAM (FPM-DRAM) . 225 7.1.4 DAS ENHANCED DRAM (EDRAM) . 226 7.1.5 DAS EXTENDED-DATA-OUTPUT-DRAM (EDO-DRAM) . 226 7.1.6 BURST EXTENDED DATA OUTPUT DRAM (BEDO-DRAM) . 227 7.1.7 DAS SYNCHRONE DRAM (SDRAM) . 228 7.1.8 DAS ENHANCED SDRAM (ESDRAM) .230 7.1.9 QUASISTATISCHES DYNAMISCHES RAM . 231 7.1.10 DUAL-PORT-RAM UND VIDEO-RAM .232 7.1.11 FIRST-INZFIRST-OUT-SPEICHER (FIFO-SPEICHER) . 235 7.2 FESTWERTSPEICHER (ROM) . 237 7.2.1 MASKENPROGRAMMIERTES ROM .238 7.2.2 PROGRAMMIERBARES ROM (PROM) . 239 7.2.3 UV-LOESCHBARES, PROGRAMMIERBARES ROM (EPROM) . 239 7.2.4 ELEKTRISCH LOESCHBARE, PROGRAMMIERBARE ROMS (EAROM, EEPROM) . 241 7.2.5 NICHTFLUECHTIGE RAMS (NON VOLATILE RAMS, NOVRAMS) . 243 7.3 ENTWURF KOMPLEXER SPEICHERSYSTEME . 243 7.4 TABELLARISCHE UEBERSICHT UEBER VERFUEGBARE SPEICHERBAUSTEINE .247 8 ANALOG-DIGITAL UND DIGITAL-ANALOG-UMSETZER .249 8.1 DAS WESEN VON ANALOG-DIGITAL-UMSETZERN .249 8.2 ANWENDUNGEN VON ANALOG-DIGITAL UND DIGITAL-ANALOG-UMSETZERN . 251 INHALTSVERZEICHNIS XI 8.3 SYSTEME ZUR UMSETZUNG ANALOGER IN DIGITALE SIGNALE UND DIGITALE IN ANALOGE SIGNALE . 253 8.3.1 DAS ABTASTTHEOREM . 254 8.3.2 DAS ABTASTHALTEGLIED (AHG) . 255 8.3.2.1 FORDERUNGEN AN EIN AHG WAEHREND DER ABTASTPHASE . 258 8.3.2.2 FORDERUNGEN AN EIN AHG WAEHREND DER HALTEPHASE . 258 8.3.2.3 FORDERUNGEN AN EIN AHG BEZUEGLICH DER UMSCHALTCHARAKTERISTIK . 259 8.3.3 ERREICHBARE GENAUIGKEIT FUER ADUS MIT EINER CODEWORTLAENGE VON N BIT . 262 8.3.4 DIGITALCODES FUER ADUS UND DAUS . 264 8.4 PRINZIPIEN DER ANALOG-DIGITAL-UMSETZUNG . 266 8.4 .1 DAS PARALLELVERFAHREN .266 8.4.2 DAS WAEGEVERFAHREN . 268 8.4.2.1 ANALOG-DIGITAL-UMSETZER MIT SUKZESSIVER APPROXIMATION . 270 8.4.2.2 ANALOG-DIGITAL-UMSETZER NACH DEM WAEGEPRINZIP IN KASKADENSTRUKTUR. 271 8.4.3 DAS ZAEHLVERFAHREN . 273 8.4.4 DAS ERWEITERTE PARALLELVERFAHREN . 274 8.4.4.1 DAS ALLGEMEINE PRINZIP DES ERWEITERTEN PARALLELVERFAHRENS . 274 8.4.4.2 DER PIPELINE-ANALOG-DIGITAL-UMSETZER . 277 8.4.5 DAS ERWEITERTE ZAEHLVERFAHREN . 279 8.4.6 SONDERFORMEN VON ANALOG-DIGITAL-UMSETZERN . 280 8.4.6.1 INDIREKTE VERFAHREN . 280 8.4.6.1.1 DAS SAEGEZAHNVERFAHREN . 280 8.4.6.1.2 DAS DOPPEL-INTEGRATIONS-VERFAHREN . 282 8.4.6.1.3 DAS MEHRFLANKEN-UMSETZ-VERFAHREN . 284 8.4.6.2 DER SIGMA-DELTA-UMSETZER . 284 8.4.6.3 DIE NICHTLINEARE ANALOG-DIGITAL-UMSETZUNG . 287 8.5 PRINZIPIEN DER DIGITAL-ANALOG-UMSETZUNG .287 8.5.1 DIE SUMMATION GEWICHTETER STROEME . 289 8.5.2 UMSETZER MIT R-2R-LEITEMETZWERK . 290 8.6 EIGENSCHAFTEN REALER AD UND DA-UMSETZER . 291 8.6.1 STATISCHE FEHLER . 292 8.6.1.1 DIE QUANTISIERUNGSFEHLER . 292 8.6.1.2 DER OFFSETFEHLER . 293 8.6.1.3 DER VERSTAERKUNGSFEHLER . 294 8.6.1.4 DIE NICHTLINEARITAET . 294 8.6.1.5 DIE DIFFERENTIELLE NICHTLINEARITAET . 295 8.6.1.6 DER MONOTONIEFEHLER . 295 8.6.1.7 DIE BETRIEBSSPANNUNGSABHAENGIGKEIT DER WANDLERPARAMETER . 295 8.6.2 DYNAMISCHE FEHLER . 296 8.6.2.1 DIE EINSCHWINGZEIT . 296 8.6.2.2 DER SIGNAL-RAUSCH-ABSTAND UND DIE EFFEKTIVE AUFLOESUNG . 297 8.6.2.3 HARMONISCHE VERZERRUNGEN . 298 8.6.2.4 DAS HISTOGRAMM . 298 8.6.2.5 GLITCH-FLAECHE . 299 8.7 BETRIEB VON ANALOG-DIGITAL-UMSETZERN . 299 8.7.1 BETRIEB VON UNIVERSAL-ANALOG-DIGITAL-UMSETZEM . 300 8.7.2 BETRIEB VON ANALOG-DIGITAL-UMSETZERN MIT MIKROPROZESSOR-INTERFACE . 302 9 MIKROPROZESSOREN UND MIKROCONTROLLER . 305 9.1 GRUNDLAGEN DER MIKROPROZESSORTECHNIK . 305 9.1.1 ALLGEMEINES . 305 XII INHALTSVERZEICHNIS 9.1.2 DIE STRUKTUR EINES MIKRORECHNERS . 307 9.2 AUFBAU UND FUNKTION EINES 8-BIT-MIKROPROZESSORS . 310 9.2.1 DIE HARDWARE-STRUKTUR DES MIKROPROZESSORS 8085 . 311 9.2.2 DIE ARBEITSWEISE DES MIKROPROZESSORS 8085 . 314 9.2.2.1 DIE ZEITLICHE STRUKTUR DER BEFEHLSAUSFUEHRUNG . 316 9.2.3 DIE SOFTWARE-STRUKTUR DES MIKROPROZESSORS 8085 . 320 9.2.3.1 BEDEUTUNG UND AUFBAU VON BEFEHLEN . 320 9.2.3.2 DIE ADRESSIERUNGSARTEN . 321 9.2.3.3 DER BEFEHLSSATZ DES 8085 . 323 9.2.4 AUFBAU EINFACHER 8-BIT-MIKROCOMPUTER . 326 9.2.4.1 MINIMALKONFIG. EINES MIKROCOMPUTERS MIT DREI BAUSTEINEN . 326 9.2.4.2 DER EXPERIMENTIERCOMPUTER ECB 85 . 328 9.3 AUFBAU UND EINSATZ VON MIKROCONTROLLEM . 330 9.3.1 HARDWARE DES MIKROCONTROLLERS 8051 . 330 9.3.2 ZEITLICHER ABLAUF BEI DER BEFEHLSAUSFUEHRUNG . 337 9.3.3 DIE SOFTWARE-STRUKTUR DES MIKROCONTROLLERS 8051 . 340 9.3.3.1 DIE ADRESSIERUNGSARTEN DES MIKROCONTROLLERS 8051 . 340 9.3.3.2 DER BEFEHLSSATZ DES MIKROCONTROLLERS 8051 . 341 9.3.4 MIKROCONTROLLER-FAMILIE MCS51 . 344 9.3.5 8-BIT-MIKROCONTROLLER MIT INTERNEM ANALOG-DIGITAL-UMSETZER (SAB805 15). 345 9.3.6 MICROCONTROLLER-APPLIKATIONEN . 346 10 UEBUNGSAUFGABEN MIT LOESUNGEN . 351 10.1 MINIMIEREN LOGISCHER GLEICHUNGEN . 352 10.2 MINIMIEREN LOGISCHER GLEICHUNGEN . 353 10.3 MINIMIEREN LOGISCHER GLEICHUNGEN . 355 10.4 MINIMIEREN LOGISCHER GLEICHUNGEN . 358 10.5 ENTWURF EINES 2-BIT-VERGLEICHERS . 360 10.6 SCHALTNETZ ZUR WASSERSTANDSREGELUNG . 362 10.7 WIDERSTANDSDIMENSIONIERUNG FUER GATTER MIT OFFENEM KOLLEKTOR . 364 10.8 ANSTEUERUNG VON LEUCHTDIODEN . 366 10.9 ANSTEUERUNG EINER 7-SEGMENT-ANZEIGE . 369 10.10 DARSTELLUNG VON HEXADEZIMALZIFTEM AUF EINER 7-SEGMENT-ANZEIGE . 370 10.11 ZUSTANDS UND FLANKENGESTEUERTES D-FLIPFLOP . 372 10.12 ANALYSE EINES SCHALTWERKS MIT D-FLIPFLOPS . 373 10.13 ENTWURF EINES JK UND EINES T-FLIPFLOPS MIT HILFE EINES D-FLIPFLOPS . 375 10.14 STEUERUNG EINER AMPELANLAGE . 375 10.15 GRAY-CODE-ZAEHLER . 378 10.16 ZAEHLERENTWURF UNTER EINSATZ EINES PROGRAMMIERBAREN ZAEHLERS . 379 10.17 SYNCHRONER MODULO-5-ZAEHLER . 381 10.18 ENTWURF EINES SYNCHRONEN SCHALTWERKS (MOORE-AUTOMAT) . 384 10.19 ENTWURF EINES SYNCHRONEN SCHALTWERKS (MEALY-AUTOMAT) . 389 10.20 ENTWURF EINES SYNCHRONEN SCHALTWERKS MIT REGISTERAUSGABE . 393 10.21 ENTWURF EINES SYNCHRONEN SCHALTWERKS MIT FESTWERTSPEICHER . 396 10.22 SYNCHRONES SCHALTWERK MIT MULTIPLEXER UND FESTWERTSPEICHER . 401 10.23 ENTWURF EINES SPEICHERSYSTEMS MIT 8-BIT-WORTBREITE .409 10.24 SPEICHERSYSTEM MIT 16-BIT-DATENBUS . 412 10.25 ENTWURF EINES SCHALTNETZES MIT EINEM FESTWERTSPEICHER . 414 10.26 ENTWURF EINER TESTSCHALTUNG .416 10.27 MIKROCONTROLLERSYSTEM MIT EXTERNER SPEICHERERWEITERUNG .418 10.28 TASTENDECODIERUNG MIT DEM MIKROCONTROLLER 8051 .419 INHALTSVERZEICHNIS XIII 11 ANHANG . 425 11.1 SCHALTSYMBOLE IN DER DIGITALTECHNIK . 425 11.1.1 FUNKTIONSBLOECKE . 425 11.1.2 BESCHREIBUNGSFELDER . 428 11.1.3 ABHAENGIGKEITSNOTATION .429 11.1.3.1 UND-ABHAENGIGKEIT (G) . 430 11.1.3.2 ODER-ABHAENGIGKEIT (V) . 431 11.1.3.3 NEGATIONS-ABHAENGIGKEIT (N) . 431 11.1.3.4 VERBINDUNGS-ABHAENGIGKEIT (Z) . 432 11.1.3.5 SETZ UND RUECKSETZ-ABHAENGIGKEIT (S, R) . 432 11.1.3.6 STEUER-ABHAENGIGKEIT (C) . 433 11.1.3.7 FREIGABE-ABHAENGIGKEIT (EN) . 433 11.1.3.8 MODE-ABHAENGIGKEIT (M) . 434 11.1.3.9 ADRESSEN-ABHAENGIGKEIT (A) . 434 11.2 BEFEHLSLISTE DES MIKROPROZESSORS 8080/8085 . 435 11.3 BEFEHLSLISTE DES MIKROCONTROLLERS 8051 . 438 12 LITERATUR . 441 13 SACHVERZEICHNIS . 445
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