Entwurf selbstgetakteter Pipelinearchitekturen für hohe Datendurchsatzraten:
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1996
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INHALTSVERZEICHNIS
EINLEITUNG
1
1.
SELBSTGETAKTETE
LOGIK
S
1.1
SIGNALUEBERGANGSGRAPHEN
5
1.2
ABWEICHUNGEN
VOM
SPEZIFIZIERTEN
VERHALTEN
7
1.3
REALISIERUNG
KOMMUNIZIERENDER
PROZESSE
12
2.
REALISIERUNGSFORMEN
SELBSTGETAKTETER
PIPELINES
22
2.1
KONTROLLOGIK
EINER
SELBSTGETAKTETEN
PIPELINE
23
2.2
REALISIERUNG
DER
VERARBEITUNGSEINHEITEN
25
2.2.1
VIER-PHASEN-MICROPIPELINE
25
2.2.2
SUTHERLAND-MICROPIPELINE
26
2.2.3
DYNAMISCHE
LOGIK
28
2.2.4
FLANKENSENSITIVE
LOGIK
29
2.3
WAHL
DER
GRANULARITAET
FUER
DAS
VIER-PHASEN-PROTOKOLL
30
2.4
VERGLEICH
DER
VERSCHIEDENEN
REALISIERUNGSFORMEN
34
3.
OPTIMALE
DIMENSIONIERUNG
DER
KONTROLLOGIK
37
3.1
MATHEMATISCHE
PROGRAMMIERUNG
38
3.1.1
KUHN-TUCKER-BEDINGUNGEN
38
3.1.2
KONVEXE
PROGRAMMIERUNG
39
3.1.3
GEOMETRISCHE
PROGRAMMIERUNG
41
3.2
MODELLIERUNG
DER
GATTER
IM
KONTROLLPFAD
43
3.2.1
MODELLE
FUER
DIE
OPTIMIERUNG
DIGITALER
CMOS-SCHALTUNGEN
44
3.2.2
DAS
MODELL
FUER
DIE
DIMENSIONIERUNG
DER
KONTROLLOGIK
46
3.3
BESTIMMUNG
DER
OPTIMALEN
TRANSISTORWEITEN
48
3.3.1
ABSCHAETZUNG
DER
EINGANGSKAPAZITAETEN
UND
DES
ENERGIEVERBRAUCHS
EINES
GATTERS
49
3.3.2
FORMULIERUNG
DES
MATHEMATISCHEN
PROGRAMMS
50
3.3.3
LOESUNG
DES
GEOMETRISCHEN
PROGRAMMS
52
3.3.4
UEBERPRUEFUNG
DER
GEFUNDENEN
TRANSISTORWEITEN
54
3.4
EIGENSCHAFTEN
DER
KONTROLLOGIK
56
4.
ENTWURF
SELBSTGETAKTETER
PIPELINEARCHITEKTUREN
60
4.1
PETRI-NETZE
61
4.2
MODELLIERUNG
SELBSTGETAKTETER
PIPELINESTUFEN
62
4.3
MAX-PLUS-ALGEBRA
65
4.4
BESTIMMUNG
DER
DATENDURCHSATZRATE
70
4.4.1
ZEITINVARIANTES
SYSTEM
70
4.4.2
ZYKLISCH
ZEITVARIANTES
SYSTEM
75
4.4.3
STOCHASTISCH
ZEITVARIANTES
SYSTEM
78
5.
ENTWURF
EINES
SYMMETRISCHEN
FIR-FILTERS
85
5.1
EINFACHES
ZUSAMMENSETZEN
DER
MULTIPLIZIERER
UND
ADDIERER
85
5.2
EINFUEGEN
ZUSAETZLICHER
PIPELINESTUFEN
87
5.3
OPTIMIERUNG
DER
KONTROLLOGIK
FUER
DAS
FILTER
89
5.4
VERGLEICH
MIT
SYNCHRON
GETAKTETEN
REALISIERUNGEN
92
5.4.1
SCHNITTEBENEN
FUER
EINE
OPTIMALE
DATENDURCHSATZRATE
93
5.4.2
SCHNITTEBENEN
FUER
EINEN
MINIMALEN
HARDWAREAUFWAND
94
5.4.3
MULTIRATE
SYSTOLIC
DESIGN
95
5.5
BIT-PLANE-REALISIERUNG
DES
FILTERS
97
5.6
INTEGRIERTE
TESTSCHALTUNG
98
ZUSAMMENFASSUNG
100
ANHANG
104
AL
FITTING-PARAMETER
FUER
DIE
GATTER
DER
KONTROLLOGIK
104
A2
FREE-ACCUMULATION
IN
EINEM
TRANSVERSALFILTER
105
LITERATURVERZEICHNIS
107 |
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