Architekturen der digitalen Signalverarbeitung:
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| Format: | Book |
| Language: | German |
| Published: |
Stuttgart
Teubner
1996
|
| Series: | Informationstechnik
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INHALTSVERZEICHNIS
VORWORT
1
EINFUEHRUNG
.
1
1.1
ALGORITHMEN
DER
SIGNALVERARBEITUNG
.
1
1.2
IMPLEMENTIERUNGSASPEKTE
.
5
1.3
INHALTSUEBERSICHT
.
9
2
GRUNDSCHALTUNGEN
IN
CMOS-TECHNOLOGIE
.
11
2.1
TRANSISTOR-MODELLIERUNG
.
11
2.2
GRUNDSCHALTUNGEN
.
19
2.3
SILIZIUMFLAECHE
.
30
2.4
VERZOEGERUNGSVERHALTEN
.
31
2.5
AUFGABEN
.
39
3
REALISIERUNG
DER
BASISOPERATIONEN
.
45
3.1
ZAHLENDARSTELLUNG
.
45
3.2
ADDIERER
UND
SUBTRAHIERER
.
53
3.2.1
ADDIERERGRUNDSCHALTUNGEN
.
53
3.2.2
ADDIERER
MIT
SCHNELLEM
UEBERTRAGSDURCHLAUF
.
59
3.2.3
ADDIERER
MIT
PARALLELER
UEBERTRAGSBERECHNUNG
.
64
3.2.4
HIERARCHISCHE
ADDIERERSTRUKTUREN
.
67
3.2.5
SUBTRAHIERER
.
78
3.2.6
CARRY-SAVE-ADDIERER
.
79
3.3
MULTIPLIZIERER
.
82
3.3.1
MULTIPLIZIERER
POSITIVER
ZAHLEN
.
82
3.3.2
MULTIPLIZIERER
VORZEICHENBEHAFTETER
ZAHLEN
.
95
3.4
DIVIDIERER
.
106
3.4.1
BINAERER
DIVISIONSALGORITHMUS
.
106
3.4.2
ARRAY-DIVIDIERER
.
109
3.5
REALISIERUNG
ELEMENTARER
FUNKTIONEN
.
115
3.5.1
BERECHNUNGSVERFAHREN
ELEMENTARER
FUNKTIONEN
.
115
3.5.2
DAS
CORDIC-VERFAHREN
.
120
3.6
AUFGABEN
.
132
4
MASSNAHMEN
ZUR
LEISTUNGSSTEIGERUNG
.
137
4.1
PARALLELVERARBEITUNG
UND
PIPELINING
.
137
4.2
EFFIZIENZVERGLEICH
.
147
4.3
AUFGABEN
.
157
VIII
INHALTSVERZEICHNIS
5
ARRAY-PROZESSORARCHITEKTUREN
.
159
5.1
ARRAY-PROZESSORREALISIERUNGEN
.
159
5.2
ALGORITHMENDARSTELLUNGEN
.
163
5.3
LINEARES
ABBILDUNGSVERFAHREN
.
173
5.3.1
ABSCHAETZUNG
DER
ANZAHL
DER
PES
.
175
5.3.2
ABBILDUNG
OHNE
AENDERUNG
DER
KNOTENANZAHL
.
176
5.3.3
ABBILDUNG
MIT
VERRINGERUNG
DER
KNOTENANZAHL
.
180
5.3.4
FORMALE
BESCHREIBUNG
DES
PROJEKTIONSVERFAHRENS
.
185
5.3.5
MULTIPROJEKTION
.
193
5.4
ERWEITERUNGEN
DER
ABBILDUNGSVERFAHREN
.
197
5.4.1
PARTITIONIERUNG
.
197
5.4.2
PROJEKTION
VON
KNOTEN
MIT
UNTERSCHIEDLICHEN
OPERATIONEN
.
203
5.5
REALISIERUNGSASPEKTE
UND
OPTIMIERUNG
.
207
5.6
AUFGABEN
.
210
6
FILTERSTRUKTUREN
.
217
6.1
CHARAKTERISIERUNG
DIGITALER
FILTER
.
217
6.2
ID
FIR-FILTERSTRUKTUREN
.
221
6.2.1
SIGNALFLUSSGRAPH
DES
ID
FIR-FILTERS
.
221
6.2.2
REALISIERUNG
FUER
NIEDRIGE
DURCHSATZRATEN
.
223
6.2.3
REALISIERUNG
FUER
HOHE
DURCHSATZRATEN
.
224
6.3
2D
FIR-FILTER
.
234
6.4
POLYPHASENFILTERSTRUKTUREN
.
236
6.4.1
DEZIMATIONSFILTER
.
237
6.4.2
INTERPOLATIONSFILTER
.
239
6.4.3
FILTERBAENKE
.
241
6.5
IIR-FILTERSTRUKTUREN
.
244
6.5.1
REKURSIVE
FILTER
IN
DIREKTFORM
.
245
6.5.2
MSB-FIRST-ARITHMETIK
.
247
6.5.3
LOOK-AHEAD-TECHNIK
.
252
6.6
AUFGABEN
.
254
7
REALISIERUNGEN
DER
DISKRETEN
FOURIER-TRANSFORMATION
.
257
7.1
CHARAKTERISTIK
DER
DFT
.
257
7.2
DIREKTE
IMPLEMENTIERUNG
DER
DFT
.
259
7.3
SCHNELLE
FOURIER-TRANSFORMATION
.
263
7.4
AUFGABEN
.
272
8
PROGRAMMIERBARE
DIGITALE
SIGNALPROZESSOREN
.
275
8.1
ARCHITEKTUREN
VON
DSP-PROZESSOREN
.
276
8.1.1
ARCHITEKTUREN
VON
STANDARD-RECHNERN
.
276
8.1.2
MASSNAHMEN
ZUR
STEIGERUNG
DER
SIGNALVERARBEITUNGSLEISTUNG
.
282
IX
8.1.3
CHARAKTERISTIKEN
VERFUEGBARER
DSP-PROZESSOREN
.
288
8.2
PROGRAMMIERUNG
VON
SIGNALVERARBEITUNGSALGORITHMEN
.
293
8.2.1
FIR-FILTER-PROGRAMM
.
294
8.2.2
DFT-PROGRAMM
.
298
8.3
ARCHITEKTUROPTIMIERUNG
MIT
EINFACHEN
MODELLEN
.
301
8.3.1
INSTRUKTIONS-PIPELINING
.
301
8.3.2
SPEZIELLE
ARITHMETISCHE
MODULE
.
305
8.3.3
ON-CHIP-SPEICHER
.
307
8.4
ENTWURFSUNTERSTUETZUNG
FUER
DSP-SYSTEME
.
309
8.5
AUFGABEN
.
310
9
MULTIPROZESSORSYSTEME
.
313
9.1
ARCHITEKTUREN
VON
MULTIPROZESSOREN
.
313
9.2
LEISTUNGSVERGLEICH
VON
MULTIPROZESSORSTRUKTUREN
.
325
9.3
AUFGABEN
.
333
10
IMPLEMENTIERUNGSSTRATEGIEN
.
337
10.1
ALGORITHMUSABHAENGIGE
ARCHITEKTURMODIFIKATIONEN
.
337
10.2
REALISIERUNGSALTEMATIVEN
.
344
10.3
AUFGABEN
.
351
LITERATUR
.
353
STICHWORTVERZEICHNIS
.
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