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Bibliographic Details
Main Author:	Pernards, Peter 1943- (Author)
Format:	Book
Language:	German
Published:	Heidelberg Hüthig 1986
Subjects:	Digital electronics Digitaltechnik
Online Access:	Inhaltsverzeichnis
Physical Description:	IX, 206 S. graph. Darst.
ISBN:	3778511610

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adam_text	INHALTSVERZEICHNIS 1. EINFUHRUNG 1 1.1 ANALOG UND DIGITAL 1 1.2 DIGITALE UND BINAERE SIGNALE 3 2. ZAHLENSYSTEME 5 2.1 POLYADISCHE ZAHLENSYSTEME 6 2.2 UMWANDLUNG VON ZAHLEN ZWISCHEN SYSTEMEN UNTERSCHIEDLICHER BASEN 7 2.3 ARITHMETIK IM DUALSYSTEM 10 2.4 DARSTELLUNG NEGATIVER ZAHLEN 11 2.5 UEBUNG, ZAHLENSYSTEME 14 3. CODES 15 3.1 NUMERISCHE CODES 16 3.2 ALPHANUMERISCHE CODES 20 3.3 CODESICHERUNG 22 3.4 UEBUNG, CODES 23 4. SCHALTALGEBRA 25 4.1 SCHALTVARIABLE UND SCHALTFUNKTION 25 4.2 RECHEN- UND KUERZUNGSREGELN 25 4.3 VERKNUEPFUNGEN UND SCHALTSYMBOLE 30 4.4 VORRANGREGELN 34 4.5 NORMALFORMEN, MINTERME, MAXTERME 35 4.6 UEBUNG, SCHALTALGEBRA 39 5. LOGISCH-PHYSIKALISCHE ZUSAMMENHAENGE 41 5.1 POSITIVE UND NEGATIVE LOGIK 42 5.2 AUSGANGSSCHALTUNGEN 47 5.3 WIRED-TECHNIK 48 5.4 UEBUNG, LOGISCH-PHYSIKALISCHE ZUSAMMENHAENGE 49 6. ANALYSE VON SCHALTNETZEN 51 6.1 UEBUNG, ANALYSE VON SCHALTNETZEN 54 7. MINIMIERUNG VON SCHALTFUNKTIONEN 57 7.1 MINIMIERUNG MIT KV-TAFELN 57 7.2 REDUNDANZEN 63 7.3 KONJUNKTIVE MINIMALFORM 64 7.4 MULTI-OUTPUT-SCHALTNETZE 65 7.5 VORGEHENSWEISE BEI DER MINIMIERUNG 66 7.6 UEBUNG, MINIMIERUNG 68 HTTP://D-NB.INFO/860739589 8. SYNTHESE VON SCHALTNETZEN I, MINIMALFORMEN 69 8.1 SCHALTNETZREALISIERUNG BEI VORGEGEBENEN VERKNUEPFUNGEN 69 8.2 UEBUNG, SYNTHESE I 73 9. HAEUFIG BENOETIGTE SCHALTNETZE 75 9.1 VERGLEICHER (KOMPARATOREN) 75 9.2 CODE-UMSETZER 78 9.3 MULTIPLEXER 81 9.4 RECHENSCHALTUNGEN 83 10. SYNTHESE VON SCHALTNETZEN N, NORMALFORMEN 89 10.1 SCHALTUNGSAUFBAU MIT MULTIPLEXERN 89 10.2 SCHALTUNGSAUFBAU MIT NICHTFLUECHTIGEN SPEICHERN 91 10.3 UEBUNG, SYNTHESE II 94 11. EINFUEHRUNG IN DIE SCHALTWERKE 95 11.1 SCHALTNETZE UND SCHALTWERKE 95 11.2 ZUSTANDSDIAGRAMM UND ZUSTANDSFOLGETABELLE 96 11.3 STRUKTUR VON SCHALTWERKEN 99 11.4 SYNCHRONER UND ASYNCHRONER BETRIEB 102 12. FLIPFLOPS 103 12.1 BASIS-FLIPFLOPS 103 12.2 FLIPFLOPS MIT TAKTSTEUERUNG 107 12.2.1 TAKTZUSTANDSGESTEUERTE EINSPEICHER-FLIPFLOPS 108 12.2.2 TAKTZUSTANDSGESTEUERTE ZWEISPEICHER-FLIPFLOPS 113 12.2.3 TAKTFLANKENGESTEUERTE FLIPFLOPS 116 12.3 KONVERTIERUNG VON FLIPFLOP-TYPEN 119 12.4 UEBERSICHTSBILDER 119 12.5 UEBUNG, FLIPFLOPS 121 13. SYNTHESE VON ZAEHLSCHALTUNGEN 125 13.1 SYNCHRONE ZAEHLER 125 13.2 ASYNCHRONE ZAEHLER 138 13.3 UEBUNG, ZAEHLER 139 14. REGISTER UND SCHIEBEREGISTER 141 14.1 AUFFANGREGISTER 141 14.2 SCHIEBEREGISTER 141 14.3 REGISTERSCHALTUNGEN ALS SPEICHER IN SCHALTWERKEN 144 14.4 UEBUNG, REGISTER UND SCHIEBEREGISTER 148 15. HALBLEITERSPEICHER 149 15.1 DEFINITIONEN UND BEGRIFFE 149 15.2 ORTSADRESSIERBARE HALBLEITERSPEICHER 151 15.2.1 NICHTFLUECHTIGE SPEICHER 152 IX 15.2.1.1 ROM 154 15.2.1.2 PROM 155 15.2.1.3 EPROM 156 15.2.1.4 EEPROM ODER EAROM 158 15.2.2 FLUECHTIGE SPEICHER 160 15.2.2.1 SRAM 162 15.2.2.2 DRAM 164 15.3 INHALTSADRESSIERBARE HALBLEITERSPEICHER 168 16. PROGRAMMIERBARE LOGIK 171 16.1 EINFUHRUNG IN PLA UND PAL 171 16.2 PLA 173 16.3 PAL 176 17. LOESUNGEN ZU DEN UEBUNGEN 179 18. ANHANG ZUR ABHAENGIGKEITSNOTATION 193 19. LITERATURVERZEICHNIS 199 19.1 ERGAENZENDE LITERATUR 199 19.2 NORMBLAETTER 199 SACHREGISTER 201
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