Monolithisch-integrierte Demultiplexer hoher Ordnung für optische Übertragungssysteme bis 20 Gbit/s:
Gespeichert in:
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| Format: | Buch |
| Sprache: | German |
| Veröffentlicht: |
1995
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| Beschreibung: | Bochum, Univ., Diss., 1995 |
| Beschreibung: | VII, 133 S. Ill., graph. Darst. |
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INHALTSVERZEICHNIS
LISTE
DER
VERWENDETEN ABKUERZUNGEN
UND
SYMBOLE
.IV
1
EINLEITUNG
.
1
1.1
ANWENDUNGSGEBIETE
FUER
DEMULTIPLEXER
.
1
1.2
STAND
DER
TECHNIK
BISHER
VEROEFFENTLICHTER
1
:4-DEMULTIPLEXER
.
2
1.3
ZIELE
UND
GLIEDERUNG DIESER
ARBEIT
.
3
2
DAS
OPTISCHE
UEBERTRAGUNGSSYSTEM
UND
DER
DEMULTIPLEXER
.
6
3
ENTWUERFE
VON
1:4-DEMULTIPLEXEM
.
10
3.1
TYPEN
VON
1:4-DEMULTIPLEXEM
UND
IHRE
UNTERSCHIEDE
.
10
3.2
ANFORDERUNG
AN
EINEN
SYSTEMGERECHTEN
1:4-DEMULTIPLEXER
.
13
3.3
ENTWURFSVERFAHREN
FUER
1
:4-DEMULTIPLEXER
.
14
3.3.1
BLOCKSCHALTBILD
DES
1:4-DEMULTIPLEXERS
.
14
3.3.2
DER
1:2-DEMULTIPLEXER
.
17
3.3.3
DER
STATISCHE
FREQUENZTEILER
.
19
3.3.4
DIE PHASENEINSTELLUNGSSCHALTUNG
.
22
3.3.5
DER
KANALUMSCHALTER
.
27
3.3.6
DER
TAKTUMSCHALTER
(CLOCK
ENABLE)
.
30
4
LEITUNGSANPASSUNG,
MESSAUFBAU
UND
STABILITAET
VON
SCHALTUNGEN
.
33
4.1
ANPASSUNG
AN
EINGAENGEN
UND
AUSGAENGEN
.
33
4.1.1
ANPASSUNG
AM
EINGANG
UND
AUSGANG
MIT
ANPASSUNGSWIDERSTAND
AUF
DEM
CHIP
.
33
4.1.1.1
ANPASSUNG
AM
AUSGANG
MIT
ANPASSUNGSWIDERSTAND
AUF
DEM
CHIP
.
33
INHALTSVERZEICHNIS
4.1.1.2
AC-GEKOPPELTE
EINGANGSSTUFE
.
36
4.1.2
DER
OFFENE
KOLLEKTORAUSGANG
.
37
4.1.3
ANPASSUNG
AN
DER
EINGANGSSEITE
VOR
DEN
EMITTERFOLGEM
.
38
4.1.4
SCHALTUNGSSIMULATIONEN
ZUR
ANPASSUNG
MIT
S-PARAMETER
UND
STABILITAETSFAKTOR
K
.40
4.2
STABILISIERUNG
DER
SCHALTUNGEN
UND
DES
MESSAUFBAUS
.46
4.2.1
STABILITAET
BEIM
EMITTERFOLGER
.
.'.
.
47
4.2.2
KOPPLUNGSPROBLEME
VON
PARASITAEREN
PARAMETERN
AUF
DEM
CHIP,
ZWISCHEN
CHIP
UND
MESSFASSUNG
SOWIE
MASSNAHMEN
ZUR
STABILISIERUNG
.
49
4.2.3
STABILITAET
DES
MESSSCHALTUNGSAUFBAUS
.
51
4.2.3.1
OHNE
ENTKOPPLUNGSKAPAZITAET
AUF
DEM
CHIP
UND
AUF
DER
MESSFASSUNG
.
52
4.2.3.2
MIT
ENTKOPPLUNGSKAPAZITAET
C
B]OCK
AUF
DEM
CHIP
.
53
4.2.3.3
MIT
ENTKOPPLUNGSKAPAZITAETEN
UND
.
54
5
ENTWUERFE
VON
DEMULTIPLEXERN
MIT
NIEDRIGER
VERLUSTLEISTUNG
DURCH
NEUE
ARCHITEKTUREN
UND
NEUE
SCHALTUNGSTECHNIK
.
56
5.1
ANFORDERUNG
AN
NIEDRIGE
LEISTUNGSAUFNAHME
BEI
HOHER
DATENRATEN
.
56
5.2
NEUE
ARCHITEKTUREN
UND
SCHALTUNGSTECHNIK
VON
1:4-DEMULTIPLEXEM
.
57
5.2.1
DER
1
:4-DEMULTIPLEXER
MIT
HALTE-LATCH
IN
DREI-STROMSCHALTERTECHNIK
(HL-LATCH)
.
58
5.2.2
SIMULIERTER
BETRIEB
DES
1
:4-DEMULTIPLEXERS
MIT
H
1
-LATCHES
.
61
5.2.3
DER
1
:4-DEMULTIPLEXER
MIT
HALTE-LATCH
IN
ZWEI-STROMSCHALTERTECHNIK
(H2-LATCH)
.
64
5.2.4
DER
1
:4-DEMULTIPLEXER
MIT
HALTE-LATCH
IN
ZWEI-STROMSCHALTERTECHNIK
OHNE
REFERENZSPANNUNG
(H3-LATCH)
.
67
5.3
AUFBAU
EINES
1:
16-DEMULTIPLEXERS
MIT
1
:4-DEMULTIPLEXEM
.
70
5.3.1
DARSTELLUNG
DES
BLOCKSCHALTBILDES
DES
1:
16-DEMULTIPLEXERS
.
71
5.3.2
SIMULIERTE
ERGEBNISSE
DER
L:16-DEMULTIPLEXERMITH2-BZW.
H3-LATCHES
.
72
5.4
DISKUSSION
DER
VORTEILE
DER
NEUEN
ARCHITEKTUREN
.
75
INHALTSVERZEICHNIS
6
REALISIERUNG VON
1:4-DEMULTIPLEXEM
.
81
6.1
OPTIMIERUNGSVERFAHREN
.
81
6.2
AUGENDIAGRAMM
UND
MESSVERFAHREN
.
83
6.3
DER
REALISIERTE
1
:4-DEMULTIPLEXER
OHNE
ERSTEN
FREQUENZTEILER
.
85
6.4
MESSERGEBNISSE
DES
REALISIERTEN
1:4-DEMULTIPLEXERS
OHNE
ERSTEN
FREQUENZTEILER
.
87
6.5
DER
REALISIERTE
SYSTEMGERECHTE
1
:4-DEMULTIPLEXER
.
91
6.6
MESSERGEBNISSE
DES
REALISIERTEN
SYSTEMGERECHTEN
1:4-DEMULTIPLEXERS
.
95
6.7
MESSERGEBNISSE
DES
1:1
6-DEMULTIPLEXERS
.
100
7
TAKTRUECKGEWINNUNG
UND
1:4-DEMULTIPLEXER
ALS
EMPFANGSSEITIGE
FUNKTIONSEINHEIT
.
104
7.1
HYBRID-AUFBAU
VON
1
:4-DEMULTIPLEXER
UND
TAKTRUECKGEWINNUNG
.
104
7.2
1
:4-DEMULTIPLEXER
UND
TAKTRUECKGEWINNUNG
OHNE
ENTSCHEIDER
.
107
7.3
MONOLITHISCHE
INTEGRIERBARKEIT
VON
DEMULTIPLEXER
UND
TAKTRUECKGEWINNUNG
.
111
8
ZUSAMMENFASSUNG
.
112
9
ANHANG
.
115
ANHANG
I:
ENTWURF
DER
STROMQUELLEN
.
115
ANHANG
II:
STROMLAUFPLAN
DES
1
:4-DEMULTIPLEXERS
.
117
10
LITERATURVERZEICHNIS
.
123 |
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